专利名称：存储器带宽控制装置的制作方法
技术领域：
本发明涉及一种存储器带宽控制装置，且特别适用于将由外部输入至视频编辑设备的，诸如视频和音频之类的材料数据(material data)暂时地存储至一存储器，然后通过存储器处理该数据，或者对传输至硬盘驱动器的突发传输，执行存储器带宽控制。
背景技术：
为了通过输入/输出端口，将从外部装置中接收的材料数据存储到硬盘驱动器，视频编辑设备暂时将规定数量或更多的材料数据存储在存储器中，然后执行数据的突发传输，将数据传输至硬盘驱动器，以便在短时间内以改善了的传输效率来传输数据。
此外，为了编辑材料数据，视频编辑设备将硬盘驱动器里存储的材料数据，通过存储器，提供给诸如操纵装置之类的外部装置，从而编辑该数据，然后通过存储器，执行所编辑的材料数据的突发传输，从而将其再次存入硬盘驱动器，或者将其向外部输出。
如上所述，视频编辑设备和硬盘驱动器之间，通过存储器来传输材料数据。因此，存储器的带宽，是由存储器和通过输入/输出端口连接到视频编辑设备的多个外部装置来控制的。
在存储器带宽(位宽×时钟数)为100Mbps，并且有10个外部装置的情况下，视频编辑设备简单地根据外部装置的数目，平分存储器的带宽，从而导致利用时间划分，使每个装置分配到0.1秒(10Mbps)。
附带说明，借助于时间划分，上述视频编辑设备将存储器的带宽，固定分给每个通过输入/输出端口连接到其上的外部装置。因此，根据存储器的带宽，限制了将连接的外部装置的数目。另外，对于没有接收或输出材料数据的外部装置来说，其所分配到的存储器的带宽并没有使用，从而导致了数据传输效率的降低。
发明内容
鉴于以上所述，本发明的目的是提供一种可以显著地提高在外部装置和存储器间传输数据的效率的存储带宽控制装置。
本发明的存储带宽控制装置已经达到上述本发明的发明目的和其他发明目的，存储器带宽控制装置，包括一存储器，用于暂时存储和输出数据以便通过输入/输出端口与所连接的外部设备进行通信；以及一控制器，用于当收到从外部设备到存储器的数据的数据传输请求时，将存储器带宽动态分配给发送数据传输请求的外部设备的输入/输出端口。因此，与固定分配存储器带宽的情况相比，存储器带宽可以被有效利用。其结果是可以不浪费存储器带宽，从而显著提高数据向存储器的传输效率，这样可以实现能够显著提高外部设备与存储器间数据传输效率的存储器带宽控制装置。
此外，本发明提供一种存储器带宽分配方法，此方法包括接收向存储器传输数据的数据传输请求的数据传输请求接收步骤，该数据与通过输入/输出端口连接的外部设备进行通信，该存储器用来暂时存储和输出数据；以及将存储器带宽动态分配给发送数据传输请求的外部装置的输入/输出端口的控制步骤。其结果是可以不浪费存储器带宽，从而显著提高存储器的数据传输效率，与固定分配存储器带宽的情况相比，得到可以实现显著提高外部设备与存储器间数据传输效率的存储器带宽分配方法。
更进一步，本发明提供了一种由编辑设备执行的存储器带宽分配程序，该程序包括接收向存储器传输数据的数据传输请求的数据传输请求接收步骤，该数据与通过输入/输出端口连接的外部设备进行通信，该存储器用来暂时存储和输出数据；以及将存储器带宽动态分配给发送数据传输请求的外部装置的输入/输出端口的控制步骤。其结果是可以不浪费存储器带宽，从而显著提高存储器的数据传输效率，与固定分配存储器带宽的情况相比，得到可以实现显著提高外部设备与存储器间数据传输效率的存储器带宽分配程序。
在结合附图阅读时，本发明的本质，原理和作用将从以下详细说明中变得更加明显，附图中相似的数字或字符表示相似的部分。
在附图中图1为根据本发明，存储器带宽控制装置的电路结构的原理模块图；
图2为说明对于一个输入/输出端口的带宽分配过程的原理模块图；图3为说明I/O缓冲器W的操作的原理示意图；以及图4为说明I/O缓冲器R的操作的原理示意图。
具体实施例方式
参照附图，将说明本发明的优选实施例(1)存储器带宽控制装置的电路结构参照图1，附图标记1标识安装在编辑设备中的本发明的存储器带宽控制装置，其通过存储器80与硬盘驱动器(HDD)60传输材料数据，存储器80包括诸如双倍数据传输率-同步动态随机存取存储器(DDR-SDRAM)。
存储器带宽控制装置1以现场可编程门阵列(FPGA)构造，并设计该装置，使其通过各种输入/输出端口，如第一串行数据接口(SDI)-IN端口3、第二SDI-IN端口4、第一SDI-OUT端口5、第二SDI-OUT端口6，ENC/DEC端口7和CPU端口12，与连接至I/O缓冲器2的第一至第四装置50到53，编码器/解码器(ENC/DEC)54和CPU62，进行材料数据的传输，并且通过存储器80，从经过外设部件互连(PCI)端口11连接的硬盘驱动器(HDD)60读出或向其写入材料数据。
应当注意，组成材料数据的视频数据、音频数据和元数据，可以在I/O缓冲器2与第一、第二SDI-IN端口3、4和第一、第二SDI-OUT端口5、6之间，通过三个读端口或者三个写端口，传输三种类型的数据。
此外，在I/O缓冲器2与ENC/DEC端口7、PCI端口11和CPU端口12之间，通过一个写端口和一个读端口来传输数据。
另外，还存在一个没有与外部连接的视频处理(VPROC)端口10，并且数据可以根据需要，通过单个或多个读端口和写端口，在VPROC端口10和I/O缓冲器2之间进行通信。
I/O缓冲器2是一个通过存储控制器70，在存储器80和输入/输出端口之间传输数据的模块，且其内部包括一个只写I/O缓冲器W 81和一个只读I/O缓冲器R 82。I/O缓冲器W 81和I/O缓冲器R 82，可以根据写入操作或读取操作，通过选择器83来进行切换。
I/O缓冲器W 81和I/O缓冲器R82，可以吸收输入/输出端口与存储器80之间数据传输速率的差值，以便提高向存储器80持续突发传输的效率。
该存储器带宽控制装置1，将存储器带宽动态分配给在第一SDI-IN端口3、第二SDI-IN端口4、第一SDI-OUT端口5、第二SDI-OUT端口6、ENC/DEC端口7、VPROC端口10、PCI端口11和CPU端口12中的请求数据传输的各个输入/输出端口，并为了存储器带宽的分配，与各个输入/输出端口进行信号交换。
基本上，一个输入/输出端口在每次向存储器80写入或从其中读出数据的同时，向I/O缓冲器2输出一个数据传输请求(请求)，且I/O缓冲器2将所请求带宽分配给请求数据传输的该输入/输出端口，并向该输入/输出端口输出响应信号(应答)，以便将存储器带宽的预留通知输入/输出端口。
应当注意的是，每个输入/输出端口都包含一个或多个读/写端口，并且在一个读端口/写端口的基础上，实现输入/输出端口与I/O缓冲器2之间的通信。
(2)带宽分配过程概要顺序地，结合图2，说明I/O缓冲器2以存储器带宽分配程序来执行读/写端口的带宽分配的过程。
例如，当I/O缓冲器2中的I/O缓冲器W 81接收到来自一个或多个写端口13、14、...、28的数据传输请求(请求)时，具有一个无源带宽分配电路81A(在下文中，简称为PBA电路)的I/O缓冲器控制器81B，将在I/O缓冲器2与存储器80之间的存储器总线带宽动态分配给发送数据传输请求的写端口13、14、...、28。
I/O缓冲控制器81B转换将被写入的材料数据，该材料数据以32位宽度数据总线顺序地从由PBA电路81A分配了存储器带宽的写端口13、14、...、28接收，从而将这些数据以256位宽度数据总线发送到缓冲器81C中。当规定大小的数据存储到缓冲器81C时，I/O缓冲控制器81B将一个数据传输请求(请求)输出给选择器83中的PBA电路83A。
选择器83中的PBA电路83A，根据数据传输请求(请求)是来自I/O缓冲器W 81或I/O缓冲器R 82，在与存储器80进行数据通信的I/O缓冲器W 81和I/O缓冲器R 82之间进行交替切换。
当选择器83选择I/O缓冲器W 81时，存储控制器70将从第一SDI-IN端口3、第二SDI-IN端口4、ENC/DEC端口7、VPROC端口10、PCI端口11和CPU端口12中任一端口接收的，要被写入的材料数据，由I/O缓冲器W 81传输给存储器80。且当选择I/O缓冲器R 82时，存储控制器70将从存储器80读出的材料数据，通过I/O缓冲器R 82，输出给第一SDI-OUT端口5、第二SDI-OUT端口6、ENC/DEC端口7、VPROC端口10、PCI端口11和CPU端口12中的任意一个。
应当注意的是，I/O缓冲器R 82执行与I/O缓冲器W 81同样的过程，其不同仅仅是写操作和读操作，且这里省略了对其工作过程的说明。(2-1)I/O缓冲器W的操作现在，将参考图3，说明当I/O缓冲器W 81通过一个输入/输出端口中的写端口13、14、...、28顺序将所要写入的材料数据突发写入存储器80时的操作。
每个写端口13、14、...、28其内部都具有一个缓冲器，且当有25个字节的将被写入的材料数据存储到缓冲器中时，其就向I/O缓冲器W 81输出一个数据传输请求。
当I/O缓冲器W 81中的PBA电路81A(图2)接收来自写端口14的一个数据传输请求时，其在缓冲器81C中，给写端口14分配一个最小编号或者第一存储区，以便给写端口14分配存储器带宽。
在这种情况下，I/O缓冲控制器81B创建一个端口表91，该表指示在发送数据传输请求的写端口14(#2)和数据传输请求到达的顺序(No.1)之间的关系，并且创建一个存储区表92，该表指示在写端口14(#2)和所分配的第一存储区(1B)之间的关系。
然后，I/O缓冲控制器81B，通过具有32位宽度数据总线的端口槽84，从写端口14接收所要写入的材料数据，以内部寄存器87转换该数据，从而通过具有256位宽度数据总线将其输出，并随后以256比特每时钟脉冲的传输率，通过一存储区槽85，将数据顺序地存储到缓冲器81C的第一存储区中，从而在8个时钟脉冲里，将256字节的材料数据存储在第一存储区中。
对于缓冲器81C的第一存储区到第十六存储区，可以设置256字节作为传输到存储器80中的一个数据传输单元。使用这个数据大小，可以将所写入的材料数据以较小的开销持续传输。
在I/O缓冲器W 81中，由于将256字节设置为向存储器80突发传输的大小，那么I/O缓冲器W 81中的一个数据传输单元基本上是256字节。
当256字节的材料数据已存储到第一存储区时，缓冲器81C向存储控制器70发出一个要将材料数据写入存储器80的写入请求。当缓冲器81C接收到写入允许时，其通过选择器83将256字节的材料数据，以每次256比特的速率全部传输给存储控制器70。
由于存储器80是双倍数据传输率存储器，所以存储控制器70以128位宽度总线，将所接收的数据传输给存储器80。
现在，考虑到这种情况，I/O缓冲控制器81B以某一顺序接收来自每个写端口13、14、...、28的数据传输请求(请求)，该顺序为写端口13、14、...、28中存储256字节的材料数据的顺序。由于I/O缓冲器81B花费8个时钟周期存储来自每个写端口13、14、...、28的256位的材料数据，从而以缓冲器86、87、88将32位的数据转换为256位的数据，并且8个时钟脉冲根据时间划分进行分割，以用于将数据向缓冲器81C进行传输，并且其可以同时从8个写端口接收数据。
因此，分配给每个写端口13、14、...、28的存储器带宽，最多是存储器带宽的八分之一。在存储器带宽是1Gbps的情况下，分配给每个写端口的最大存储器带宽就是125Mbps。
在不需要存储器带宽的情况下，将不会分配存储器带宽，除非有传输请求送入I/O缓存器W 81。
如上所述，I/O缓冲器W 81根据传输请求(请求)来分配存储器带宽，所以，将较大的存储器带宽分配给具有大量数据的写端口，从而实现高效的数据传输。
这时，同样地，I/O缓冲控制器81B创建一个端口表91，该表指示在写端口13、14、...、28和数据传输请求(请求)到达的顺序之间的关系。另外，I/O缓冲控制器81B根据数据传输请求到达的顺序，将每个写端口13、14、...、28分配给缓冲器81C中的最小编号的空闲存储区，并创建一个存储区表92，该表指示其相互之间的关系。
端口表91显示写端口14(#2)、13(#1)和28(#16)发送以No.1、No.2、No3指示的第一到第三的数据传输请求(请求)。
另外，存储区表92指示了与缓冲器81C的第一到第十六存储区范围中的第二到第四存储区相关联，根据数据传输请求(请求)到达的顺序所分配的写端口14、13和28的编号(#2、#1、#16)。
关于这一点，对于第一存储区，来自第二SDI-IN端口4的材料数据已经如上所述进行了存储，所以，已经给写端口分配了最小编号的空闲存储区，或者，第二或随后的空闲存储区。
如上所述，I/O缓冲控制器81B根据到达PBA电路81A的数据传输请求(请求)的顺序，将写端口13、14、...、28动态分配给缓冲器81C中的各存储区。
这样，将存储器带宽分配给三个写端口13、14、28，所以，根据数据传输请求到达的顺序，在第一个时钟，将来自写端口14的256位的材料数据存储到第二存储区，在下一个时钟，将来自写端口13的256位的材料数据存储到第三存储区，并且在下一个时钟，将来自写端口28的256位的材料数据存储到第四存储区。
接着，在八个时钟脉冲后，将256位的材料数据重复存储在每个写端口13、14、28，从而将所要写入的256字节的材料数据存储在第二到第四存储区。
缓冲器81C包含一个双端口RAM，且当将256字节的材料数据存储到第二个存储区时，根据存储控制器70发出的一个写入允许，通过存储控制器70，将第二存储区存储的256字节的材料数据以每次256比特的速度写入存储器80。同样地，缓冲器81C通过存储控制器70，将材料数据依次从第三存储区和第四存储区传输至存储器80。
如上所述，缓冲器81C包含一个双端口RAM，所以I/O缓冲控制器81B向/从缓冲器81C中的第一到第十六存储区异步地存储和读出材料数据。
因此，缓冲器81C可以在I/O缓冲控制器81B向第二到第四存储区存储材料数据的同时，从第一存储区中将数据传输给存储器80，从而提高数据传输的效率。
顺便提一下，I/O缓冲器W 81只是用来将材料数据写入存储器80中。和交替地多次发出写入命令和读出命令的情况相比，不需要在写入操作和读出操作之间转换的时间，从而显著地提高数据传输的效率。(2-2)I/O缓冲器R的操作现在，结合图4来说明当每次通过I/O缓冲器R 82，从存储器80将材料数据传输到读端口29、30、...、44时的操作。
在图4中，相同的附图标记适用于与图3中相一致的部分，除了用I/O缓冲器R 82替代了图3中I/O缓冲器W81之外，其他部分均相同。
当I/O缓冲器R 82中的PBA电路(未示出)只从写端口30接收存储器80中存储的所要读取的材料数据的数据传输请求时，其将存储器带宽分配给读端口30，并将最小编号的空闲存储区，或缓冲器82C中的第一存储区分配给读端口30。
在这种情况下，I/O缓冲控制器82B创建一个端口表101，该表指示在发送数据传输请求的读端口30(#2)和其数据传输请求到达的顺序(No.1)之间的关系，并且创建一个存储区表102，该表指示在读端口30(#2)和所分配的缓冲器82C中的具有最小编号的第一存储区(1B)之间的关系。
然后，I/O缓冲控制器82B将所要读取材料数据的数据传输请求通过选择器83，发送至存储控制器70，以每个时钟256位的速率顺序地将来自存储器80的材料数据存储在缓冲器82C的第一存储区中，因此经八个时钟就可以在第一存储区中存储256字节的材料数据。
然后，I/O缓冲控制器82B通过存储区槽105，接收来自缓冲器82C的第一存储区的256位的材料数据，在寄存器107中将其进行转换，以32位宽度数据总线将其输出，并通过端口槽104将数据传输到读端口30，当已将256字节的材料数据写入读端口30的时候，结束数据传输过程。
当I/O缓冲控制器82B接收来自读端口29、30、...、44的，从存储区80中读取材料数据的数据传输请求的时候，其将存储器带宽分配给发送传输请求的读端口29、30、...、44。
I/O缓冲控制器82B创建一个端口表101，该表指示在读端口29、30、...、44和数据传输请求到达的顺序之间的关系。另外，I/O缓冲控制器82B根据数据传输请求到达的顺序，将各读端口分配给最小编号的空闲存储区，并创建一个存储区表102，该表指示其之间的对应关系。
该例中的端口表101表示读端口30(#2)、29(#1)和44(#16)分别发送用No.1到No3指示的第一到第三的数据传输请求。
根据数据传输请求到达的顺序，存储区表102示出了分配给缓冲器82C的第一到第十六存储区范围中的第二到第四存储区的读端口29、30、...、44的编号(#2、#1、#16)。
关于这一点，对于第一存储区，如上所述，响应从读端口30发出的数据传输请求，存储要被读取的材料数据，将各读端口分配给最小编号，或者第二或随后的空闲存储区。
如上所述，I/O缓冲控制器82B，根据到达PBA电路(未示出)的数据传输请求(请求)的顺序，将读端口29、30、...、44动态分配给缓冲器82C中的存储区。
实际上，和I/O缓冲控制器81B一样，I/O缓冲控制器82B根据传输请求的顺序，以每次256位的速率，从存储器80将256字节的数据突发传输到缓冲器82C中的存储区中。
这种情况下，由于按顺序将存储器带宽分配给三个读端口30、29、44，所以，将来自存储器80的256字节的材料数据按顺序存入第二存储区、第三存储区和第四存储区。
缓冲器82C包含一个双端口RAM，且当将256字节的材料数据存储到第二到第四存储区中的每一个时，将来自第二至第四存储区中的材料数据，以每次256位的速率，依次传输至按时间划分的I/O缓冲控制器82B。
I/O缓冲控制器82B通过寄存器106到108将256位的材料数据转换成为32位宽度，并将转换结果通过端口槽104传输给读端口29、30、...、44。
因为缓冲器82C也包含一个双端口RAM，所以，I/O缓冲控制器82B可以异步地将材料数据存储到缓冲器82C的第一到第十六存储区，并输出从缓冲器82C的第一到第十六存储区中读取的材料数据。
因此，当I/O缓冲控制器82B将材料数据存入第二到第四存储区时，缓冲器82C可以通过I/O缓冲控制器82B，从第一存储区将材料数据传输到读端口30中，从而提高数据传输效率。
顺便提一下，I/O缓冲器R 82只是用来从存储器80中读取材料数据。和交替地多次输出命令和读出命令的情况相比，不需要在写入操作和读出操作之间转换的时间，从而显著地提高数据传输的效率。
(3)操作和效果在上述结构中，存储器带宽控制装置1的I/O缓冲器2，将存储器带宽动态分配给请求数据传输的输入/输出端口。因此，可以根据需要分配所请求的存储器带宽。和传统的固定存储器带宽分配的情况相比，可以避免存储带宽的无用分配，从而显著提高传输至存储器80的数据传输效率。
存储器带宽控制装置1中的I/O缓冲器2，将存储器带宽动态分配给请求数据传输的输入/输出端口。连接到I/O缓冲器2的输入/输出端口的数目，在理论上可以不受限制，假定可以在该范围内分配存储器带宽，则可以根据存储器带宽，在不受外部设备的数目限制的情况下，显著提高其可用性。
I/O缓冲器W 81中的I/O缓冲器81B，按照存储区编号递增的顺序将排列的缓冲器81C中的第二到第四存储区分配给写端口13、14、28，该写端口13、14、28以数据传输请求到达的顺序，依次动态地被分配存储器带宽，并且以每次256位的速率，通过分时逐个时钟，将所要写入的材料数据存储至被分配的第二到第四存储区，从而结束向第二到第四存储区几乎同时传输所要写入的256字节数据。
当将数据以非分时方式传输至第二到第四存储区时，来自写端口13、14、...、28的将要写入的材料数据，应该一次存入寄存器86、87和88，以便由寄存器86、87和88，中断材料数据的数据传输，该材料数据为I/O缓冲控制器81B和缓冲器81C之间所传输的材料数据。
然而，I/O缓冲控制器81B，通过分时逐个时钟，将256位的材料数据存储至分配给写端口13、14、...、28的第二到第四存储区，从而以几乎相同的时间结束第二到第四存储区中256字节的材料数据的传输，并且也通过避免传输的数据在寄存器86、87和88产生中断而显著提高数据的传输效率。
I/O缓冲器R 82中的I/O缓冲控制器82B可以产生同样的效果。
由于I/O缓冲器2使用只写I/O缓冲器W 81和只读I/O缓冲器R 81，所以，不需要在写入操作和读出操作之间转换的时间，从而显著地提高数据传输的效率。
实际上，存储器带宽控制装置1的I/O缓冲器2使用只写I/O缓冲器W 81和只读I/O缓冲器R 82，且选择器83的PBA电路83A在缓冲器81和82之间进行动态切换，以提供写入允许和读出允许。因此，当以每次256位的速率，连续8次执行突发读写传输时，在74MHZ和100MHZ的时钟频率下，可以分别达到95.16％和95.84％的最高使用效率。
根据上述构造，存储器带宽控制装置1的I/O缓冲器2，将存储器带宽动态分配给请求数据传输的各输入/输出端口。与传统固定存储器带宽分配的情况相比，由于没有存储器带宽的浪费，传输到存储器80的数据的传输效率可以得到显著的提高。
(4)其他实施例应当注意的是，在上述实施例中已经描述了以每次256位的速率，在8个时钟执行突发传输时，256字节的材料数据被存储在缓冲器81C和82C的第一到第十六存储区中。但是，本发明不局限于本实施例，或者通过使用四个或十六个时钟脉冲的突发传输，存储来128字节或512字节的材料数据。
此外，上述实施例已经描述了I/O缓冲器2根据存储器带宽分配程序，执行的上述存储器带宽分配过程。但是，本发明不局限于此，且I/O缓冲器2能够通过在一编辑设备中插入存储该存储器带宽分配程序的程序存储介质，执行存储器带宽分配的过程。
在编辑装置中，安装该存储器带宽分配程序，以执行上述存储区带宽分配过程的程序存储介质不但可以是诸如软盘、高密度只读存储光盘(CD-ROM)、数字多用途光盘(DVD)之类的程序包介质，而且可以是半导体存储器和磁盘等可以暂时或永久存储存储器带宽分配程序的存储介质。另外，作为用于将存储器带宽分配程序存储到程序存储媒介的装置，可以使用诸如局域网、Internet网或者数字卫星广播之类的有线或无线通信介质。程序可以通过诸如路由器和调制解调器之类的各种通信接口来进行存储。
更进一步，上述实施例已经描述了将存储器带宽动态分配给请求数据传输的各输入/输出端口。然而，本发明不局限于此，且存储器带宽可以在将接收数据传输请求的优先级顺序送给每一个输入/输出带宽之后，动态分配存储器带宽。这样做，虽然可连接的输入/输出端口的数目可以不受理论限制，但可以提前避免具有较高优先权的设备无法分配到存储器带宽的风险。
更进一步，上述实施例已经描述了安装在编辑装置中的本发明的存储器带宽控制装置。本发明并不局限于此，且本发明的存储器带宽控制装置还可以安装在诸如个人电脑和个人数字助理(PDA)之类的各种信息处理设备中。
更进一步，上述实施例已经描述了作为一个控制装置，动态分配存储区带宽的I/O缓冲器W 81中的PBA电路81A和I/O缓冲器R 82中的PBA电路。但是，本发明并不局限于此，且存储器带宽可以由其他电路结构进行分配。
本发明可以用于各种通过例如，存储器传输数据的信息处理设备。
虽然结合本发明优选实施例进行了叙述，但显而易见，本领域技术人员可以在本发明精神和范围之内，以各种变化和修改为目的，在附带权利要求中覆盖各种变化和修改。
权利要求
1.一种存储器带宽控制装置，包括一存储器，用于暂时存储和输出数据以便通过输入/输出端口与所连接的外部设备进行通信；以及一控制器，用于当收到从外部设备到存储器的数据的数据传输请求时，将存储器带宽动态分配给发送数据传输请求的外部设备的输入/输出端口。
2.如权利要求1所述的存储器带宽控制装置，其中所述控制器在存储器带宽范围内，设置对存储器有效的输入/输出端口的数目。
3.如权利要求1所述的存储器带宽控制装置，其中所述控制器包含一个选择器，用于当接收来自外部设备的写入请求时，暂时将来自外部设备的数据存入只写缓冲器，或者当接收来自外部设备的读出请求时，暂时将从存储器读出的数据存入只读缓冲器，并将使用许可动态分配给接收写入请求的只写缓冲器，或者接收读出请求的只读缓冲器。
4.如权利要求1所述的存储器带宽控制装置，其中所述选择器以每次规定的数据量，将存储在只写缓冲器或只读缓冲器中的数据突发传输到存储器中。
5.一种存储器带宽控制方法，包括接收向存储器传输数据的数据传输请求的数据传输请求接收步骤，该数据与通过输入/输出端口连接的外部设备进行通信，该存储器用来暂时存储和输出数据；以及将存储器带宽动态分配给发送数据传输请求的外部装置的输入/输出端口的控制步骤。
6.一种由编辑设备执行的存储器带宽分配程序接收向存储器传输数据的数据传输请求的数据传输请求接收步骤，该数据与通过输入/输出端口连接的外部设备进行通信，该存储器用来暂时存储和输出数据；以及将存储器带宽动态分配给发送数据传输请求的外部装置的输入/输出端口的控制步骤。
全文摘要
一种可以显著提高在外部装置和存储器之间的数据传输效率的存储器带宽控制装置。本发明提供一个存储器80，用于暂时存储和输出数据以便通过输入/输出端口与所连接的外部设备进行通信，以及一个I/O缓冲器2，用于在接收到从外部装置发送到存储器80的数据传输请求时，将存储器带宽动态分配给请求数据传输的外部设备。与传统的固定存储器带宽分配的情况相比，由于没有存储器带宽的浪费，传输到存储器80的数据传输效率可以得到显著的提高。
文档编号G06F3/06GK1601501SQ20041009217
公开日2005年3月30日 申请日期2004年9月8日 优先权日2003年9月8日
发明者奥野健一 申请人:索尼株式会社