专利名称：具有流水线结构的高速同步掩模只读存储器的制作方法
技术领域：
本发明涉及掩模ROM(只读存储器)，特别涉及具有简单存储单元结构的高速同步掩模ROM。
掩模ROM一般可以分为两类，同步掩模ROM和异步掩模ROM。
图1为表明常规同步掩模ROM的原理图。图1中的同步掩模ROM执行与典型只读存储器装置同样的操作。就是说，存储单元阵列17中的存储单元由行解码部分10和列解码部分20选通。存储在存储单元内的数据，由读出放大器18放大，通过输出缓冲器19输出到外部电路。行解码部分10由X地址缓冲器11、X预解码器12和X解码器13组成，列解码部分20由Y地址缓冲器14、Y预解码器15和Y解码器16构成。
根据输入的X地址行解码部分10通过其中的开关晶体管选择存储单元阵列17中一个字线。同样，根据输入的Y地址列解码部分20通过其中的开关晶体管选择存储单元阵列17中一个位线。由此，存储单元阵列17中的一个存储单元由行和列解码部分10和20选择。被选择的数据由读出放大器18放大并且输出到输出缓冲器19。
图2是表示输入地址与输出信号之间关系的时序图。图2中，Trc为读周期时间，TAA为地址存取时间。该常规掩模ROM操作速度一般在120ns，特别是在页面方式中为20至30ns。
虽然常规掩模ROM可以实现高集成度的存储器芯片，但是存在掩模ROM不能以高速运行问题，因为存储单元的尺寸小引起电流小。即从存储单元到输出缓冲器传递数据要花费许多时间。由此，掩模ROM应用在要求高速运行的办公自动化设备如打印机、电子笔记本或游戏机等是困难的。
本发明的目的是提供一种利用流水线结构可以降低存取时间并保证输出数据可靠性的高速同步掩模只读存储器装置(ROM)。
根据本发明提供的一种只读存储器，它具有包含“与非”型单元或者“或”型单元的存储单元阵列；第一解码装置，用于选择存储单元阵列中的字线；第二解码装置，用于选择存储单元阵列中的位线；放大器，用于放大从存储单元阵列中读出的数据；输出缓冲装置，用于输出放大了的数据，该只读存储器包括时钟发生装置用于接收外部的时钟信号并输出内部的时钟信号；多个储存装置，用于储存每个部件的输出，其被时钟发生器产生的内部时钟信号所同步。
本发明的其他目的和特性由以下参照附图对实施例的说明将会更加清楚，图1是常规同步掩模ROM的原理图；图2是表示图1中输入地址与输出信号之间关系的时序图；图3是表明根据本发明的同步掩模ROM的原理图；图4是表明具有开关电路的锁存电路的原理图；图5是表明图3中时钟发生器的原理图；图6是图3中输入地址和输出信号之间关系的时序图。
以下将结合图3～6详细描述根据本发明的同步掩模ROM。
首先，参考图3的同步掩模ROM的原理图。如图3所示，根据本发明的同步掩模ROM包括存储单元阵列317；读出放大器318；输出缓冲器319；X地址缓冲器311；X预解码器312；X解码器(行解码器)313；Y地址缓冲器314；Y预解码器315和Y解码器(列解码器)316。另外，图3中的各部件完成与图1中各部件同样的操作。
此外，本发明中的掩模ROM具有时钟发生器300和在各部件之间的锁存电路201至207，以便形成流水线结构。
时钟发生器300接收外部的时钟信号，然后输出内部时钟信号到锁存电路201至207。时钟信号发生器300产生的时钟信号是由锁存电路的延迟时间来确定的，锁存电路具有最长的操作时间。由此，相应于地址的单元数据在恒定等待时钟时间间隔之后以高速输出，以便实现高速存取。锁存电路201至207由D型触发器或寄存器构成。
各锁存电路的输出被传送到邻近的部件，其被时钟发生器300产生的时钟信号所同步。当然，掩模ROM中用于部件之间的锁存电路数量可以根据场合的需要控制。
图4为具有由时钟信号控制的开关电路的锁存电路原理图。图4中，锁存电路包括开关电路40和锁存部分41。当时钟信号被从时钟发生器输入到开关电路40时，NMOS晶体管42导通，PMOS晶体管44通过反相器43也导通。锁存部分41包括两个反相器45和46，它们构成反馈环路。
图5为图3中时钟发生器的原理图。输入到图3中锁存电路201至207的时钟信号由扭曲调整部分(SKEW ADJUSTING PART)和内部时钟发生器产生。扭曲调整部分如PLL(锁相环)，校正失真的外部时钟，然后内部时钟发生器不失真地产生内部时钟信号，它被传送到每个锁存电路201至207。
图6为图3中输入地址和输出信号之间关系的时序图。如图6所示，地址被输入到地址缓冲器，其被时钟发生器产生的时钟信号所同步。当第三时钟信号产生时，第一输出数据被输出。即，相应于地址的单元数据在预定的等待时钟时间TLC(TLC等于2TCC)间隔之后输出。然而，由于等待时钟时间TLC的间隔，连续输出的数据以高速输出。特别是在页面方式中，根据本发明的同步掩模ROM可以以20～30ns的速度运行。
显而易见，本发明的效果在于利用简单锁存电路实现流水线结构从而改善掩模ROM的速度，还在于使锁存电路的延迟时间等于其时钟周期时间从而可以保证输出数据的安全性，锁存电路的延迟时间具有最长的操作时间。
虽然为了说明的目的公开了本发明的最佳实施例，本领域的普通技术人员应该意识到，在不违反本发明权利要求描述的范围和构思的情况下，可以作出各种修改、增加和替换。
权利要求
1.一种只读存储器，具有包含“与非”型或者“或”型单元的存储单元阵列；第一解码装置，用于选择存储单元阵列中的字线；第二解码装置，用于选择存储单元阵列中的位线；放大器，用于放大从存储单元阵列读出的数据，输出缓冲装置用于输出放大了的数据，该只读存储器包括时钟发生装置，用于接收外部时钟信号并且输出内部时钟信号；第一开关装置，用于连接第一解码装置到存储单元矩阵，其被时钟发生装置产生的内部时钟信号所同步；第二开关装置，用于连接第二解码装置到存储单元矩阵，其被时钟发生装置产生的内部时钟信号所同步；第三开关装置，用于连接输出缓冲装置到存储单元矩阵，其被时钟发生装置产生的内部时钟信号所同步。
2.如权利要求1所述的只读存储器，其中，该时钟发生装置进一步包括扭曲调节装置用于校正外部时钟信号的波形失真。
3.如权利要求1所述的只读存储器，其中，该第一解码装置包括第一装置，用于缓冲行地址信号；第二装置，用于预解码第一装置的输出；第三装置，用于解码第二装置的输出。
4.如权利要求3所述的只读存储器，其中，该第二解码装置包括第四装置，用于缓冲列地址信号；第五装置，用于预解码第四装置的输出；第六装置，用于解码第五装置的输出。
5.如权利要求4所述的只读存储器，其中，该只读存储器进一步包括第四开关装置，用于连接第一装置到第二装置，被时钟发生装置产生的内部时钟信号所同步；第五开关装置，用于连接第二装置到第三装置，其被时钟发生装置产生的内部时钟信号所同步；第六开关装置，用于连接第四装置到第五装置，其被时钟发生装置产生的内部时钟信号所同步；第七开关装置，用于连接第五装置到第六装置，其被时钟发生装置产生的内部时钟信号所同步。
6.如权利要求2所述的只读存储器，其中，该扭曲调整装置为锁相环。
7.一种只读存储器，具有包含“与非”型单元或“或”型单元的存储单元阵列；第一解码装置，用于选择存储单元阵列中的字线；第二解码装置，用于选择存储单元阵列中的位线；放大器，用于放大存储单元阵列读出的数据；输出缓冲装置；用于输出放大了的数据，该只读存储器包括时钟发生装置，用于接收外部时钟信号并且输出内部时钟信号；第一存储装置，位于存储第一解码装置和存储单元阵列之间，用于存储第一解码装置的输出，其被时钟发生装置产生的内部时钟信号所同步；第二存储装置，位于存储第二解码装置和存储单元列阵之间，用于存储第二解码装置的输出，其被时钟发生装置产生的内部时钟信号所同步；第三存储装置，位于存储单元阵列和输出缓冲装置之间，用于存储存储单元阵列的输出，其被时钟发生装置产生的内部时钟信号同步。
8.如权利要求7所述的只读存储器，其中，该时钟发生装置进一步包括扭曲调整装置，用于校正外部时钟信号的波形失真。
9.如权利要求7所述的只读存储器，其中，该第一解码装置包括第一装置，用于缓冲行地址信号；第二装置，用于预解码第一装置的输出；第三装置，用于解码第二装置的输出。
10.如权利要求9所述的只读存储器，其中，该第二解码装置包括第四装置，用于缓冲列地址信号；第五装置，用于预解码第四装置的输出；第六装置，用于解码第五装置的输出。
11.如权利要求10所述的只读存储器，其中，该只读存储器进一步包括第四存储装置，位于第一装置和第二装置之间，用于存储第一装置的输出，其被时钟发生装置产生的内部时钟信号同步；第五存储装置，位于第二装置和第三装置之间，用于存储第二装置的输出，其被时钟发生装置产生的内部时钟信号同步；第六存储装置，位于第四装置和第五装置之间，用于存储第四装置的输出，其被时钟发生装置产生的内部时钟信号同步；第七存储装置，位于第五装置和第六装置之间，用于存储第五装置的输出，其被时钟发生装置产生的内部时钟信号同步。
12.如权利要求7所述的只读存储器，其中，该第一、第二和第三存储装置包括开关装置由时钟发生装置产生的内部时钟信号控制；锁存装置连接到开关装置，该锁存装置存储其输出。
13.如权利要求11所述的只读存储器，其中第四、第五、第六和第七存储装置包括开关装置，由时钟发生装置产生的内部时钟信号控制；锁存装置连接到开关装置，该锁存装置存储其输出。
14.如权利要求7所述的只读存储器，其中，第一、第二和第三存储装置为寄存器或D型触发器。
15.如权利要求11所述的只读存储器，其中，第四、第五、第六和第七存储装置为寄存器或D型触发器。
16.如权利要求8所述的只读存储器，其中，扭曲调整装置为锁相环。
17.一种只读存储器，具有包含“与非”型单元或“或”型单元的存储单元阵列；第一解码装置，用于选择存储单元阵列中的字线；第二解码装置，用于选择存储单元阵列中的位线；放大器，用于放大从存储单元阵列读出的数据；输出缓存装置，用于输出放大了的数据，该只读存储器还包括时钟发生装置，用于接收外部时钟信号并且输出内部时钟信号；多个存储装置，用于存储各部件的输出，其被时钟发生装置产生的内部时钟信号同步。
全文摘要
本发明公开了一种掩模ROM，具有使用简单锁存电路的流水线结构；由此，通过提供时钟发生器和多个被时钟发生装置产生的内部时钟信号同步的用于存储其中各部件的输出的锁存电路，本发明的掩模ROM改善了其速度并保证了输出数据的安全。
文档编号G11C17/08GK1149189SQ9611173
公开日1997年5月7日 申请日期1996年6月30日 优先权日1995年6月30日
发明者金宰亨, 尹炳震 申请人:现代电子产业株式会社