时脉信号产生方法以及时脉信号产生电路的制作方法

专利名称：时脉信号产生方法以及时脉信号产生电路的制作方法
技术领域：
本发明是有关于一种时脉信号产生电路，且特别是有关于一种用于液晶显
示面板的时脉信号(clock signal)产生电路。
背景技术：
请参照图1，为一传统的液晶显示面板1的示意图。液晶显示面板1包含 二维的像素阵列IO。像素阵列IO包含多行及多列，多条栅极线以选择或驱动 一列像素单元，以及多条数据线以提供数据至一行像素单元。因此，液晶显示 面板1更包含栅极驱动电路300以提供栅极线信号至各栅极线，以及数据驱动 电路200以提供数据信号至各数据线。
栅极驱动电路300包含多个串接的移位缓存器SR1 (shiftregister)，以使
各移位缓存器的输出信号做为对应一栅极线的栅极线信号，并同时做为下一级 移位缓存器的起始信号。如图2所示，第一级移位缓存器SR1的起始信号由 ST信号所提供，而其它各级的起始信号则由前一级的移位缓存器所提供。如 图2所示，奇数级移位缓存器的时脉信号输入端CK接收时脉信号CK，而偶 数级移位缓存器的时脉信号输入端CK接收时脉信号XCK。如图3所示，时 脉信号XCK为时脉信号CK的反相，工作周期(duty cycle)均为50%。
在使用栅极驱动电路基板技术(gate on array; GOA)所制造的栅极驱动 电路，时脉信号的电压(￥^=23￥且￥81=-1(^)由一低电压波形经过电压电 平转换器后提升得来。位移暂存是在玻璃基板上制造，而电压电平转换器的芯 片是在印刷线路板(printed wire board; PWB)或印刷电路板(printed circuit board; PCB)。而软性电路板(Flexible Printed Circuit)则用以连接玻璃基板 及印刷线路板或印刷电路板。由于时脉信号.间峰值的差异，以及接收时脉信号 的位移缓存器数量大，因此寄生电容所耗的功率将增大且显得浪费。
降低寄生电容所耗功率的方法，可藉由电荷分享方式，来减少时脉信号在 各电压电平转换时，产生的电压突升或电压突降。如图4a所示，电压电平转换器具有一输入端，以接收时脉信号CK-in以及其反相时脉信号XCK一in (请 参照图4b)以及一约3.3V的控制电压VCS。电压电平转换器包含二电压放大 器A1及A2，以提供输出时脉信号CK及XCK。切换元件S1位于放大器A1 及输出CK间，切换元件S2位于放大器A2及输出XCK间，第三个切换元件 S3以及一电阻R串联于CK及XCK间。切换元件S1、 S2及S3的工作时间 如下所述
在时间区间1及3，切换元件S1及S2位于连接状态，而切换元件S3位 于断开状态。因此，CK及XCK的电压电平分别为放大器A1及A2的输出。
在时间区间2及4，切换元件S1及S2位于断开状态，而切换元件S3位 于连接状态，以使CK及XCK间进行电荷分享。然而当功率因为电荷分享而 下降时，却将在栅极线的开关上产生延迟。

发明内容
因此，本发明是在提供一种时脉信号产生电路。时脉信号产生电路包含二 输出端，以分别根据第一及第二输入信号提供一第一及一第二时脉信号。电荷 储存元件用以于第一时脉信号为高电平的一段时间内执行自第一输出端至电 荷储存元件的电荷转换，并于第二时脉信号为低电平时执行自电荷储存元件至 第二输出端的龟荷转换。在时脉周期的另一段期间中，电荷储存元件用以于第 二时脉信号为高电平的一段时间内执行自第二输出端至电荷储存元件的电荷 转换，并于第一时脉信号为低电平时执行自电荷储存元件至第一输出端的电荷 转换。
因此，本发明的第一个目的是在提供一种时脉信号产生方法，用以根据第 一输入信号于第一信号路径产生第一时脉信号，及根据第二输入信号在第二信 号路径产生第二时脉信号，各第一及第二输入信号分别包含第一信号状态H 以及第二信号状态L，第一及第二时脉信号分别包含第一时脉电平及第二时脉
电平，时脉信号产生方法包含下列步骤在第一输入信号位于第一信号状态，
且第二输入信号位于第二信号状态时，执行自第一信号路径至电荷储存元件的
第一电荷转换以使第一时脉信号自第一时脉电平转换至第一中间电平；在第一 输入电平仍位于第二信号状态时，使第一时脉信号工作于第二时脉电平；在第 一输入信号位于第二信号状态，且第二输入信号位于第一信号状态时使第二时脉信号自第二时脉电平转换至第二中间电平；使第一时脉信号工作于第二时 脉电平及使第二时脉电平工作于第一时脉电平；执行自第二信号路径至电荷储 存元件的第二电荷转换以使第二时脉信号自第一时脉电平转换至第三中间电 平；以及于第二时脉信号仍位于第一信号状态时，使第二时脉信号工作于第二 时脉状态；在第一输入信号位于第二信号状态，且第二输入信号位于第一信号 状态时，使第一时脉信号自第二时脉电平转换至第四中间电平；以及在第一输 入信号位于第一信号状态，且第二输入信号位于第二信号状态时，使第一时脉 信号自第四中间电平转换至第一时脉电平。
本发明的第二个目的是在提供一种时脉信号产生电路，用以接收第一输入 信号XCK—in、第二输入信号CK—in以及控制信号VCS，以根据第一输入信号 于第一信号路径P2产生第一时脉信号XCK以及根据第二输入信号于第二信 号路径Pl产生第二时脉信号CK，各第一及第二输入信号分别包含第一信号 状态H以及第二信号状态L，各第一及第二时脉信号分别包含第一时脉电平 (Vgh=20V)及第二时脉电平(Vgl二10v)。时脉信号产生电路包含第一输 出端以提供第一时脉信号；第二输出端以提供第二时脉信号；第一电压电平转 换器用以在第一输入电平位于第一信号状态时，提供第一信号路径相当于一第 一时脉电平的一电压电平，以及用以在第一输入电平位于第二信号状态时，提 供第一信号路径相当于第二时脉电平的电压电平；第二电压电平转换器用以在 第二输入电平位于第一信号状态时，提供第二信号路径相当于第一时脉电平的 电压电平，以及用以在第二输入电平位于第二信号状态时，提供第二信号路径 相当于第二时脉电平的电压电平；第一切换元件S2位于第一信号路径，根据 第一输入信号及控制信号而工作于连接状态或断开状态；第二切换元件Sl位 于第二信号路径，根据第二输入信号及控制信号而工作于连接状态或断开状 态；第三切换元件S4藉由位于第一切换元件及第一输出端之间的第一连接点， 电性连接电荷储存元件至第一信号路径，第三切换元件根据第一输入信号及控 制信号而工作于连接状态或断开状态；以及第四切换元件S3藉由位于第二切 换元件及第二输出端之间的第二连接点，电性连接电荷储存元件至第二信号路 径，第四切换元件根据第二输入信号及控制信号而工作于连接状态或断开状 态。
本发明的第三个目的是在提供一种时脉信号产生电路，包含第一输出端以在第一信号路径提供第一时脉信号；第二输出端以在第二信号路径提供第二 时脉信号，各第一及第二输出端可工作于第一信号状态及第二信号状态；电荷 储存元件连接于第一及第二信号路径；以及控制模块用以在第一输出端位于 第一信号状态，且第二输出端位于第二信号状态时，执行自第一信号路径至电 荷储存元件的第一电荷转换；于第一及第二输出端均工作于第二信号状态时， 执行自电荷储存元件至第二信号路径的第二电荷转换；在第一输出端位于第二 信号状态且第二输出端位于第一信号状态时，执行自第二信号路径至电荷储存 元件的第三电荷转换；以及于第一及第二输出端均工作于第二信号状态时，执 行自电荷储存元件至第二信号路径的第四电荷转换。
在图5a 图11的叙述中，可对本发明有更清楚的了解。


为让本发明的上述和其它目的、特征、优点与实施例能更明显易懂，所附 图式的说明如下
图1为一传统的液晶显示面板的示意图； 图2为具有串接的移位缓存器的栅极驱动电路的示意图； 图3为一表示栅极线信号及时脉信号间的关系的时序图； 图4a为现有的电荷分享装置的示意图4b为现有的电荷分享装置的时脉输入以及所产生的时脉信号的示意
图5a为本发明的一实施例中的电荷分享电路的示意图； 图5b为本发明的一实施例中的电荷分享电路的时脉输入以及所产生的时 脉信号的示意图5c为本发明的一实施例中的电荷分享过程的时间表；
图6a为本发明图5a的实施例的电荷分享电路的一部份电路图6b为本发明图6a的实施例中的电路的等效电路图6c为本发明图6a的实施例中的电路的又一等效电路图6d为本发明图6c的实施例中的电路之电荷分享过程的时间表；
图7a为本发明的另一实施例中的电荷分享电路的示意图7b为本发明图7a的实施例中的电荷分享电路的时脉输入以及所产生的时脉信号的示意图7c为本发明图7a的实施例中的电荷分享过程的时间表；
图7d为本发明图7a的实施例中的电路的一等效电路图8为本发明的又一实施例中的电荷分享电路'的时脉输入以及所产生的
时脉信号的示意图9为本发明的再一实施例中的电荷分享电路的时脉输入以及所产生的
时脉信号的示意图10为本发明的一实施例中的位移缓存器的一不同排列方式的示意以及
图11为本发明的一实施例中使用四个输入时脉信号以产生栅极线信号时 的相位关系图。
其中主要附图标记为
1:液晶显示面板 10:像素阵列
200:数据驱动电路 300:栅极驱动电路
50:电荷分享电路 50':电荷分享电路
C:连接状态 D:断开状态
具体实施例方式
图5a绘示依照本发明的一实施例的的一电荷分享电路50的示意图。电荷 分享电路50用以接收第一输入信号XCK—in、第二输入信号CK—in以及控制 信号VCS。电荷分享电路50包含第一放大器Al，或称为第一电压电平提升 器Al，第一放大器Al输入端耦接至第一输入信号CK_in以根据第一输入信 号CK—in于第一信号路径Pl提供第一输出信号CK至第一输出端Outl ，以及 第二放大器A2，或称为第二电压电平提升器A2，第一放大器A2输入端耦接 至第二输入信号XCK—in，以根据第二输入信号XCK—in于第二信号路径P2 提供第二输出信号XCK至第二输出端Out2。第一切换元件SI位于第一信号 路径P1，第二切换元件S2位于第二信号路径。第三切换元件S3及第四切换 元件S4串联于第一输出端Outl及第二输出端Out2之间。如图5a所示，第一 切换元件S1具有二切换端，第一切换端连接于第一电压电平提升器A1，第二 切换端连接于第一输出端Outl。同样地，第二切换元件S2具有二切换端，第一切换端连接于第二电压电平提升器A2，第二切换端连接于第二输出端Out2。 一具有电荷储存元件STG的电荷分享路径D连接于第三切换元件S3及第四 切换元件S4间的接地端及连接点Q。如图5a所示，电荷储存元件STG包含 串联的电阻R及电容C。z
各第一切换元件Sl、第二切换元件S2、第三切换元件S3及第四切换元 件S4可工作于第一状态及第二状态。当工作于第一状态时，切换元件使一信 号由第一切换端传送至第二切换端。而当工作于第二状态时，切换元件的第一 切换端及第二切换端将断开。因此，当第一切换元件工作于第一状态时，将电 性连接第一输出端Outl至第一电压电平提升器Al，而第一切换元件工作于第 二状态时，将使第一输出端Outl及第一电压电平提升器Al断开。相同地， 当第二切换元件工作于第一状态时，将电性连接第二输出端Out2至第一电压 电平提升器A2，而第二切换元件工作于第二状态时，将使第二输出端Out2及 第二电压电平提升器A2断开。当第三切换元件工作于第一状态时，将电性连 接第一输出端Outl至电荷分享路径D，而第三切换元件工作于第二状态时， 将使第一输出端Outl及电荷分享路径D断开。当第四切换元件工作于第一状 态时，将电性连接第二输出端Out2至电荷分享路径D，而第四切换元件工作 于第二状态时，将使第二输出端Out2及电荷分享路径D断开。
第一切换元件Sl、第二切换元件S2、第三切换元件S3及第四切换元件 S4的运作，可使第一输出端Outl及第二输出端Out2的电压具有介于第一电 压Vgh及第二电压Vgl之间的中间电压电平。在不同的实施例中，来自第一 输出端Outl的中间电压电平与来自第二输出端Out2的中间电压电平，将分别 在不同的时间周期产生。
如图5b所示，时脉周期可由八个时间区间1-8代表。第一输入时脉信号 CKjn是在时间区间4及6中位于第一状态(高态)，并在时间区间1-3、 7 及8中位于第二状态(低态)。第二输入时脉信号XCK—in在时间区间1、 2 及8中位于第一状态，并在时间区间3及7中位于第二状态。第一及第二输入 信号的工作周期小于50%。控制电压VCS在时间区间1及5位于第一状态， 并在时间区间2-4、 6、 7及8中位于第二状态(请参照图5c)。第一输出信号 CK的中间电压电平，为时间区间4及6的电荷分享之结果。而第二输出信号 XCK的中间电压电平，为时间区间2及8的电荷分享的结果。如图5c所示的时间表，表中C表示连接状态，D表示断开装置。在时间区 间l，由于S1在连接状态且S3在断开状态，因此CK—in在低态，CK在低态 Vgl。同样地，由于S2在连接状态且S4在断开状态，因此XCK—in在高态， XCK在高态Vgh。
在时间区间2，由于Sl在连接状态且S3在断开状态，因此CK—in在低态， CK在低态Vgl。然而，由于S2在连接状态且S4亦在连接状态，因此第二输 出端Out2的电压电平因自XCK至储存元件STG的电荷分享而下降。
在时间区间3，由于S1在连接状态且S3在断开状态，因此CK—in在低态， CK在低态Vgl。同样地，由于S2在连接状态且S4在断开状态，因此XCK—in 在低态，XCK在低态Vgl。
在时间区间4，由于S1在断开状态且S3在连接状态，因此CK—in及CK 在高态。储存于储存元件STG的电荷将因此分享至第一输出端Outl，而使CK 的电压电平因而提升至中间电压电平。XCK一in及XCK均由于S2位于连接状 态而在低态。
在时间区间5，由于S1及S2在连接状态，且S3、 S4在断开状态，储存 于储存元件STG的电荷将因此分享至第一输出端Outl，而使CK的电压电平 因而提升至中间电压电平。XCKjn及XCK均由于S2位于连接状态而在低态。 XCK一in及XCK均由于S2位于连接状态且S4位于断开状态而在低态。
在时间区间6，电荷自CK分享至储存元件STG。
在时间区间7，由于Sl在连接状态且S3在断开状态，因此CKjn及CK 在低态Vgl。XCKJn及XCK均由于S2位于连接状态且S4位于断开状态而在 低态。
在时间区间8，电荷自储存元件STG分享至XCK。
如图6b及图6c所示，控制电压VCS施加于一逻辑电路中。图6b及图 6c所示，为图6a的等效电路。图6a绘示图5a中的电荷分享电路中的第一信 号路径P1。在图6c中，自逻辑电路输出的电压电平A及B由下列逻辑表达 式决定
A = nCK—in OR (CK—in AND nVCS); B = nCK一in; 11=否定(negated);电压电平A及B决定第一输出端Outl的电压电平。举例来说，当CKjn 为低态且VCS为高态，nCK—in为高态且nVCS为低态。逻辑表达式(CKjn ANDnVCS)的结果为低态，因此A为高态且B为高态。所以，如图6d的时 间表z的时间区间1所示，PMOS位于非导通状态，NMOS位于导通状态，且 Outl为低态(Vgl二10V)。
在时间区间2、 3、 7及8中，CK一in及VCS倶为低态。nCK—in及nVCS 俱为高态。逻辑表达式(CK—inANDnVCS)的结果为低态，因此A为高态且 B为高态。如同时间区间l， Outl为低态。
在时间区间4及6中，CK—in为高态，VCS为低态，nCKjn为低态且nVCS 为高态。(CK—in AND nVCS)的结果为高态，因此A为高态且B为低态。 所以，PMOS及NMOS均位于非导通状态，相当于S1位于断开状态(请同时 参照图5a及图6a)，电荷分享是在第一输出端Outl及储存元件STG间产生 (请参照图5a)。
在时间区间5中，CK—in及VCS均为高态。nCK—in及nVCS均为低态。 (CK一inANDnVCS)的结果为低态，因此A为高态且B为低态。所以，PMOS 位于导通状态，NMOS位于非导通状态。Outl为高态或等于Vgh，即20V。
图6c的实施例中，电平转换器用以将输入电压自(0，3.3V)转换为(-10， 20V)。
逻辑电路可以应用于不同的用途。例如，逻辑电路可如图6b所示用以控 制传输栅。传输栅等效于图5a中的电荷分享电路50的第一切换元件Sl。电 压电平转换器A1 (请同时参照图5a及图6a)包含如图6b所示的一电平转换 器/反相器电路以及另一个反相器(包含PMOS及NMOS)。
本发明的另一实施例如图7a所示。除了切换元件S3及S4外，额外的两 个切换元件S5及S6亦可用以改变电荷分享电路50，中，第一及第二输出端 Outl及Out2的电压电平。切换元件S3及S4用以通过电荷分享路径D，进行 储存元件STG与第一输出端Outl间，及储存元件STG与第二输出端Out2间 的电荷分享。如图7a所示， 一具有电阻R2的电荷释放路径E连接于S5及S6 间的接地端及连接点。更进一步地，电荷分享电路50'用以接收电一输入信号 CK一in、第二输入信号XCK—in、第一控制信号VCS1以及第二控制信号VCS2。
输入信号CK—in、XCK—in，控制电压VCS1、 VCS2以及输出时脉信号CK、XCK的关系，如图7b所示。图7c则绘示相对应的时间表。
在时间区间1、 4、 7及10， S3、 S4、 S5及S6位于断开状态，Sl及S2 位于连接状态。输出端Outl及Out2的输出电平分别与来自电压电平转换器 A1及A2的电压相同。
在时间区间2， S2、 S3及S6位于断开状态，S4位于连接状态。输出端 Out2的输出电平由于自Out2至储存元件STG的电荷分享而下降。
在时间区间3， S2、 S4及S5位于断开状态，S6位于连接状态。输出端 Out2的输出电平由于通过电阻R2至接地端的电荷释放而下降至0V。
在时间区间5， Sl、 S3及S6位于断开状态，S5位于连接状态。输出端 Outl的输出电平由于通过电阻R2至接地端的负电荷释放而拉升至0V。
在时间区间6， Sl、 S4及S5位于断开状态，S3位于连接状态，而使于时 间区间2中储存于储存元件STG的电荷分享至输出端Outl。
时间区间8、 9、 11及12除了输出结果略有不同外，与时间区间2、 3、 5 及6的运作过程相似。
须注意的是，图5b所示的时间区间3及7可为极短的区间，甚至如图8 中所示为0。同样地，图7b所示的时间区间4及10亦可为极短的区间，甚至 如图9中所示为0。因此，输入时脉的工作周期可以接近或等于50%。
结论是，本发明提供了一个时脉信号产生方法，可根据第一输入信号 XCK—in在第一信号路径P2产生第一时脉信号XCK以及根据第二输入信号 CK—in在第二信号路径Pl产生第二时脉信号CK，各第一及第二输入信号分别 包含第一信号状态H以及第二信号状态L，各第一及第二时脉信号分别包含第 一时脉电平(Vgh-20V)及第二时脉电平(Vgl=-10v)。时脉信号产生方法包 含下列步骤于第一输入信号位于第一信号状态H，且第二输入信号位于第二 信号状态L时，执行自第一信号路径至电荷储存元件的第一电荷转换以使第一 时脉信号自第一时脉电平转换至第一中间电平(时间区间2，第5b、 8、 9及 7b图)；
在第一输入电平仍位于第二信号状态L时，使第一时脉信号工作于第二时 脉电平(图5b、 8的时间区间3，图7b及9的时间区间4);
在第一输入信号位于第二信号状态L，且第二输入信号位于第一信号状态
时H:使第二时脉信号自第二时脉电平转换至第二中间电平(图5b、 8的时间区 间4，图7b及9的时间区间5);
使第一时脉信号工作于第二时脉电平及使第二时脉电平工作于第一时脉 电平(图5b、 8的时间区间5，图7b及9之时间区间7);"
执行自第二信号路径至电荷储存元件的第二电荷转换以使第二时脉信号 自第一时脉电平转换至第三中间电平(图5b、 8的时间区间6，图7b及9的 时间区间8);
以及于第二时脉信号仍位于第一信号状态H时，使第二时脉信号工作于 第二时脉状态L(图5b、 8的时间区间7，图7b及9的时间区间10);
在第一输入信号位于第二信号状态L，且第二输入信号位于第一信号状态 H时，使第一时脉信号自第二时脉电平转换至第四中间电平(图5b、 8的时间 区间8，图7b及9的时间区间12);以及
在第一输入信号位于第一信号状态，且第二输入信号位于第二信号状态 时，使第一时脉信号自第四中间电平转换至第一时脉电平。
本发明的一实施例中，使第一时脉信号工作于第二时脉电平的步骤，在使 第二时脉信号自第二时脉电平转换至第二中间电平的步骤前执行；以及于第一 输入信号位于第二信号状态时，使第二时脉信号工作于第二时脉电平的步骤， 在使第一时脉信号自第二时脉电平转换至第四中间电平的步骤前执行。
本发明的又一实施例中，使该第一时脉信号工作于第二时脉电平的步骤， 是在使第二时脉信号自第二时脉电平转换至第二中间电平的步骤同时 (concurrent)执行，以及于第一信号位于第二信号状态时，使第二时脉信号 工作于第二时脉状态L的步骤，是在使第一时脉信号自第二时脉电平转换至第 四中间电平的步骤同时(concurrent)执行。
本发明的一实施例中，其中于第一输入信号位于第二信号状态L且第二输 入信号位于第一信号状态H时，执行自电荷储存元件至第二信号路径的第三 电荷转换，以使第二时脉信号自第二时脉电平转换至第二中间电平，且于第一 输入信号位于第二信号状态L且第二输入信号位于第一信号状态时H，执行自 电荷储存元件至第一信号路径的第四电荷转换，以使第一时脉信号自第二时脉 电平转换至第四中间电平。
本发明的一实施例中，使第一时脉信号工作于第二时脉电平的步骤，是在第二时脉信号自第二时脉电平转换至一第二中间电平的步骤时执行，以及在第
一信号位于第二信号状态时L，使第二时脉信号工作于第二时脉状态L的步骤， 是在使第一时脉信号自第二时脉电平转换至第四中间电平的步骤前执行。
本发明的另一实施例中，在第一输入信号位于第二信号状态L且第二输入 信号位于第一信号状态H时，执行自电荷储存元件至第二信号路径的一第三 电荷转换，以使该第二时脉信号自该第二时脉电平转换至一第二中间电平，且 于第一输入信号位于第二信号状态L且第二输入信号位于第一信号状态H时， 执行自电荷储存元件至第一信号路径的第四电荷转换，以使第一时脉信号自第 二时脉电平转换至第四中间电平。
本发明的一实施例中，第一中间电平实质上与第三中间电平相同，且第二 中间电平实质上与第四中间电平相同。
本发明的另一实施例中，在第一输入信号位于第二信号状态L且第二输入 信号位于第一信号状态H时，执行自电荷储存元件至第二信号路径的一第三 电荷转换，以使该第二时脉信号自该第二时脉电平转换至一第二中间电平，且 于第一输入信号位于第二信号状态L且第二输入信号位于第一信号状态H时， 执行自电荷储存元件至第一信号路径的第四电荷转换，以使第一时脉信号自第 二时脉电平转换至第四中间电平。
本发明的一实施例中，第一中间电平实质上与第三中间电平相同，且第二 中间电平实质上与第四中间电平相同。
本发明的另一实施例中，其中第一中间电平实质上与第二中间电平相同。
本发明的一实施例中，在执行自第一信号路径至电荷储存元件的第一 电荷 转换的步骤后，以及于第一输入电平仍位于第二信号状态L时，使第一时脉信 号工作于第二时脉电平的步骤前，在第一输入信号仍位于第一信号状态以及第 二输入信号仍位于该第二信号状态时(图7b及9的时间区间3)，还包含一 步骤，使第一时脉信号自第一中间电平转换至介于第一中间电平及第二时脉电 平的第五中间电平；以及于使第二时脉信号自第二时脉电平转换至第二中间电 平的步骤后，以及使第一时脉信号工作于第二时脉电平及使第二时脉电平工作 于第一时脉电平的步骤前，在第一输入电平位于第二信号状态L以及第二输入 电平位于该第一信号状态H时(图7b及9的时间区间6)，还包含一步骤， 使第二时脉信号自第二中间电平转换至介于第二中间电平及第一时脉电平之第六中间电平；以及于执行自第二信号路径至电荷储存元件的第二电荷转换以 使第二时脉信号自第一时脉电平转换至第三中间电平以及于使第二时脉信号 工作于第二时脉状态L的步骤后，还包含一步骤，使第二时脉信号自第三中间 电平转换至介于第三中间电平及第二时脉电平的第七中间电平(图7b及9的 时间区间9);以及于使第一时脉信号自第二时脉电平转换至第四中间电平的 步骤后，以及使第一时脉信号自第四中间电平转换至第一时脉准的步骤前，还 包含一步骤，使第一时脉信号自第四中间电平转换至介于第四中间电平及第一 时脉电平H的第八中间电平(图7b及9的时间区间11)。
本发明的一实施例中，在第一输入信号位于第二信号状态L且第二输入信 号位于第一信号状态H，执行自电荷储存元件至第二信号路径的第三电荷转 换，以使第二时脉信号自第二时脉电平转换至介于第二中间电平及第一时脉电 平H的第六中间电平；以及于第一输入信号位于第一信号状态H且第二输入 信号位于第二信号状态L，执行自电荷储存元件至第一信号路径的第四电荷转 换，以使第一时脉信号自第四时脉电平转换至介于第四中间电平及第一时脉电 平H的第八中间电平。
本发明的另一实施例中，于第一输入信号仍位于第一信号状态，释放储存 于储存元件的电荷至接地端，以使第一时脉信号自第一中间电平转换至第五中 间电平(接地电位)；以及于第二输入信号仍位于第一信号状态，释放储存于 储存元件的电荷至接地端，以使第二时脉信号自第三中间电平转换至第七中间 电平(接地电位)。
本发明的一实施例中，在第二输入信号仍位于第一信号状态H，藉由一负 载连接第二信号路径至接地端，以使第二时脉信号自第二时脉电平转换至第二 中间电平(接地电位)；以及于第一输入信号仍位于第一信号状态，藉由负载 连接第一信号路径至接地端，以使第一时脉信号自第二时脉电平转换至第四中 间电平。
本发明亦提供了一种时脉信号产生电路。时脉信号产生电路包含第一输 出端以于第一信号路径提供第一时脉信号；第二输出端以于第二信号路径提供 第二时脉信号，各第一及第二输出端可工作于第一信号状态及第二信号状态； 电荷储存元件连接于第一及第二信号路径；以及控制模块。控制模块用以于 第一输出端位于第一信号状态，且第二输出端位于第二信号状态时，执行自第一信号路径至电荷储存元件的第一电荷转换；在第一及第二输出端均工作于第 二信号状态时，执行自电荷储存元件至第二信号路径的第二电荷转换；在第一 输出端位于第二信号状态且第二输出端位于第一信号状态时，执行自第二信号 路径至电荷储存元件的第三电荷'转换；以及于第一及第二输出端均工作于第二 信号状态时，执行自电荷储存元件至第二信号路径的第四电荷转换。
本发明的一实施例中，其中第一输出端工作于介于第一电荷转换及第二电 荷转换间的第二信号状态。
本发明的一实施例中，其中第二输出端工作于介于第三电荷转换及第四电 荷转换间的第二信号状态。
本发明的一实施例中，各第一及第二时脉信号具有第一电压电平以及较低 的第二电压电平，且其中当第一时脉信号位于第一电压电平，第一输出端工 作于第一信号状态，当第一信号时脉信号位于第二电压电平，第一输出端工作 于第二信号状态，且于执行第一电荷转换及第四电荷转换时，第一时脉信号介 于第一及第二电压电平；以及当第二时脉信号位于第一电压电平时，第二输出 端工作于第一信号状态，当第二信号时脉信号位于第二电压电平时，第二输出 端工作于第二状态，且在执行第二电荷转换及第三电荷转换时，第一时脉信号 介于第一及第二电压电平。
根据本发明的实施例，介于第二及第三电荷转换时，第二时脉信号位于第 一电压电平，第一时脉信号位于第二电压电平。
本发明的时脉信号产生电路，用以接收第一输入信号XCKjn、第二输入 信号CK一in以及控制信号VCS，以根据第一输入信号于第一信号路径P2产生 第一时脉信号XCK以及根据第二输入信号于第二信号路径Pl产生第二时脉 信号CK，各第一及第二输入信号分别包含第一信号状态H以及第二信号状态 L，各第一及第二时脉信号分别包含第一时脉电平(Vgh=20v)及第二时脉电 平(Vgl=-10v)，时脉信号产生电路包含第一输出端以提供第一时脉信号； 第二输出端以提供第二时脉信号；第一电压电平转换器用以于第一输入电平位 于第一信号状态H时，提供第一信号路径相当于第一时脉电平的电压电平， 以及用以于该第一输入电平位于该第二信号状态L时，提供第一信号路径相当 于第二时脉电平的电压电平；第二电压电平转换器用以于第二输入电平位于第 一信号状态H时，提供第二信号路径相当于第一时脉电平的电压电平，以及用以于第二输入电平位于第二信号状态L时，提供第二信号路径相当于第二时 脉电平的电压电平；第一切换元件S2位于第一信号路径，第一切换元件根据 第一输入信号及控制信号而工作于连接状态或断开状态；第二切换元件Sl位 于第二信号路径，第二切换元件根据第二输入信号及控制信号而工作于连接状 态或断开状态；第三切换元件S4藉由位于第一切换元件及第一输出端之间的 第一连接点，电性连接电荷储存元件至第一信号路径，第三切换元件S4根据 第一输入信号及控制信号而工作于连接状态或断开状态；以及第四切换元件 S3藉由位于第二切换元件及第二输出端之间的第二连接点，电性连接电荷储 存元件至第二信号路径，第四切换元件S3根据第二输入信号及控制信号而工 作于连接状态或断开状态。
根据本发明，其中控制信号包含第一控制电平H以及第二控制电平L，时 脉信号产生电路更包含逻辑电路，用以控制第一、第二、第三及第四切换元件， 以使第一切换元件S2在第二输入信号位于第一信号状态H且控制信号位于 第一控制电平H，或是第一输入信号位于第一信号状态H且控制信号位于第 二控制电平L时，工作于连接状态，以及第一切换元件S2在第二输入信号位 于第一信号状态H且控制信号位于第二控制电平L时，工作于断开状态。更 进一步地，第二切换元件Sl在第一输入信号位于第二信号状态L，或是第一 输入信号位于第一信号状态H且控制信号位于第一控制电平H时，工作于连 接状态，以及第二切换元件Sl在第一输入信号位于第一信号状态H且控制信 号位于第二控制电平L时，工作于断开状态。第三切换元件S4在第一切换元 件位于断开状态时，工作于连接状态，以及第一切换元件位于连接状态时，工 作于断开状态；以及第四切换元件S3在第二切换元件位于断开状态时，工作 于连接状态，以及第二切换元件位于连接状态时，工作于断开状态。
根据本发明，时脉信号产生电路更包含第五切换元件S6电性连接第一信 号路径P2及电压电平转换路径，以转换第一信号路径的电压电平至介于第一 时脉电平H及第二时脉电平L的不同电压电平；以及第六切换元件S5电性连 接第二信号路径P1及电压电平转换路径，以转换第二信号路径至不同电压电 平。
本发明的另一实施例中，时脉信号产生电路更接收一进阶控制信号，该进 阶控制信号包含第一进阶控制电平H以及第二进阶控制电平L，时脉信号产生电路更包含第五切换元件电性连接第一信号路径(P2 )及电压电平转换路径，
以转换第一信号路径的电压电平至介于第一时脉电平H及第二时脉电平L的 不同电压电平；以及第六切换元件电性连接第二信号路径P1及电压电平转换 路径，以转换第二信号路径至不同电压电平，其中逻辑电路还用以控制第五及 第六切换元件，以使第五切换元件S6在第一输入信号位于第一信号状态H 且进阶控制信号位于第二进阶控制电平L时，工作于连接状态，以及第五切换 元件在第一输入信号位于第二信号状态L，或第一输入信号位于第一信号状态 H且进阶控制信号位于第二进阶控制电平L时，工作于断开状态；以及第六切 换元件S5在第二输入信号位于第一信号状态H且进阶控制信号位于第二进阶 控制电平L时，工作于连接状态，以及第六切换元件在第二输入信号位于第二 信号状态L，或第二输入信号位于第一信号状态H且进阶控制信号位于第二进 阶控制电平L时，工作于断开状态。
本发明的另一实施例中，逻辑电路还用以在第一输入信号位于第一信号 状态H，且第二输入信号位于第二信号状态L时，执行自第一信号路径至电荷 储存元件的第一电荷转换以使第一时脉信号自第一时脉电平转换至第一中间 电平；在第一输入电平仍位于第二信号状态L时，使第一时脉信号工作于第二 时脉电平；在第一输入信号位于第二信号状态L，且第二输入信号位于第一信 号状态时H:使第二时脉信号自第二时脉电平转换至第二中间电平；使第一时 脉信号工作于第二时脉电平及使第二时脉电平工作于第一时脉电平；执行自第 二信号路径至电荷储存元件的第二电荷转换以使第二时脉信号自第一时脉电 平转换至第三中间电平；以及于第二时脉信号仍位于第一信号状态H时，使 第二时脉信号工作于第二时脉状态L;于第一输入信号位于第二信号状态L, 且第二输入信号位于第一信号状态H时，使第一时脉信号自第二时脉电平转 换至第四中间电平；以及于第一输入信号位于第一信号状态，且第二输入信号 位于第二信号状态时，使第一时脉信号自第四中间电平转换至第一时脉电平。
须注意的是，如图5a、 5b、 5c、 7a、 7b、 7c、 7d、 8及9所示的实施例中， 仅提供二时脉信号(CK及XCK)至位移缓存器(请参照图2:K以产生栅极线 信号。在现有技术中，电荷分享如图4a所示，发生于二时脉信号间。然而， 本发明的各实施例中，二时脉信号间并未有直接的电荷分享，而经由电荷分享 元件所进行。电荷分享可在输入时脉信号的高态时未有重迭时间的情形下进行。如图5b、 7b、 8及9所示，当输入时脉信号(CK—in及XCK—in)其中之 一为高态时，另一者将必定是低态。
在其它实施例中，位移缓存器亦可能使用两个以上的时脉信号来产生栅极 线信号Z举例来说，如图IO所示，可用四个时脉信号CLK1、 CLK2、 CLK3 及CLK4来产生栅极线信号。为了能够自一第三电路元件，如一电荷储存元件， 进行电荷分享，输入时脉信号将设计成任一输入时脉信号的高态将不会与其它 的输入时脉信号的高态有重迭时间。如图11所示，当输入时脉信号CKl一in 位于高态，则输入时脉信号CK3—in必为低态。而当输入时脉信号CK3—in位 于高态，则输入时脉信号CK1—in必为低态。相似地，当输入时脉信号CK2一in 位于高态，则输入时脉信号CK4—in必为低态。而当输入时脉信号CK4—in位 于高态，则输入时脉信号CK2一in必为低态。因此，电荷分享可以在时脉信号 CLK1、 CLK3间，藉由如图5a、 6b、 6c、 7a及7d中的电路实现。同时，电荷 分享亦可以在时脉信号CLK2、 CLK4间实现。而在三个时脉信号的实施方式 中，电荷分享可以在时脉信号CLK1、 CLK3间或是时脉信号CLK3、 CLK1 间实现。
本发明的时脉信号产生电路及方法可应用于位移缓存器具有两个、三个、 四个或更多时脉信号的情形下，来产生栅极线信号。
虽然本发明已以一较佳实施例揭露如上，然其并非用以限定本发明，在 不背离本发明精神及其实质的情况下，熟悉本领域的技术人员当可根据本发明 作出各种相应的改变和变形，但这些相应的改变和变形都应属于本发明所附的 权利要求的保护范围。
权利要求
1. 一种时脉信号产生方法，用以根据一第一输入信号在一第一信号路径产生一第一时脉信号，及根据一第二输入信号在一第二信号路径产生一第二时脉信号，各该第一及第二输入信号分别包含一第一信号状态以及一第二信号状态，各该第一及第二时脉信号分别包含一第一时脉电平及一第二时脉电平，其特征在于，该时脉信号产生方法包含下列步骤在该第一输入信号位于该第一信号状态时，且该第二输入信号位于该第二信号状态，执行自该第一信号路径至一电荷储存元件的一第一电荷转换以使该第一时脉信号自该第一时脉电平转换至一第一中间电平；在该第一输入电平仍位于该第二信号状态时，使该第一时脉信号工作于该第二时脉电平；在该第一输入信号位于该第二信号状态，且该第二输入信号位于该第一信号状态时使该第二时脉信号自该第二时脉电平转换至一第二中间电平；使该第一时脉信号工作于该第二时脉电平及使该第二时脉电平工作于该第一时脉电平；执行自该第二信号路径至该电荷储存元件的一第二电荷转换以使该第二时脉信号自该第一时脉电平转换至一第三中间电平；以及在该第二时脉信号仍位于该第一信号状态时，使该第二时脉信号工作于该第二时脉状态；在该第一输入信号位于该第二信号状态，且该第二输入信号位于该第一信号状态时，使该第一时脉信号自该第二时脉电平转换至一第四中间电平；以及在该第一输入信号位于该第一信号状态，且该第二输入信号位于该第二信号状态时，使该第一时脉信号自该第四中间电平转换至该第一时脉电平。
2. 如权利要求1所述的时脉信号产生方法，其特征在于， 使该第一时脉信号工作于该第二时脉电平的步骤，是在使该第^^时脉信号自该第二时脉电平转换至一第二中间电平的步骤前执行；以及其中在该第一输入信号位于该第二信号状态时，使该第二时脉信号工作于 该第二时脉电平的步骤，是在使该第一时脉信号自该第二时脉电平转换至一第四中间电平的步骤前执行。
3. 如权利要求2所述的时脉信号产生方法，其特征在于，在该第一输入信 号位于该第二信号状态且该第二输入信号位于该第一信号状态时，执行自该电 荷储存元件至该第二信号路径的一第三电荷转换，以使该第二时脉信号自该第 二时脉电平转换至一第二中间电平，且于该第一输入信号位于该第二信号状态 且该第二输入信号位于该第一信号状态时，执行自该电荷储存元件至该第一信 号路径的一第四电荷转换，以使该第一时脉信号自该第二时脉电平转换至一第 四中间电平。
4. 如权利要求1所述的时脉信号产生方法，其特征在于，使该第一时脉信 号工作于该第二时脉电平的步骤，在该第二时脉信号自该第二时脉电平转换至 一第二中间电平的步骤时执行，以及其中在该第一信号位于该第二信号状态时，使该第二时脉信号工作于该第 二时脉状态的步骤，是在使该第一时脉信号自该第二时脉电平转换至一第四中 间电平的步骤前执行。
5. 如权利要求4所述的时脉信号产生方法，其特征在于，在该第一信号位 于该第二信号状态且第二信号位于该第一信号状态时，执行一 自该电荷储存元 件至该第二信号路径的第三电荷转换，以使该第二时脉信号自该第二时脉电平 转换至一第二中间电平，且于该第一输入信号位于该第二信号状态且该第二输 入信号位于该第一信号状态，执行一 自该电荷储存元件至该第一信号路径的第 四电荷转换，以使该第一时脉信号自该第二时脉电平转换至一第四中间电平。
6. 如权利要求2所述的时脉信号产生方法，其特征在于，该第一中间电平 实质上与该第三中间电平相同，且该第二中间电平实质上与该第四中间电平相 同。
7. 如权利要求6所述的时脉信号产生方法，其特征在于，该第一中间电平 实质上与该第二中间电平相同。
8. 如权利要求4所述的时脉信号产生方法，其特征在于，该第一中间电平 实质上与该第三中间电平相同，且该第二中间电平实质上与该第四中间电平相 同。
9. 如权利要求8所述的时脉信号产生方法，其特征在于，该第一中间电平 实质上与该第二中间电平相同。
10. 如权利要求1所述的时脉信号产生方法，其特征在于，进一步包含: 在执行自该第一信号路径至一电荷储存元件的该第一电荷转换的步骤后，以及于该第一输入电平仍位于该第二信号状态时，使该第一时脉信号工作于该 第二时脉电平的步骤前，在该第一输入信号仍位于该第一信号状态以及该第二 输入信号仍位于该第二信号状态时，更包含一步骤，使该第一时脉信号自该第 一中间电平转换至介于该第一中间电平及该第二时脉电平的一第五中间电平；在使该第二时脉信号自该第二时脉电平转换至一第二中间电平的步骤后， 以及使该第一时脉信号工作于该第二时脉电平及使该第二时脉电平工作于该 第一时脉电平的步骤前，在该第一输入电平位于该第二信号状态以及该第二输 入电平位于该第一信号状态时，还包含一步骤，使该第二时脉信号自该第二中 间电平转换至介于该第二中间电平及该第一时脉电平的一第六中间电平；在执行自该第二信号路径至该电荷储存元件的该第二电荷转换以使该第 二时脉信号自该第一时脉电平转换至一第三中间电平以及于使该第二时脉信 号工作于该第二时脉状态的步骤后，还包含一步骤，使该第二时脉信号自该第 三中间电平转换至介于该第三中间电平及该第二时脉电平的一第七中间电平；以及在使该第一时脉信号自该第二时脉电平转换至一第四中间电平的步骤后， 以及使该第一对脉信号自该第四中间电平转换至该第一时脉电平的步骤前，更 包含一步骤，使该第一时脉信号自该第四中间电平转换至介于该第四中间电平 及该第一时脉电平的一第八中间电平。
11. 如权利要求10所述的时脉信号产生方法，其特征在于， 在该第一输入信号位于该第二信号状态且该第二输入信号位于该第一信号状态，执行一自该电荷储存元件至该第二信号路径的第三电荷转换，以使该 第二时脉信号自该第二时脉电平转换至介于该第二中间电平及该第一时脉电 平的一第六中间电平；以及在该第一输入信号位于该第一信号状态且该第二输入信号位于该第二信 号状态，执行自该电荷储存元件至该第一信号路径的一第四电荷转换，以使该 第一时脉信号自该第四时脉电平转换至介于该第四中间电平及该第一时脉电 平的一第八中间电平。
12. 如权利要求ll所述的时脉信号产生方法，其特征在于，在该第一输入信号仍位于该第一信号状态，释放储存于该储存元件的电荷 至一接地端，以使该第一时脉信号自该第一中间电平转换至一第五中间电平； 以及在该第二输入信号仍位于该第一信号状态/释放储存于该储存元件的电荷 至一接地端，以使该第二时脉信号自该第三中间电平转换至一第七中间电平。
13. 如权利要求12所述的时脉信号产生方法，其特征在于 在该第二输入信号仍位于该第一信号状态，藉由一负载连接该第二信号路径至该接地端，以使该第二时脉信号自该第二时脉电平转换至一第二中间电 平；以及在该第一输入信号仍位于该第一信号状态，藉由该负载连接该第一信号路 径至该接地端，以使该第一时脉信号自该第二时脉电平转换至一第四中间电 平。
14. 一种时脉信号产生电路，用以接收一第一输入信号、 一第二输入信 号以及一控制信号，以根据该第一输入信号在一第一信号路径产生一第一时脉 信号以及根据该第二输入信号在一第二信号路径产生一第二时脉信号，各该第 一及该第二输入信号分别包含一第一信号状态以及一第二信号状态，各该第一 及第二时脉信号分别包含一第一时脉电平及一第二时脉电平，该时脉信号产生 电路包含一第一输出端以提供该第一时脉信号； 一第二输出端以提供该第二时脉信号；一第一电压电平转换器(Voltage-levd Shifter)，用以于该第一输入电平 位于该第一信号状态时，提供该第一信号路径相当于一第一时脉电平的一电压 电平，以及用以于该第一输入电平位于该第二信号状态时，提供该第一信号路 径相当于一第二时脉电平的一电压电平；一第二电压电平转换器，用以于该第二输入电平位于该第一信号状态时， 提供该第二信号路径相当于一第一时脉电平的一电压电平，以及用以于该第二 输入电平位于该第二信号状态时，提供该第二信号路径相当于一第二时脉电平 的一电压电平；一第一切换元件，位于该第一信号路径，该第一切换元件根据该第一输入 信号及该控制信号而工作于一连接状态或一断开状态；一第二切换元件，位于该第二信号路径，该第二切换元件根据该第二输入 信号及该控制信号而工作于一连接状态或一断开状态；一第三切换元件，藉由位于该第一切换元件及该第一输出端之间的一第一 连接点，电性连接一电荷储存元件至该第一信号路径，该第三切换元件根据该 第一输入信号及该控制信号而工作于一连接状态或一断开状态；以及一第四切换元件，藉由位于该第二切换元件及该第二输出端之间的一第二 连接点，电性连接该电荷储存元件至该第二信号路径，该第四切换元件根据该 第二输入信号及该控制信号而工作于一连接状态或一断开状态。
15. 如权利要求14所述的时脉信号产生电路，其特征在于，该控制信号 包含一第一控制电平以及一第二控制电平，该时脉信号产生电路进一步包含一逻辑电路，用以控制该第一、第二、第三及第四切换元件，以使-该第一切换元件在该第二输入信号位于该第一信号状态且该控制信号位 于该第一控制电平，或是该第一输入信号位于该第一信号状态且该控制信号位 于该第二控制电平时，工作于该连接状态，以及该第一切换元件在该第二输入 信号位于该第一信号状态且该控制信号位于该第二控制电平时，工作于该断开 状态；该第二切换元件在该第一输入信号位于该第二信号状态，或是该第一输 入信号位于该第一信号状态且该控制信号位于该第一控制电平时，工作于该连 接状态，以及该第二切换元件在该第一输入信号位于该第一信号状态且该控制 信号位于该第二控制电平时，工作于该断开状态；该第三切换元件在该第一切换元件位于该断开状态时，工作于该连接状 态，以及该第一切换元件位于该连接状态时，工作于该断开状态；以及该第四切换元件在该第二切换元件位于该断开状态时，工作于该连接状 态，以及该第二切换元件位于该连接状态时，工作于该断开状态。
16. 如权利要求14所述的时脉信号产生电路，其特征在于，进一步包含 一第五切换元件，电性连接该第一信号路径及一电压电平转换路径，以转换该第一信号路径的一电压电平至介于该第一时脉电平及该第二时脉电平的 一不同电压电平；以及一第六切换元件，电性连接该第二信号路径及该电压电平转换路径，以转 换该第二信号路径至该不同电压电平。
17. 如权利要求14所述的时脉信号产生电路，其特征在于，还接收一进 阶控制信号，该进阶控制信号包含一第一进阶控制电平以及一第二进阶控制电平，该时脉信号产生电路进一步包含一第五切换元件，电性连接该第一信号路径及一电压电平转换路径，以转 换该第一信号路径的一电压电平至介于该第一时脉电平及该第二时脉电平的 一不同电压电平；以及一第六切换元件，电性连接该第二信号路径及该电压电平转换路径，以转 换该第二信号路径至该不同电压电平，其中该逻辑电路还用以控制该第五及第 六切换元件，以使该第五切换元件在该第一输入信号位于该第一信号状态且该进阶控制信 号位于该第二进阶控制电平时，工作于该连接状态，以及该第五切换元件在该 第一输入信号位于该第二信号状态，或该第一输入信号位于该第一信号状态且 该进阶控制信号位于该第二进阶控制电平时，工作于该断开状态；以及该第六切换元件在该第二输入信号位于该第一信号状态且该进阶控制信 号位于该第二进阶控制电平时，工作于该连接状态，以及该第六切换元件在该 第二输入信号位于该第二信号状态，或该第二输入信号位于该第一信号状态且该进阶控制信号位于该第二进阶控制电平时，工作于该断开状态。
18. 如权利要求15所述的时脉信号产生电路，其特征在于，该逻辑电路 还用以在该第一输入信号位于一第一信号状态，且该第二输入信号位于一第二信 号状态，执行自该第一信号路径至一电荷储存元件的一第一电荷转换以使该第 一时脉信号自该第一时脉电平转换至一第一中间电平；在该第一输入电平仍位于该第二信号状态时，使该第一时脉信号工作于该 第二时脉电平；在该第一输入信号位于该第二信号状态，且该第二输入信号位于该第一信 号状态使该第二时脉信号自该第二时脉电平转换至一第二中间电平； 使该第一时脉信号工作于该第二时脉电平及使该第二时脉电平工作于该 第一时脉电平；执行一自该第二信号路径至该电荷储存元件的第二电荷转换以使该第二时脉信号自该第一时脉电平转换至一第三中间电平；以及在该第二时脉信号仍位于该第一信号状态时，使该第二时脉信号工作于该第二时脉状态；在该第一输入信号位于该第二信号状态，且该第二输入信号位于该第一信号状态，在使该第一时脉信号自该第二时脉电平转换至一第四中间电平；以及 在该第一输入信号位于该第一信号状态，且该第二输入信号位于该第二信 号状态，使该第一时脉信号自该第四中间电平转换至该第一时脉电平。
19. 如权利要求18所述的时脉信号产生电路，其特征在于 使该第一时脉信号工作于该第二时脉电平的步骤，在使该第二时脉信号自该第二时脉电平转换至一第二中间电平的步骤前执行；以及其中于该第一输入信号位于该第二信号状态时，使该第二时脉信号工作于 该第二时脉电平的步骤，在使该第一时脉信号自该第二时脉电平转换至一第四 中间电平的步骤前执行。
20. 如权利要求18所述的时脉信号产生电路，其特征在于，使该第一时 脉信号工作于该第二时脉电平的步骤，在使该第二时脉信号自该第二时脉电平 转换至一第二中间电平的步骤同时执行，以及其中于该第一信号位于该第二信 号状态时，使该第二时脉信号工作于该第二时脉状态的步骤，是在使该第一时 脉信号自该第二时脉电平转换至一第四中间电平的步骤前执行。
21. —种时脉信号产生电路，其特征在于，包含 一第一输出端以于一第一信号路径提供一第一时脉信号； 一第二输出端以于一第二信号路径提供一第二时脉信号，各第一及第二输出端可工作于一第一信号状态及一第二信号状态；一电荷储存元件，连接于该第一及第二信号路径；以及 一控制模块，用以在该第一输出端位于该第一信号状态，且该第二输出端位于该第二信号 状态时，执行自该第一信号路径至一电荷储存元件的一第一电荷转换；在该第一及第二输出端均工作于该第二信号状态时，执行自该电荷储存 元件至该第二信号路径的一第二电荷转换；在该第一输出端位于该第二信号状态且该第二输出端位于该第一信号状 态时，执行自该第二信号路径至该电荷储存元件的一第三电荷转换；以及在该第一及第二输出端均工作于该第二信号状态时，执行自该电荷储存 元件至该第二信号路径的一第四电荷转换。
22. 如权利要求21所述的时脉信号产生电路，其特征在于，该第一输出 端工作于介于该第一电荷转换及该第二电荷转换间的一第二信号状态。
23. 如权利要求21所述的时脉信号产生电路，其特征在于，该第二输出 端工作于介于该第三电荷转换及该第四电荷转换间的该第二信号状态。
24. 如权利要求21所述的时脉信号产生电路，其特征在于，各该第一及 第二时脉信号具有一第一电压电平以及一较低的第二电压电平，且其中当该第一时脉信号位于该第一电压电平时，该第一输出端工作于该第一信 号状态，当该第一信号时脉信号位于该第二电压电平时，该第一输出端工作于 该第二信号状态，且于执行该第一电荷转换及第四电荷转换时，该第一时脉信 号介于该第一及第二电压电平；以及当该第二时脉信号位于该第一电压电平时，该第二输出端工作于该第一信 号状态，当该第二信号时脉信号位于该第二电压电平时，该第二输出端工作于 该第二信号状态，且于执行该第二电荷转换及第三电荷转换时，该第一时脉信 号介于该第一及第二电压电平。
25. 如权利要求24所述的时脉信号产生电路，其特征在于，介于该第二 及第三电荷转换时，该第二时脉信号位于该第一电压电平，该第一时脉信号位 于该第二电压电平。
全文摘要
本发明公开了一种时脉信号产生方法以及时脉信号产生电路。时脉信号产生电路包含二输出端，以分别根据第一及第二输入信号提供一第一及一第二时脉信号。电荷储存元件用以在第一时脉信号为高电平的一段时间内执行自第一输出端至电荷储存元件的电荷转换，并在第二时脉信号为低电平时执行自电荷储存元件至第二输出端的电荷转换。在时脉周期的另一段期间中，电荷储存元件用以在第二时脉信号为高电平的一段时间内执行自第二输出端至电荷储存元件的电荷转换，并在第一时脉信号为低电平时执行自电荷储存元件至第一输出端的电荷转换。
文档编号H03K19/00GK101546545SQ200910133680
公开日2009年9月30日 申请日期2009年4月22日 优先权日2008年11月28日
发明者徐兆庆, 程仲升, 董穆林 申请人:友达光电股份有限公司