本发明涉及显示技术领域，特别涉及一种移位寄存器单元、栅极驱动电路、显示面板及显示装置。
背景技术：
目前，在液晶显示器(liquidcrystaldisplay，lcd)显示时，一般通过栅极驱动电路对lcd中的栅线逐行扫描，控制薄膜晶体管(thin-filmtransistor，tft)打开以将显示电压输入像素电极，从而通过像素电极与公共电极之间的电场，控制液晶分子偏转，实现显示功能。一般栅极驱动电路由多个移位寄存器单元级联组成。目前，现有技术提供的一种移位寄存器单元，如图1所示，包括：晶体管m01～m09，电容c01～c02。在正常显示进行扫描时，图1所示的移位寄存器单元对应的电路时序图如图2所示。当输出信号端gout向栅线输出高电平信号时，lcd中的tft打开，像素电极中充入电荷。当输出信号端gout向栅线输出低电平信号时，lcd中的tft关闭，像素电极中的电荷得以保持。然而，在lcd关机，例如由于电源掉电或正常操作导致的lcd关机时，像素电极中存储的电荷得不到有效释放，会留下残留图像，导致关机残影问题。为了改善关机残影问题，一般通过控制电路控制栅极驱动电路中的移位寄存器单元停止输出信号，即控制节点n01与节点n02的信号均为低电平信号；以及向栅线传输高电平信号以控制阵列基板中的tft全部打开，释放电荷。
然而，在释放电荷之后若直接进行正常显示的逐行扫描。假设逐行扫描了前三行，那么从第5行开始，由于显示面板中的栅线保持的是高电平信号，即从第5行开始的移位寄存器单元的输出信号端gout仍是高电平信号。这样在第5行之后的移位寄存器单元中，在其连接的信号端ck2为高电平信号时，晶体管m04会导通。并且，由于该移位寄存器单元的输入信号端in的信号为其相邻的上一级移位寄存器单元的输出信号端gout的信号，从而使得该移位寄存器单元中的晶体管m03也导通。由于晶体管m03与m04同时导通，导致低电平信号端vgl与高电平信号端vgh导通，造成低电平信号端vgl与高电平信号端vgh之间具有大电流，进而导致向低电平信号端vgl与高电平信号端vgh提供信号的电路不稳定，甚至损坏的问题。
技术实现要素：
本发明实施例提供一种移位寄存器单元、栅极驱动电路、显示面板及显示装置，用于解决现有技术中由于低电平信号端vgl与高电平信号端vgh之间具有大电流，导致的向低电平信号端vgl与高电平信号端vgh提供信号的电路不稳定，甚至损坏的问题。
本发明实施例提供了一种移位寄存器单元，包括：扫描控制电路、复位电路、节点控制电路、输出电路、放电控制电路以及电荷释放电路；
所述扫描控制电路用于在正扫控制信号端的控制下，将第一输入信号端的信号提供给所述节点控制电路以及将第一时钟信号端的信号提供给所述复位电路；在反扫控制信号端的控制下，将第二输入信号端的信号提供给所述节点控制电路以及将第二时钟信号端的信号提供给所述复位电路；
所述复位电路用于在所述扫描控制电路输入其的信号的控制下，将第一参考信号端的信号提供给下拉节点；
所述节点控制电路用于根据所述扫描控制电路输入的信号或所述下拉节点的信号，控制上拉节点与所述下拉节点的信号的电平相反；
所述输出电路用于在所述上拉节点的信号的控制下，将第三时钟信号端的信号提供给所述移位寄存器单元的输出信号端，或在所述下拉节点的信号的控制下，将第二参考信号端的信号提供给所述输出信号端；
所述放电控制电路用于在放电控制信号端的控制下，将所述第一参考信号端的信号提供给所述上拉节点和所述下拉节点中的一个节点；
所述电荷释放电路用于在电荷释放信号端的控制下，将所述第二参考信号端的信号分别提供给所述下拉节点与所述上拉节点，以及在所述电荷释放信号端的控制下，将所述第一参考信号端的信号提供给所述输出信号端。
相应地，本发明实施例还提供了一种栅极驱动电路，包括级联的多个本发明实施例提供的移位寄存器单元；
第1级所述移位寄存器单元的所述第一输入信号端与正扫帧触发信号端耦接；第n级所述移位寄存器单元的所述第一输入信号端与第n-1级所述移位寄存器单元的所述输出信号端耦接；第n级所述移位寄存器单元的所述第一输入信号端与第n-1级所述移位寄存器单元的所述输出信号端耦接；其中，n为大于或等于2且小于或等于n-1的整数；和/或，
第n级所述移位寄存器单元的所述第二输入信号端与反扫帧触发信号端耦接；第n级所述移位寄存器单元的所述第二输入信号端与第n+1级所述移位寄存器单元的所述输出信号端耦接；第1级所述移位寄存器单元的所述第二输入信号端与第2级所述移位寄存器单元的所述输出信号端耦接。
相应地，本发明实施例还提供了一种显示面板，包括：本发明实施例提供的栅极驱动电路。
相应地，本发明实施例还提供了一种显示装置，包括：本发明实施例提供的显示面板。
本发明有益效果如下：
本发明实施例提供的移位寄存器单元、栅极驱动电路、显示面板及显示装置，在移位寄存器单元正常输出扫描信号以驱动显示面板中的栅线扫描时，通过扫描控制电路可以实现正向扫描与反向扫描的控制，通过复位电路可以在移位寄存器单元的输出信号端输出有效脉冲信号后对移位寄存器单元进行复位，通过节点控制电路可以控制上拉节点和下拉节点的电位，以及通过输出电路输出扫描信号。在控制显示面板中的像素电极释放电荷时，通过电荷释放电路向上拉节点与下拉节点输入第二参考信号端的信号，以控制移位寄存器单元停止输出扫描信号，并且向输出信号端输出第一参考信号端的信号，控制显示面板中的tft均导通以释放电荷。在显示面板中的像素电极释放电荷之后，通过放电控制电路向上拉节点和下拉节点中的一个节点输入第一参考信号端的信号，并与输出电路相互配合，以使输出信号端的电平拉低，从而可以改善再次正常扫描时的大电流问题。
附图说明
图1为现有技术中的移位寄存器单元的结构示意图；
图2为图1所示的移位寄存器单元的电路时序图；
图3为本发明实施例提供的移位寄存器单元的结构示意图之一；
图4为本发明实施例提供的移位寄存器单元的结构示意图之二；
图5、图7、图8、图10、图12、图14分别为图3所示的移位寄存器单元的具体结构示意图；
图15至图20分别为图4所示的移位寄存器单元的具体结构示意图；
图6、图9、图11、图13以及图21分别为本发明实施例提供的电路时序图；
图22为本发明实施例提供的栅极驱动电路的结构示意图。
具体实施方式
为了使本发明的目的，技术方案和优点更加清楚，下面结合附图，对本发明实施例提供的移位寄存器单元、栅极驱动电路、显示面板及显示装置的具体实施方式进行详细地说明。应当理解，下面所描述的优选实施例仅用于说明和解释本发明，并不用于限定本发明。并且在不冲突的情况下，本申请中的实施例及实施例中的特征可以相互组合。
本发明实施例提供的移位寄存器单元，如图3与图4所示，包括：扫描控制电路1、复位电路2、节点控制电路3、输出电路4、放电控制电路5以及电荷释放电路6；
扫描控制电路1用于在正扫控制信号端u2d的控制下，将第一输入信号端inf的信号提供给节点控制电路3以及将第一时钟信号端ckv1的信号提供给复位电路2；在反扫控制信号端d2u的控制下，将第二输入信号端inb的信号提供给节点控制电路3以及将第二时钟信号端ckv2的信号提供给复位电路2；
复位电路2用于在扫描控制电路1输入其的信号的控制下，即在扫描控制电路1输入其的第一时钟信号端ckv1的信号或第二时钟信号端ckv2的信号的控制下，将第一参考信号端v1的信号提供给下拉节点n1；
节点控制电路3用于根据扫描控制电路1输入其的信号(即扫描控制电路1输入其的第一输入信号端inf的信号或第二输入信号端inb的信号)或下拉节点n1的信号，控制上拉节点n2与下拉节点n1的信号的电平相反；
输出电路4用于在上拉节点n2的信号的控制下，将第三时钟信号端ckv3的信号提供给移位寄存器单元的输出信号端gout，在下拉节点n1的信号的控制下，将第二参考信号端v2的信号提供给输出信号端gout；
放电控制电路5用于在放电控制信号端cs的控制下，将第一参考信号端v1的信号提供给上拉节点n2和下拉节点n1中的一个节点；
电荷释放电路6用于在电荷释放信号端gas的控制下，将第二参考信号端v2的信号分别提供给下拉节点n1与上拉节点n2，以及在电荷释放信号端gas的控制下，将第一参考信号端v1的信号提供给输出信号端gout。
本发明实施例提供的上述移位寄存器单元，在移位寄存器单元正常输出扫描信号以驱动显示面板中的栅线扫描时，通过扫描控制电路可以实现正向扫描与反向扫描的控制，通过复位电路可以在移位寄存器单元的输出信号端输出有效脉冲信号后对移位寄存器单元进行复位，通过节点控制电路可以控制上拉节点和下拉节点的电位，以及通过输出电路输出扫描信号。在控制显示面板中的像素电极释放电荷时，通过电荷释放电路向上拉节点与下拉节点输入第二参考信号端的信号，以控制移位寄存器单元停止输出扫描信号，并且向输出信号端输出第一参考信号端的信号，控制显示面板中的tft均导通以释放电荷。在显示面板中的像素电极释放电荷之后，通过放电控制电路向上拉节点和下拉节点中的一个节点输入第一参考信号端的信号，并与输出电路相互配合，以使输出信号端的电平拉低，从而可以改善再次正常扫描时的大电流问题。
在具体实施时，在本发明实施例中，如图3所示，放电控制电路5分别与放电控制信号端cs、第一参考信号端v1以及上拉节点n2耦接，以在放电控制信号端cs的控制下，将第一参考信号端v1的信号提供给上拉节点n2。如
图4所示，放电控制电路5分别与放电控制信号端cs、第一参考信号端v1以及下拉节点n1耦接，以在放电控制信号端cs的控制下，将第一参考信号端v1的信号提供给下拉节点n1。
本发明实施例提供的上述移位寄存器单元可以实现双向扫描。其中，在正扫控制信号端的信号为有效电平信号，反扫控制信号端的信号为无效电平信号时，可以将第一输入信号端的信号提供给节点控制电路以及将第一时钟信号端的信号提供给复位电路，以实现正向扫描。反之，在正扫控制信号端的信号为无效电平信号，反扫控制信号端的信号为有效电平信号时，可以将第二输入信号端的信号提供给节点控制电路以及将第二时钟信号端的信号提供给复位电路，以实现反向扫描。
在具体实施时，在本发明实施例中，在正向扫描时，在第一输入信号端的有效脉冲信号为高电平信号时，第一参考信号端的信号为高电平信号，第二参考信号端的信号为低电平信号。在第一输入信号端的有效脉冲信号为低电平信号时，第一参考信号端的信号为低电平信号，第二参考信号端的信号为高电平信号。在反向扫描时，在第二输入信号端的有效脉冲信号为高电平信号时，第一参考信号端的信号为高电平信号，第二参考信号端的信号为低电平信号。在第二输入信号端的有效脉冲信号为低电平信号时，第一参考信号端的信号为低电平信号，第二参考信号端的信号为高电平信号。
下面结合具体实施例，对本发明进行详细说明。需要说明的是，本实施例中是为了更好的解释本发明，但不限制本发明。
实施例一、
在具体实施时，在本发明实施例中，如图5所示，扫描控制电路1可以包括：第四晶体管m4、第五晶体管m5、第六晶体管m6以及第七晶体管m7；其中，第四晶体管m4的栅极与正扫控制信号端u2d耦接，第四晶体管m4的第一极与第一输入信号端inf耦接，第四晶体管m4的第二极分别与第五晶体管m5的第二极以及节点控制电路3耦接。第五晶体管m5的栅极与反扫控制信号端d2u耦接，第五晶体管m5的第一极与第二输入信号端inb耦接。第六晶体管m6的栅极与正扫控制信号端u2d耦接，第六晶体管m6的第一极与第一时钟信号端ckv1耦接，第六晶体管m6的第二极分别与第七晶体管m7的第二极以及复位电路2耦接。第七晶体管m7的栅极与反扫控制信号端d2u耦接，第七晶体管m7的第一极与第二时钟信号端ckv2耦接。
一般n型晶体管在高电平信号的控制下导通，在低电平信号的控制下截止；p型晶体管在低电平信号的控制下导通，在高电平信号的控制截止。在具体实施时，如图5所示，第四晶体管m4、第五晶体管m5、第六晶体管m6以及第七晶体管m7可以为n型晶体管，此时正扫控制信号端u2d与反扫控制信号端d2u的有效电平信号分别为高电平信号，无效电平信号分别为低电平信号。反之，第四至第七晶体管也可以为p型晶体管，此时，正扫控制信号端与反扫控制信号端的有效电平信号分别为低电平信号，无效电平信号分别为高电平信号，在此不作限定。
在具体实施时，在本发明实施例中，如图5所示，复位电路2可以包括：第八晶体管m8；其中，第八晶体管m8的栅极用于接收扫描控制电路1输出的信号，第八晶体管m8的第一极与第一参考信号端v1耦接，第八晶体管m8的第二极与下拉节点n1耦接。具体地，第八晶体管m8的栅极分别与第六晶体管m6的第二极以及第七晶体管m7的第二极耦接。
在具体实施时，在本发明实施例中，如图5所示，输出电路4可以包括：第九晶体管m9、第十晶体管m10、第一电容c1以及第二电容c2；其中，第九晶体管m9的栅极与上拉节点n2耦接，第九晶体管m9的第一极与第三时钟信号端ckv3耦接，第九晶体管m9的第二极与输出信号端got耦接。第十晶体管m10的栅极与下拉节点n1耦接，第十晶体管m10的第一极与第二参考信号端v2耦接，第十晶体管m10的第二极与输出信号端gout耦接。第一电容c1耦接于第十晶体管m10的栅极与第二参考信号端v2之间。第二电容c2耦接于上拉节点n2与输出信号端gout之间。
在具体实施时，在本发明实施例中，如图5所示，节点控制电路3可以包括：第十四晶体管m14、第十五晶体管m15以及第十六晶体管m16；其中，第十四晶体管m14的栅极与下拉节点n1耦接，第十四晶体管m14的第一极与第二参考信号端v2耦接，第十四晶体管m14的第二极分别与第十六晶体管m16的第二极以及上拉节点n2耦接。第十五晶体管m15的栅极用于接收扫描控制电路1输出的信号，第十五晶体管m15的第一极与第二参考信号端v2耦接，第十五晶体管m15的第二极与下拉节点n1耦接。第十六晶体管m16的栅极与第四时钟信号端ck4耦接，第十六晶体管m16的第一极与第十五晶体管m15的栅极耦接。
在具体实施时，在本发明实施例中，如图5所示，电荷释放电路6可以包括：第十九晶体管m19、第二十晶体管m20以及第二十一晶体管m21；其中，第十九晶体管m19的栅极与电荷释放信号端gas耦接，第十九晶体管m19的第一极与第二参考信号端v2耦接，第十九晶体管m19的第二极与下拉节点n1耦接。第二十晶体管m20的栅极与电荷释放信号端gas耦接，第二十晶体管m20的第一极与第二参考信号端v2耦接，第二十晶体管m20的第二极与上拉节点n2耦接。第二十一晶体管m21的栅极与电荷释放信号端gas耦接，第二十一晶体管m21的第一极与第一参考信号端v1耦接，第二十一晶体管m21的第二极与输出信号gout端耦接。
在具体实施时，在本发明实施例中，如图5所示，放电控制信号端cs可以包括：第一子放电控制信号端cs1和第二子放电控制信号端cs2；放电控制电路5可以包括：第一晶体管m1与第二晶体管m2；其中，第一晶体管m1的栅极与第一子放电控制信号端cs1耦接，第一晶体管m1的第一极与上拉节点n2耦接，第一晶体管m1的第二极与第二晶体管m2的第一极耦接；第二晶体管m2的栅极与第二子放电控制信号端cs2耦接，第二晶体管m2的第二极与第一参考信号端v1耦接。
需要说明的是，本发明上述实施例中提到的晶体管可以是薄膜晶体管(tft，thinfilmtransistor)，也可以是金属氧化物半导体场效应管(mos，metaloxidescmiconductor)，在此不作限定。在具体实施中，可以根据晶体管的类型以及其栅极的信号，将晶体管的第一极作为其源极，第二极作为其漏极；或者，反之，将晶体管的第一极作为其漏极，第二极作为其源极，具体在此不做具体区分。
图5所示的移位寄存器单元采用的时序图可以如图6所示。下述描述中以1表示高电平信号，0表示低电平信号，其中，1和0代表其逻辑电平，仅是为了更好的解释本发明实施例提供的上述移位寄存器单元的工作过程，而不是在具体实施时施加在各晶体管的栅极上的电平。以下均是以正向扫描为例进行说明。具体选取图6中的t1、t2以及t3三个阶段。其中，t1阶段代表移位寄存器单元在正常显示的一帧扫描时间内的工作阶段。t2阶段代表控制移位寄存器单元的输出信号端gout拉高以控制像素电极释放电荷的阶段，t3阶段代表控制移位寄存器单元的输出信号端gout拉低的阶段。
在t1阶段中，又可以分为4个子阶段，即t11、t12、t13以及t14。并且，cs1＝0、cs2＝0、d2u＝0以及gsa＝0，因此第一晶体管m1、第二晶体管m2、第五晶体管m5、第七晶体管m7、第十九晶体管m19、第二十晶体管m20、第二十一晶体管m21均截止。
在t11子阶段中，ckv1＝0、ckv3＝0、ckv4＝1、inf＝1，u2d＝1。由于u2d＝1，因此第四晶体管m4与第六晶体管m6均导通。导通的第六晶体管m6将第一时钟信号端ckv1的低电平信号提供给第八晶体管m8的栅极，控制第八晶体管m8截止。导通的第四晶体管m4将第一输入信号端inf的高电平信号提供给第十五晶体管m15，则第十五晶体管m15导通以将第二参考信号端v2的低电平信号提供给下拉节点n1，使下拉节点n1的信号为低电平信号，以控制第十晶体管m10与第十四晶体管m14截止。由于ckv4＝1，因此第十六晶体管m16导通，并将第一输入信号端inf的高电平信号提供给上拉节点n2，使上拉节点n2的信号为高电平信号，以控制第九晶体管m9导通，以将第三时钟信号端ckv3的低电平信号提供给输出信号端gout，对第二电容c2充电以及使输出信号端gout输出低电平的扫描信号。
在t12子阶段中，ckv1＝0、ckv3＝0、ckv4＝0、inf＝0，u2d＝1。由于u2d＝1，因此第四晶体管m4与第六晶体管m6均导通。导通的第六晶体管m6将第一时钟信号端ckv1的低电平信号提供给第八晶体管m8的栅极，控制第八晶体管m8截止。导通的第四晶体管m4将第一输入信号端inf的低电平信号提供给第十五晶体管m15，控制第十五晶体管m15截止。由于ckv4＝0，因此第十六晶体管m16截止，因此上拉节点n2与下拉节点n1浮接。由于第一电容c1的作用，可以保持下拉节点n1的信号为低电平信号，以控制第十晶体管m10与第十四晶体管m14截止。由于第二电容c2的作用，可以保持上拉节点n2的信号为高电平信号，以控制第九晶体管m9导通，并将第三时钟信号端ckv3的低电平信号提供给输出信号端gout，使输出信号端gout输出低电平的扫描信号。
在t13子阶段中，ckv1＝0、ckv3＝1、ckv4＝0、inf＝0，u2d＝1。由于u2d＝1，因此第四晶体管m4与第六晶体管m6均导通。导通的第六晶体管m6将第一时钟信号端ckv1的低电平信号提供给第八晶体管m8的栅极，控制第八晶体管m8截止。导通的第四晶体管m4将第一输入信号端inf的低电平信号提供给第十五晶体管m15，控制第十五晶体管m15截止。由于ckv4＝0，因此第十六晶体管m16截止，因此上拉节点n2与下拉节点n1浮接。由于第一电容c1的作用，可以保持下拉节点n1的信号为低电平信号，以控制第十晶体管m10与第十四晶体管m14截止。由于第二电容c2的作用，可以保持上拉节点n2的信号为高电平信号，以控制第九晶体管m9导通，并将第三时钟信号端ckv3的高电平信号提供给输出信号端gout，使输出信号端gout输出高电平的扫描信号。由于下拉节点n1浮接且由于第二电容c2的自举作用可以使下拉节点n1的电平拉高，以控制第九晶体管m9完全导通，以将第三时钟信号端ckv3的高电平信号可以无电压损失的提供给输出信号端gout，使输出信号端gout输出高电平的扫描信号。
在t14子阶段中，ckv1＝1、ckv3＝0、ckv4＝0、inf＝0，u2d＝1。由于u2d＝1，因此第四晶体管m4与第六晶体管m6均导通。导通的第四晶体管m4将第一输入信号端inf的低电平信号提供给第十五晶体管m15，控制第十五晶体管m15截止。导通的第六晶体管m6将第一时钟信号端ckv1的高电平信号提供给第八晶体管m8的栅极，控制第八晶体管m8导通以将第一参考信号端v1的高电平信号提供给下拉节点n1，使下拉节点n1的信号为高电平信号，以控制第十晶体管m10与第十四晶体管m14导通。由于ckv4＝0，因此第十六晶体管m16截止。导通的第十四晶体管m14将第二参考信号端v2的低电平信号提供给上拉节点n2，以控制第九晶体管m9截止。导通的第十晶体管m10将第二参考信号端v2的低电平信号提供给输出信号端gout，使输出信号端gout输出低电平的扫描信号。
之后，在ckv4＝1时，第十六晶体管m16导通，以将第一输入端inf的低电平信号提供给上拉节点n2，拉低上拉节点n2的电平，以控制第九晶体管m9截止。在ckv1＝1时，控制第八晶体管m8导通以将第一参考信号端v1的高电平信号提供给下拉节点n1，拉高下拉节点n1的电平，以控制第十晶体管m10与第十四晶体管m14导通。导通的第十晶体管m10使输出信号端gout输出低电平信号。导通的第十四晶体管m14将第二参考信号端v2的低电平信号提供给上拉节点n2，拉低上拉节点n2的电平。具体过程参见上述描述，在此不作赘述。
在显示面板关机或突然断电时，为了改善关机残影问题，一般向栅线传输高电平信号以控制阵列基板中的tft全部打开，以使像素电极与数据线导通，此时数据线与接地端gnd导通，从而释放电荷。此时各时钟信号端的信号均变为低电平信号。具体地，在t2阶段进行释放电荷的工作过程。由于cs1＝0、cs2＝0、d2u＝0、ckv1＝0以及ckv4＝0，因此第一晶体管m1、第二晶体管m2、第五晶体管m5、第七晶体管m7、第八晶体管m8以及第十六晶体管m16均截止。由于gsa＝1，因此第十九晶体管m19、第二十晶体管m20、第二十一晶体管m21均导通。导通的第十九晶体管m19将第二参考信号端v2的低电平信号提供给下拉节点n1，使下拉节点n1的信号为低电平信号，以控制第十晶体管m10与第十四晶体管m14截止。导通的第二十晶体管m20将第二参考信号端v2的低电平信号提供给上拉节点n2，使上拉节点n2的信号为低电平信号，以控制第九晶体管m9截止。导通的第二十一晶体管m21将第一参考信号端v1的高电平信号提供给输出信号端gout，使输出信号端gout输出高电平信号，以控制显示面板中的tft均打开，以控制像素电极释放电荷。
为了改善在t2阶段完成之后直接进行正常显示扫描时的大电流问题，设置了t3阶段。在t3阶段中，各时钟信号端的信号均变为低电平信号。由于d2u＝0、ckv1＝0、ckv4＝0以及gas＝0，因此第五晶体管m5、第七晶体管m7、第八晶体管m8、第十六晶体管m16、第十九晶体管m19、第二十晶体管m20、第二十一晶体管m21均截止。由于cs1＝1且cs2＝1、因此第一晶体管m1与第二晶体管m2均导通，以将第一参考信号端v1的高电平信号提供给上拉节点n2，从而控制第九晶体管m9导通以将第三时钟信号端ckv3的低电平信号提供给输出信号端gout，使输出信号端gout输出低电平信号，从而将输出信号端gout的电平拉低。这样t3阶段之后再进行正常显示扫描时，可以使显示面板中的栅线保持为低电平信号，使得移位寄存器单元的第一输入信号端inf与第二输入信号端inb输入的信号可以为低电平信号，从而在正向扫描且在第一输入信号端inf的有效脉冲信号未出现时，可以控制第十五晶体管m15截止。同理，在反向扫描且在第二输入信号端inb的有效脉冲信号未出现时，可以控制第十五晶体管m15截止。进而可以改善第一参考信号端v1与第二参考信号端v2直接导通而造成的大电流问题。
进一步地，为了提高移位寄存器单元的稳定性，在t3阶段之后还可以将下拉节点n1的信号重置为高电平信号，将上拉节点n2的信号重置为低电平信号，即分别与t14子阶段中下拉节点n1与上拉节点n2的信号相同。具体地，在t4阶段中，各时钟信号端的信号均变为高电平信号。并且，由于cs1＝0、cs2＝0、d2u＝0以及gsa＝0，因此第一晶体管m1、第二晶体管m2、第五晶体管m5、第七晶体管m7、第十九晶体管m19、第二十晶体管m20、第二十一晶体管m21均截止。由于u2d＝1，因此第四晶体管m4与第六晶体管m6均导通。导通的第四晶体管m4将第一输入信号端inf的低电平信号提供给第十五晶体管m15，控制第十五晶体管m15截止。导通的第六晶体管m6将第一时钟信号端ckv1的高电平信号提供给第八晶体管m8的栅极，控制第八晶体管m8导通以将第一参考信号端v1的高电平信号提供给下拉节点n1，使下拉节点n1的信号为高电平信号，以控制第十晶体管m10与第十四晶体管m14导通。导通的第十晶体管m10使输出信号端gout输出低电平信号。导通的第十四晶体管m14将第二参考信号端v2的低电平信号提供给上拉节点n2，使上拉节点n2的信号为低电平信号，以控制第九晶体管m9截止。由于ckv4＝1，因此第十六晶体管m16导通以将第一输入信号端inf的低电平信号提供给上拉节点n2，进一步使上拉节点n2的信号为低电平信号。
在t4阶段之后，可以控制移位寄存器单元直接进行正常扫描驱动，其工作可以参见t1阶段的工作过程，在此不作赘述。
在具体实施时，上述t1、t2、t3、t4所用的时长可以分别为一帧扫描时间的时长。当然，在实际应用中，也可以根据实际应用环境来设计其所用的时长，在此不作限定。
在反向扫描时，正扫控制信号端u2d与反扫控制信号端d2u的信号相反，并且第二时钟信号端ckv2的信号可以对应设置，其具体工作过程参见上述正向扫描的工作过程，在此不作赘述。
实施例二、
本发明实施例二提供的移位寄存器单元与实施例一提供的移位寄存器单元相同的部分在此不再赘述，下面只说明不同的部分。
为了进一步使下拉节点n1的信号稳定，在具体实施时，在本发明实施例中，如图7所示，移位寄存器单元还可以包括：第十七晶体管m17；其中，第十七晶体管m17的栅极与上拉节点n2耦接，第十七晶体管m17的第一极与第二参考信号端v2耦接，第十七晶体管m17的第二极与下拉节点n1耦接。
为了进一步使上拉节点n2的信号稳定，在具体实施时，在本发明实施例中，如图7所示，移位寄存器单元还可以包括：第十八晶体管m18；其中，第十八晶体管m18的栅极用于接收扫描控制电路1输出的时钟信号，第十八晶体管m18的第一极用于接收扫描控制电路1输出的输入信号，第十八晶体管m18的第二极与上拉节点n2耦接。具体地，第十八晶体管m18的栅极分别与第六晶体管m6以及第七晶体管m7的第二极耦接，第十八晶体管m18的第一极分别与第四晶体管m4的第二极以及第五晶体管m5的第二极耦接。
在上拉节点n2拉高时，为了进一步保持上拉节点n2的电平。在具体实施时，在本发明实施例中，如图7所示，输出电路4还可以包括：第十一晶体管m11；其中，上拉节点n2通过第十一晶体管m11分别与第九晶体管m9的栅极以及第二电容c2耦接；并且，第十一晶体管m11的栅极与第一参考信号端v1耦接，第十一晶体管m11的第一极与上拉节点n2耦接，第十一晶体管m11的第二极分别与第九晶体管m9的栅极以及第二电容c2耦接，第十一晶体管m11的第一极分别与第十六晶体管m16的第二极以及第十四晶体管m14的第二极耦接。
图7所示的移位寄存器单元采用的时序图可以如图6所示。并且，实施例二提供的移位寄存器单元与实施例一提供的移位寄存器单元的工作过程相类似，相同的部分在此不再赘述，下面只说明不同的部分。
在上拉节点n2的信号为高电平信号时，还可以控制第十七晶体管m17导通以将第二参考信号端v2的低电平信号提供给下拉节点n1，进一步保证下拉节点n1的信号为低电平信号。
在ckv1＝1时，还可以控制第十八晶体管m18导通以将第一输入信号端inf的低电平信号提供给上拉节点n2，从而可以及时将上拉节点n2的信号拉低，提高移位寄存器单元的稳定性。
在t13子阶段中时，由于第二电容c2将上拉节点n2的信号保持为高电平信号，因此第九晶体管m9导通，以将第三时钟信号端ckv3的高电平信号提供给输出信号端gout。由于第二电容c2的自举作用可以将与第九晶体管m9的栅极连接的第二电容c2的一端拉高。由于第十一晶体管的作用，在该第二电容c2的一端拉高到一定电平时，上拉节点n2的电平也拉高，从而降低第九晶体管m9的栅极漏电，提高输出稳定性。
实施例三、
本发明实施例三提供的移位寄存器单元与实施例二提供的移位寄存器单元相同的部分在此不再赘述，下面只说明不同的部分。
为了减少信号线的设置，节省信号端口数量，节省布线空间，进一步地，在具体实施时，可以将第一子放电控制信号端与正扫控制信号端设置为同一信号端，以及将第二子放电控制信号端与反扫控制信号端设置为同一信号端。具体地，如图8所示，第一晶体管m1的栅极、第四晶体管m4的栅极以及第六晶体管m6的栅极均与正扫控制信号端u2d耦接。第二晶体管m2的栅极、第五晶体管m5的栅极以及第七晶体管m7的栅极均与反扫控制信号端d2u耦接。
图8所示的移位寄存器单元采用的时序图可以如图9所示。并且，实施例三提供的移位寄存器单元与实施例二提供的移位寄存器单元的工作过程相类似，相同的部分在此不再赘述，下面只说明不同的部分。
在t1、t2以及t4阶段中，由于u2d＝1，因此第一晶体管m1导通，但是由于d2u＝0，因此第二晶体管m2截止。因此第一晶体管m1与第二晶体管m2不能将第一参考信号端v1的高电平信号提供给上拉节点n2。在t3阶段中，由于u2d＝1，因此第一晶体管m1导通，并且d2u＝1，因此第二晶体管m2导通，从而可以将第一参考信号端v1的高电平信号提供给上拉节点n2，从而控制第九晶体管m9导通以将第三时钟信号端ckv3的低电平信号提供给输出信号端gout，使输出信号端gout输出低电平信号，从而将输出信号端gout的电平拉低。
实施例四、
本发明实施例四提供的移位寄存器单元与实施例二提供的移位寄存器单元相同的部分在此不再赘述，下面只说明不同的部分。
在具体实施时，放电控制电路的具体结构也可以采用其他实施方式。在本发明实施例中，如图10所示，放电控制电路5也可以包括：第三晶体管m3；其中，第三晶体管m3的栅极与放电控制信号端cs耦接，第三晶体管m3的第一极与第一参考信号端v1耦接，第三晶体管m3的第二极与上拉节点n2耦接。这样可以减少晶体管的数量设置，进一步减低移位寄存器单元的占用空间以及减少功耗。
图10所示的移位寄存器单元采用的时序图可以如图11所示。并且，实施例四提供的移位寄存器单元与实施例二提供的移位寄存器单元的工作过程相类似，相同的部分在此不再赘述，下面只说明不同的部分。在t1、t2以及t4阶段中，由于cs＝0，因此第三晶体管m3截止。在t3阶段中，由于cs＝1，因此第三晶体管m3导通，以将第一参考信号端v1的高电平信号提供给上拉节点n2，从而控制第九晶体管m9导通以将第三时钟信号端ckv3的低电平信号提供给输出信号端gout，使输出信号端gout输出低电平信号，从而将输出信号端gout的电平拉低。
实施例五、
本发明实施例五提供的移位寄存器单元与实施例一提供的移位寄存器单元相同的部分在此不再赘述，下面只说明不同的部分。在具体实施时，本发明实施例提供的移位寄存器单元中的节点控制电路也可以采用其他具体实施方式。具体地，如图12所示，节点控制电路3具体也可以包括：第十二晶体管m12与第十三晶体管m13；其中，第十二晶体管m12的栅极与下拉节点n1耦接，第十二晶体管m12的第一极与第二参考信号端v2耦接，第十二晶体管m12的第二极分别与第十三晶体管m13的栅极以及上拉节点n2耦接。第十三晶体管m13的栅极用于接收扫描控制电路1输出的信号，第十三晶体管m13的第一极与第二参考信号端v2耦接，第十三晶体管m13的第二极与下拉节点n1耦接。其中，第十三晶体管m13的栅极分别与第四晶体管m4的第二极以及第五晶体管m5的第二极耦接。
图12所示的移位寄存器单元采用的时序图可以如图13所示。具体选取图13中的t1、t2以及t3三个阶段。其中，t1阶段代表移位寄存器单元在正常显示的一帧扫描时间内的工作阶段。t2阶段代表控制移位寄存器单元的输出信号端gout拉高以控制像素电极释放电荷的阶段，t3阶段代表控制移位寄存器单元的输出信号端gout拉低的阶段。
在t1阶段中，又可以分为3个子阶段，即t11、t12、t13。并且，cs1＝0、cs2＝0、d2u＝0以及gsa＝0，因此第一晶体管m1、第二晶体管m2、第五晶体管m5、第七晶体管m7、第十九晶体管m19、第二十晶体管m20、第二十一晶体管m21均截止。
在t11子阶段中，ckv1＝0、ckv2＝1、ckv3＝0、inf＝1，u2d＝1。由于u2d＝1，因此第四晶体管m4与第六晶体管m6均导通。导通的第六晶体管m6将第一时钟信号端ckv1的低电平信号提供给第八晶体管m8的栅极，控制第八晶体管m8截止。导通的第四晶体管m4将第一输入信号端inf的高电平信号提供给上拉节点n2，使上拉节点n2的信号为高电平信号，控制第十三晶体管m13导通以将第二参考信号端v2的低电平信号提供给下拉节点n1，使下拉节点n1的信号为低电平信号，以控制第十晶体管m10与第十四晶体管m14截止。由于第十一晶体管m11在第一参考信号端v1的高电平信号的控制下导通，从而使第九晶体管m9导通以将第三时钟信号端ckv3的低电平信号提供给输出信号端gout，对第二电容c2充电以及使输出信号端gout输出低电平的扫描信号。
在t12子阶段中，ckv1＝0、ckv2＝0、ckv3＝1、inf＝0，u2d＝0。由于u2d＝0，因此第四晶体管m4与第六晶体管m6均截止。因此，上拉节点n2浮接。由于第二电容c2的作用，可以保持上拉节点n2的信号为高电平信号，以控制第九晶体管m9导通，以将第三时钟信号端ckv3的高电平信号提供给输出信号端gout，由于第二电容c2的自举作用可以使其与第九晶体管m9的栅极连接的一端的电平拉高，从而使第九晶体管m9完全导通，以将第三时钟信号端ckv3的高电平信号无电压损失的提供给输出信号端gout，使输出信号端gout输出高电平的扫描信号。导通的第十三晶体管m13可以将第二参考信号端v2的低电平信号提供给下拉节点n1，使下拉节点n1的信号为低电平信号，以控制第十晶体管m10与第十四晶体管m14截止。其中，由于第十一晶体管m11的作用，可以改善第九晶体管m9的栅极的电平的漏电流问题。
在t13子阶段中，ckv1＝1、ckv2＝0、ckv3＝0、inf＝0，u2d＝1。由于u2d＝1，因此第四晶体管m4与第六晶体管m6均导通。导通的第四晶体管m4将第一输入信号端inf的低电平信号提供给上拉节点n1，以控制第九晶体管m9以及第十三晶体管m13截止。导通的第六晶体管m6将第一时钟信号端ckv1的高电平信号提供给第八晶体管m8的栅极，控制第八晶体管m8导通以将第一参考信号端v1的高电平信号提供给下拉节点n1，使下拉节点n1的信号为高电平信号，以控制第十晶体管m10与第十二晶体管m12导通。导通的第十二晶体管m12将第二参考信号端v2的低电平信号提供给上拉节点n2，使上拉节点n2的信号为低电平信号，以控制第九晶体管m9截止。导通的第十晶体管m10将第二参考信号端v2的低电平信号提供给输出信号端gout，使输出信号端gout输出低电平的扫描信号。
之后，在ckv1＝1时，控制第八晶体管m8导通以将第一参考信号端v1的高电平信号提供给下拉节点n1，拉高下拉节点n1的电平，以控制第十晶体管m10与第十二晶体管m12导通。导通的第十晶体管m10使输出信号端gout输出低电平信号。导通的第十四晶体管m14将第二参考信号端v2的低电平信号提供给上拉节点n2，拉低上拉节点n2的电平。具体过程参见上述描述，在此不作赘述。
在显示面板关机或突然断电时，为了改善关机残影问题，一般向栅线传输高电平信号以控制阵列基板中的tft全部打开，释放电荷。各时钟信号端的信号均变为低电平信号。具体地，在t2阶段进行释放电荷的工作过程。由于cs1＝0、cs2＝0、d2u＝0以及ckv1＝0，因此第一晶体管m1、第二晶体管m2、第五晶体管m5、第七晶体管m7以及第八晶体管m8均截止。由于gsa＝1，因此第十九晶体管m19、第二十晶体管m20、第二十一晶体管m21均导通。导通的第十九晶体管m19将第二参考信号端v2的低电平信号提供给下拉节点n1，使下拉节点n1的信号为低电平信号，以控制第十晶体管m10与第十四晶体管m14截止。导通的第二十晶体管m20将第二参考信号端v2的低电平信号提供给上拉节点n2，使上拉节点n2的信号为低电平信号，以控制第九晶体管m9截止。导通的第二十一晶体管m21将第一参考信号端v1的高电平信号提供给输出信号端gout，使输出信号端gout输出高电平信号，以控制显示面板中的tft均打开，以控制像素电极释放电荷。
为了改善在t2阶段完成之后直接进行正常显示扫描时的大电流问题，设置了t3阶段。在t3阶段中，各时钟信号端的信号均变为低电平信号。由于u2d＝0，d2u＝0、ckv1＝0以及gas＝0，因此第四晶体管m4、第五晶体管m5、第六晶体管m6、第七晶体管m7、第八晶体管m8、第十九晶体管m19、第二十晶体管m20、第二十一晶体管m21均截止。由于cs1＝1且cs2＝1、因此第一晶体管m1与第二晶体管m2均导通，以将第一参考信号端v1的高电平信号提供给上拉节点n2，控制第九晶体管m9与第十三晶体管m13均导通。导通的第十三晶体管m13将第二参考信号端v2的低电平信号提供给下拉节点n1，以控制第十二晶体管m12以及第十晶体管m10截止。导通的第九晶体管m9将第三时钟信号端ckv3的低电平信号提供给输出信号端gout，使输出信号端gout输出低电平信号，从而将输出信号端gout的电平拉低。这样t3阶段之后再进行正常显示扫描时，可以使显示面板中的栅线保持为低电平信号，使得移位寄存器单元的第一输入信号端inf与第二输入信号端inb输入的信号可以为低电平信号，从而在正向扫描且在第一输入信号端inf的有效脉冲信号未出现时，可以控制第十三晶体管m13截止。同理，在反向扫描且在第二输入信号端inb的有效脉冲信号未出现时，可以控制第十三晶体管m13截止。进而可以改善第一参考信号端v1与第二参考信号端v2直接导通而造成的低大电流问题。
进一步地，为了提高移位寄存器单元的稳定性，在t3阶段之后还可以将下拉节点n1的信号设置为高电平信号，将上拉节点n2的信号设置为低电平信号。具体地，在t4阶段中，各时钟信号端的信号均变为高电平信号。并且，由于cs1＝0、cs2＝0、d2u＝0以及gsa＝0，因此第一晶体管m1、第二晶体管m2、第五晶体管m5、第七晶体管m7、第十九晶体管m19、第二十晶体管m20、第二十一晶体管m21均截止。由于u2d＝1，因此第四晶体管m4与第六晶体管m6均导通。导通的第六晶体管m6将第一时钟信号端ckv1的高电平信号提供给第八晶体管m8的栅极，控制第八晶体管m8导通以将第一参考信号端v1的高电平信号提供给下拉节点n1，使下拉节点n1的信号为高电平信号，以控制第十晶体管m10与第十四晶体管m14导通。导通的第十晶体管m10使输出信号端gout输出低电平信号。导通的第十四晶体管m14将第二参考信号端v2的低电平信号提供给上拉节点n2，使上拉节点n2的信号为低电平信号，以控制第九晶体管m9截止。导通的第四晶体管m4将第一输入信号端inf的低电平信号提供给上拉节点n2，进一步使上拉节点n2的信号为低电平信号。
在t4阶段之后，可以控制移位寄存器单元直接进行正常扫描驱动，其工作可以参见t1阶段的工作过程，在此不作赘述。
在反向扫描时，正扫控制信号端u2d与反扫控制信号端d2u的信号相反，并且第二时钟信号端ckv2的信号可以对应设置，其具体工作过程参见上述正向扫描的工作过程，在此不作赘述。
实施例六、
本发明实施例六提供的移位寄存器单元与实施例五提供的移位寄存器单元相同的部分在此不再赘述，下面只说明不同的部分。在具体实施时，本发明实施例提供的移位寄存器单元中的放电控制电路的具体结构也可以采用其他实施方式。在本发明实施例中，如图14所示，放电控制电路5也可以包括：第三晶体管m3；其中，第三晶体管m3的栅极与放电控制信号端cs耦接，第三晶体管m3的第一极与第一参考信号端v1耦接，第三晶体管m3的第二极与上拉节点n2耦接。
通过实施例五可知，第一子放电控制信号端cs1和第二子放电控制信号端cs2的信号可以相同，因此实施例六中的放电控制信号端cs可以采用第一子放电控制信号端cs1和第二子放电控制信号端cs2中的一个信号端的信号即可。图14所示的移位寄存器单元的工作过程可以参见实施例五中的移位寄存器单元的工作过程，在此不作赘述。
实施例七、
本发明实施例七提供的移位寄存器单元与实施例一和实施例二提供的移位寄存器单元相同的部分在此不再赘述，下面只说明不同的部分。在具体实施时，本发明实施例提供的移位寄存器单元中的放电控制电路5也可以与下拉节点n1耦接。
具体地，在具体实施时，如图15所示，放电控制信号端cs可以包括：第一子放电控制信号端cs1和第二子放电控制信号端cs2；放电控制电路5可以包括：第一晶体管m1与第二晶体管m2；其中，第一晶体管m1的栅极与第一子放电控制信号端cs1耦接，第一晶体管m1的第一极与下拉节点n1耦接，第一晶体管m1的第二极与第二晶体管m2的第一极耦接；第二晶体管m2的栅极与第二子放电控制信号端cs2耦接，第二晶体管m2的第二极与第一参考信号端v1耦接。
图15所示的移位寄存器单元采用的时序图可以如图6所示。并且，实施例七提供的移位寄存器单元与实施例二提供的移位寄存器单元的工作过程相类似，相同的部分在此不再赘述，下面只说明不同的部分。在t3阶段中，各时钟信号端的信号均变为低电平信号。由于d2u＝0、ckv1＝0、ckv4＝0以及gas＝0，因此第五晶体管m5、第七晶体管m7、第八晶体管m8、第十八晶体管m18、第十六晶体管m16、第十九晶体管m19、第二十晶体管m20、第二十一晶体管m21均截止。由于cs1＝1且cs2＝1、因此第一晶体管m1与第二晶体管m2均导通，以将第一参考信号端v1的高电平信号提供给下拉节点n1，从而控制第十晶体管m10与第十四晶体管m14导通。导通的第十四晶体管m14将第二参考信号端v2的低电平信号提供给上拉节点n2，使上拉节点n2的信号为低电平信号，以控制第九晶体管m9以及第十七晶体管m17截止。导通的第十晶体管m10将第二参考信号端v2的低电平信号提供给输出信号端gout，使输出信号端gout输出低电平信号，从而将输出信号端gout的电平拉低。
由于在t3阶段中，已经使上拉节点n2的信号为低电平信号，以及使下拉节点n1的信号为高电平信号，因此，可以不用设置图6中的t4阶段，而可以控制移位寄存器单元直接进行正常扫描驱动，其工作可以参见t1阶段的工作过程，在此不作赘述。这样可以降低消耗的时间。
实施例八、
本发明实施例八提供的移位寄存器单元与实施例七提供的移位寄存器单元相同的部分在此不再赘述，下面只说明不同的部分。
为了减少信号线的设置，节省信号端口数量，节省布线空间，进一步地，在具体实施时，可以将第一子放电控制信号端与正扫控制信号端设置为同一信号端，以及将第二子放电控制信号端与反扫控制信号端设置为同一信号端。具体地，如图16所示，第一晶体管m1的栅极、第四晶体管m4的栅极以及第六晶体管m6的栅极均与正扫控制信号端u2d耦接。第二晶体管m2的栅极、第五晶体管m5的栅极以及第七晶体管m7的栅极均与反扫控制信号端d2u耦接。
图16所示的移位寄存器单元采用的时序图可以如图9所示。并且，实施例八提供的移位寄存器单元与实施例七提供的移位寄存器单元的工作过程相类似，相同的部分在此不再赘述，下面只说明不同的部分。
在t1与t2阶段中，由于u2d＝1，因此第一晶体管m1导通，但是由于d2u＝0，因此第二晶体管m2截止。因此第一晶体管m1与第二晶体管m2不能将第一参考信号端v1的高电平信号提供给下拉节点n1。在t3阶段中，由于u2d＝1，因此第一晶体管m1导通，并且d2u＝1，因此第二晶体管m2导通，从而可以将第一参考信号端v1的高电平信号提供给下拉节点n1，从而控制第十晶体管m10与第十四晶体管m14导通。导通的第十四晶体管m14将第二参考信号端v2的低电平信号提供给上拉节点n2，使上拉节点n2的信号为低电平信号，以控制第九晶体管m9以及第十七晶体管m17截止。导通的第十晶体管m10将第二参考信号端v2的低电平信号提供给输出信号端gout，使输出信号端gout输出低电平信号，从而将输出信号端gout的电平拉低。
实施例九、
本发明实施例九提供的移位寄存器单元与实施例七提供的移位寄存器单元相同的部分在此不再赘述，下面只说明不同的部分。
在具体实施时，放电控制电路的具体结构也可以采用其他实施方式。在本发明实施例中，如图17所示，放电控制电路5也可以包括：第三晶体管m3；其中，第三晶体管m3的栅极与放电控制信号端cs耦接，第三晶体管m3的第一极与第一参考信号端v1耦接，第三晶体管m3的第二极与下拉节点n1耦接。
图17所示的移位寄存器单元采用的时序图可以如图11所示。并且，实施例九提供的移位寄存器单元与实施例四提供的移位寄存器单元的工作过程相类似，相同的部分在此不再赘述，下面只说明不同的部分。在t1与t2阶段中，由于cs＝0，因此第三晶体管m3截止。在t3阶段中，由于cs＝1，因此第三晶体管m3，从而可以将第一参考信号端v1的高电平信号提供给下拉节点n1，从而控制第十晶体管m10与第十四晶体管m14导通。导通的第十四晶体管m14将第二参考信号端v2的低电平信号提供给上拉节点n2，使上拉节点n2的信号为低电平信号，以控制第九晶体管m9以及第十七晶体管m17截止。导通的第十晶体管m10将第二参考信号端v2的低电平信号提供给输出信号端gout，使输出信号端gout输出低电平信号，从而将输出信号端gout的电平拉低。
实施例十、
本发明实施例十提供的移位寄存器单元与实施例七提供的移位寄存器单元相同的部分在此不再赘述，下面只说明不同的部分。在具体实施时，本发明实施例提供的移位寄存器单元中的节点控制电路也可以采用其他具体实施方式。具体地，如图18所示，节点控制电路3具体也可以包括：第十二晶体管m12与第十三晶体管m13；其中，第十二晶体管m12的栅极与下拉节点n1耦接，第十二晶体管m12的第一极与第二参考信号端v2耦接，第十二晶体管m12的第二极分别与第十三晶体管m13的栅极以及上拉节点n2耦接；第十三晶体管m13的栅极用于接收扫描控制电路1输出的信号，第十三晶体管m13的第一极与第二参考信号端v2耦接，第十三晶体管m13的第二极与下拉节点n1耦接。其中，第十三晶体管m13的栅极与第十二晶体管m12的第二极均与第四晶体管m4的第二极以及第五晶体管m5的第二极耦接。
图18所示的移位寄存器单元采用的时序图可以如图13所示。并且，实施例十提供的移位寄存器单元与实施例五提供的移位寄存器单元的工作过程相类似，相同的部分在此不再赘述，下面只说明不同的部分。在t3阶段中，各时钟信号端的信号均变为低电平信号。由于u2d＝0、d2u＝0以及gas＝0，因此第四晶体管m4、第五晶体管m5、第六晶体管m6、第七晶体管m7、第十九晶体管m19、第二十晶体管m20、第二十一晶体管m21均截止。由于cs1＝1且cs2＝1、因此第一晶体管m1与第二晶体管m2均导通，以将第一参考信号端v1的高电平信号提供给下拉节点n1，使下拉节点n1的信号为高电平信号，从而控制第十晶体管m10与第十二晶体管m12导通。导通的第十二晶体管m12将第二参考信号端v2的低电平信号提供给上拉节点n2，使上拉节点n2的信号为低电平信号，以控制第九晶体管m9以及第十三晶体管m13截止。导通的第十晶体管m10将第二参考信号端v2的低电平信号提供给输出信号端gout，使输出信号端gout输出低电平信号，从而将输出信号端gout的电平拉低。
实施例十一、
本发明实施例十一提供的移位寄存器单元与实施例十提供的移位寄存器单元相同的部分在此不再赘述，下面只说明不同的部分。
为了减少信号线的设置，节省信号端口数量，节省布线空间，进一步地，在具体实施时，可以将第一子放电控制信号端与正扫控制信号端设置为同一信号端，以及将第二子放电控制信号端与反扫控制信号端设置为同一信号端。具体地，如图19所示，第一晶体管m1的栅极、第四晶体管m4的栅极以及第六晶体管m6的栅极均与正扫控制信号端u2d耦接。第二晶体管m2的栅极、第五晶体管m5的栅极以及第七晶体管m7的栅极均与反扫控制信号端d2u耦接。
图19所示的移位寄存器单元采用的时序图可以如图21所示。并且，实施例十一提供的移位寄存器单元与实施例十提供的移位寄存器单元的工作过程相类似，相同的部分在此不再赘述，下面只说明不同的部分。
在t3阶段中，由于gas＝0，因此第十九晶体管m19、第二十晶体管m20、第二十一晶体管m21均截止。由于u2d＝1，因此第四晶体管m4、第六晶体管m6以及第一晶体管m1均导通。由于d2u＝1，因此第五晶体管m5、第七晶体管m7以及第二晶体管m2均导通。由于第六晶体管m6与第七晶体管m7导通，可以将时钟信号端的低电平信号提供给第八晶体管m8，控制第八晶体管m8截止。由于第一晶体管m1与第二晶体管m2均导通，可以将第一参考信号端v1的高电平信号提供给下拉节点n1，使下拉节点n1的信号为高电平信号，从而控制第十晶体管m10与第十二晶体管m12导通。导通的第十二晶体管m12将第二参考信号端v2的低电平信号提供给上拉节点n2，使上拉节点n2的信号为低电平信号，以控制第九晶体管m9以及第十三晶体管m13截止。导通的第十晶体管m10将第二参考信号端v2的低电平信号提供给输出信号端gout，使输出信号端gout输出低电平信号，从而将输出信号端gout的电平拉低。
实施例十二、
本发明实施例十二提供的移位寄存器单元与实施例十提供的移位寄存器单元相同的部分在此不再赘述，下面只说明不同的部分。
在具体实施时，放电控制电路的具体结构也可以采用其他实施方式。在本发明实施例中，如图20所示，放电控制电路5也可以包括：第三晶体管m3；其中，第三晶体管m3的栅极与放电控制信号端cs耦接，第三晶体管m3的第一极与第一参考信号端v1耦接，第三晶体管m3的第二极与下拉节点n1耦接。
图20所示的移位寄存器单元的放电控制信号端cs可以采用图6所示的第一子放电控制信号端cs1或第二子放电控制信号端cs2中的一个信号端的信号。并且，实施例十一提供的移位寄存器单元与实施例十提供的移位寄存器单元的工作过程相类似，相同的部分在此不再赘述，下面只说明不同的部分。在t1与t2阶段中，由于cs＝0，因此第三晶体管m3截止。在t3阶段中，由于cs＝1，因此第三晶体管m3导通，以将第一参考信号端v1的高电平信号提供给下拉节点n1，从而控制第十晶体管m10与第十四晶体管m14导通。导通的第十四晶体管m14将第二参考信号端v2的低电平信号提供给上拉节点n2，使上拉节点n2的信号为低电平信号，以控制第九晶体管m9以及第十七晶体管m17截止。导通的第十晶体管m10将第二参考信号端v2的低电平信号提供给输出信号端gout，使输出信号端gout输出低电平信号，从而将输出信号端gout的电平拉低。
本发明实施例仅是以移位寄存器单元中的晶体管为n型晶体管为例进行说明的，对于晶体管为p型晶体管的情况，设计原理与本发明相同，也属于本发明保护的范围。
基于同一发明构思，本发明实施例还提供一种栅极驱动电路，如图22所示，可以包括：级联的n个本发明实施例提供的移位寄存器单元；其中，n为大于1的整数。
具体地，在栅极驱动电路中，如图22所示，第1级移位寄存器单元sr(1)的第一输入信号端inf与正扫帧触发信号端stvf耦接；除第1级移位寄存器单元sr(1)之外，第n级移位寄存器单元sr(n)的第一输入信号端inf与第n-1级移位寄存器单元sr(n-1)的输出信号端gout耦接；第n级移位寄存器单元sr(n)的第一输入信号端inf与第n-1级移位寄存器单元sr(n-1)的输出信号端gout耦接；其中，n为大于或等于1且小于或等于n-1的整数。这样可以实现正向扫描驱动。
或者，在栅极驱动电路中，如图22所示，第n级移位寄存器单元sr(n)的第二输入信号端inb与反扫帧触发信号端stvb耦接；除第n级移位寄存器单元sr(n)之外，第n级移位寄存器单元sr(n)的第二输入信号端inb与第n+1级移位寄存器单元sr(n+1)的输出信号端gout耦接；第1级移位寄存器单元sr(1)的第二输入信号端inb与第2级移位寄存器单元sr(2)的输出信号端gout耦接。这样可以实现反向扫描驱动。
进一步地，为了可以在正向扫描和反向扫描驱动两种模式下进行切换，在具体实施时，如图22所示，第1级移位寄存器单元sr(1)的第一输入信号端inf与正扫帧触发信号端stvf耦接；除第1级移位寄存器单元sr(1)之外，第n级移位寄存器单元sr(n)的第一输入信号端inf与第n-1级移位寄存器单元sr(n-1)的输出信号端gout耦接；第n级移位寄存器单元sr(n)的第一输入信号端inf与第n-1级移位寄存器单元sr(n-1)的输出信号端gout耦接。并且，第n级移位寄存器单元sr(n)的第二输入信号端inb与反扫帧触发信号端stvb耦接；除第n级移位寄存器单元sr(n)之外，第n级移位寄存器单元sr(n)的第二输入信号端inb与第n+1级移位寄存器单元sr(n+1)的输出信号端gout耦接；第1级移位寄存器单元sr(1)的第二输入信号端inb与第2级移位寄存器单元sr(2)的输出信号端gout耦接。这样可以在正向扫描与反向扫描之间进行切换。
具体地，上述栅极驱动电路中的每个移位寄存器单元的具体结构与本发明上述移位寄存器单元在功能和结构上均相同，重复之处不再赘述。
在具体实施时，在本发明实施例提供的移位寄存器单元中的节点控制电路包括第十四晶体管、第十五晶体管以及第十六晶体管时，在本发明实施例提供的栅极驱动电路中，第2k-1级移位寄存器单元的第一时钟信号端ckv1与第2k级移位寄存器单元的第二时钟信号端ckv2均与同一时钟线，即第一时钟线ck1耦接，第2k-1级移位寄存器单元的第二时钟信号端ckv2与第2k级移位寄存器单元的第一时钟信号端ckv1均与同一时钟线，即第二时钟线ck2耦接，第2k-1级移位寄存器单元的第三时钟信号端ckv3与第2k级移位寄存器单元的第四时钟信号端ckv4均与同一时钟线，即第三时钟线ck3耦接，第2k-1级移位寄存器单元的第四时钟信号端ckv4与第2k级移位寄存器单元的第三时钟信号端ckv3均与同一时钟线，即第四时钟线ck4耦接；其中，k为正整数。在实际应用中，通过向第一时钟线ck1、第二时钟线ck2、第三时钟线ck3以及第四时钟线ck4分别输入相应的时钟信号，以控制各级移位寄存器单元进行正向扫描或反向扫描。
在具体实施时，在本发明实施例提供的移位寄存器单元中的节点控制电路包括第十二晶体管与第十三晶体管时，在本发明实施例提供的栅极驱动电路中，第4k-3级移位寄存器单元的第一时钟信号端ckv1、第4k-2级移位寄存器单元的第三时钟信号端ckv3、第4k-1级移位寄存器单元的第二时钟信号端ckv2均与同一时钟线，即第一时钟线ck1耦接。第4k-3级移位寄存器单元的第二时钟信号端ckv2、第4k-1级移位寄存器单元的第一时钟信号端ckv1、第4k级移位寄存器单元的第三时钟信号端ckv3均与同一时钟线，即第二时钟线ck2耦接。第4k-3级移位寄存器单元的第三时钟信号端ckv3、第4k-2级移位寄存器单元的第二时钟信号端ckv2、第4k级移位寄存器单元的第一时钟信号端ckv1均与同一时钟线，即第三时钟线ck3耦接。第4k-2级移位寄存器单元的第二一时钟信号端ckv1、第4k-1级移位寄存器单元的第三时钟信号端ckv3、第4k级移位寄存器单元的第二时钟信号端ckv2均与同一时钟线，即第四时钟线ck4耦接。在实际应用中，通过向第一时钟线ck1、第二时钟线ck2、第三时钟线ck3以及第四时钟线ck4分别输入相应的时钟信号，以控制各级移位寄存器单元进行正向扫描或反向扫描。
基于同一发明构思，本发明实施例还提供了一种显示面板，包括本发明实施例提供的栅极驱动电路。该显示面板解决问题的原理与前述移位寄存器单元相似，因此该显示面板的实施可以参见前述移位寄存器单元的实施，重复之处在此不再赘述。
在具体实施时，在本发明实施中，显示面板可以包括2个栅极驱动电路；其中，1个栅极驱动电路连接显示面板中的奇数行的栅线，另1个栅极驱动电路连接显示面板中的偶数行的栅线。这样在本发明实施例提供的移位寄存器单元中的节点控制电路包括第十四晶体管、第十五晶体管以及第十六晶体管时，通过设置输入各移位寄存器单元中的信号的时序，可以使显示面板中相邻两条栅线上的信号之间无间隔无交叠。在本发明实施例提供的移位寄存器单元中的节点控制电路包括第十二晶体管与第十三晶体管时，通过设置输入各移位寄存器单元中的信号的时序，可以使显示面板中的相邻两行的栅线上的信号具有交叠。
在具体实施时，显示面板可以包括栅极驱动电路；其中，栅极驱动电路中的一个移位寄存器单元连接显示面板中的一条栅线。具体地，栅极驱动电路可以为1个；其中，栅极驱动电路中的一个移位寄存器单元连接显示面板中的一条栅线。当然，栅极驱动电路也可以为2个；其中，各栅极驱动电路中的一个移位寄存器单元连接显示面板中的一条栅线，并且这2个栅极驱动电路中的同一级的移位寄存器单元连接同一条栅线。并且通过设置输入各移位寄存器单元中的信号的时序，可以使显示面板中的栅线实现逐行扫描驱动。这样在本发明实施例提供的移位寄存器单元中的节点控制电路包括第十四晶体管、第十五晶体管以及第十六晶体管时，通过设置输入各移位寄存器单元中的信号的时序，可以使显示面板中的相邻两条栅线上的信号之间间隔1/4时钟周期。在本发明实施例提供的移位寄存器单元中的节点控制电路包括第十二晶体管与第十三晶体管时，通过设置输入各移位寄存器单元中的信号的时序，可以使显示面板中的相邻两行的栅线上的信号之间无间隔无交叠。
基于同一发明构思，本发明实施例还提供了一种显示装置，包括本发明实施例提供的上述显示面板。该显示装置解决问题的原理与前述显示面板相似，因此该显示装置的实施可以参见前述显示面板的实施，重复之处在此不再赘述。
在具体实施时，本发明实施例提供的显示装置可以为全面屏的手机。当然，本发明实施例提供的显示装置可也以为：平板电脑、电视机、显示器、笔记本电脑、数码相框、导航仪等任何具有显示功能的产品或部件。对于该显示装置的其它必不可少的组成部分均为本领域的普通技术人员应该理解具有的，在此不做赘述，也不应作为对本发明的限制。
显然，本领域的技术人员可以对本发明进行各种改动和变型而不脱离本发明的精神和范围。这样，倘若本发明的这些修改和变型属于本发明权利要求及其等同技术的范围之内，则本发明也意图包含这些改动和变型在内。