高压栅极驱动电流源的制作方法

本发明一般涉及电子电路，更具体地涉及高压栅极驱动电流源。

背景技术：

usbc型是通用串行总线标准，其能够在电源装置(例如移动计算机，例如膝上型计算机或笔记本计算机)与功率吸收器装置(例如移动电话)之间进行可逆的插头定向和电缆方向。在所述标准下，电源装置可以动态管理0.5安培至3.0安培的电流。usb功率输送(pd)是使用usb-c标准和电缆的单线协议。usbc型端口既可以充当向所连接的装置(例如移动电话)输送功率的电源，也可以充当从所连接的装置(例如电池)传输功率的电流吸收器。pd协商允许装置在当前电池情况下约定输送最佳功率电平。协议扩展了usb以输送高达100瓦的功率(即，5安培时20伏)。

技术实现要素：

在一个实例中，电力供应系统包含功率fet控制器中的电流源驱动电路，以控制功率fet的栅极，从而调节功率输入和功率输出之间的功率的供应。电流源驱动电路包含共源共栅电流源，所述共源共栅电流源具有在上级和下级之间的共源共栅节点；以及共源共栅保护电路，其对共源共栅节点处的电压进行采样，并且自适应地改变到下级的栅极的电压，并且自动地将下级配置成源极跟随器，并且在需要限制功率输入和功率输出之间的电流的过电流情况期间使下级置于饱和状态。

在另一实例中，供应功率的方法包含利用共源共栅电流源向功率fet的栅极供应电流，以通过具有输出的功率路径来调节功率。所述方法通过检测通过功率路径的电流超过预定电流限制阈值而继续。基于此检测，当通过功率路径的电流未超过预定电流限制阈值时，功率fet的栅极被下拉，即，下拉到低于栅极在运行期间将经历的电压。所述方法通过偏置共源共栅电流源的下级以在饱和状态下继续，从而增加了共源共栅电流源到功率fet的栅极的输出阻抗，并且增加了共源共栅电流源的电流精度。

在又一实例中，电路包含高压功率路径和电压总线节点之间的功率fet以调节其间的功率传输。电流源向电流镜的一侧提供偏置电流。共源共栅电流源在电流镜的另一侧包括上级和下级。上级的源极连接到电荷泵电压节点，下级的漏极连接到功率fet栅极。反馈晶体管的栅极位于共源共栅的中间节点(上级和下级之间)，其漏极位于电荷泵节点。第一和第二反馈电阻器布置为电压分压器，所述分压器具有上节点、分压器节点和下节点，所述上节点连接到反馈晶体管的源极，所述分压器节点连接到共源共栅电流源的下级的栅极，所述下节点连接到功率fet的漏极。

附图说明

图1是实例电力供应系统的系统图。

图2是实例电力供应电路的电路图。

图3是另一实例电力供应电路的电路图。

图4是示出调节电力供应中的功率的实例方法的流程图。

图5是示出调节电力供应中的功率的实例方法的流程图。

具体实施方式

usb功率路径可以由内部/外部背对背功率fet和控制每个功率fet的栅极的控制器(即，用作栅极驱动器)组成。在实例实施例中，高压兼容电流镜包含低压装置。例如，电流镜在usbpd场效应晶体管(fet)控制器中是有用的，并且其有利地减少了掩模计数并且因此减少了芯片成本。

共源共栅保护电路可以保护高压兼容电流镜中的共源共栅电流源在通过导致电流限制电路下拉功率fet的栅极的功率路径的过电流情况期间不被|vgs|违反。共源共栅保护电路还允许共源共栅电流源中的晶体管装置为低压装置，即，额定vds不为40伏的装置，从而节省了由于在制作高压装置时需要超高压掩模而花费的制造成本。

共源共栅保护电路可以由例如源极跟随器电路和反馈电压分压器电路组成，所述反馈电压分压器电路被布置成对共源共栅电流源中的共源共栅节点处的电压进行采样，并且自适应地改变共源共栅电流源中的共源共栅的下级的栅极处的电压。源极跟随器电路可以由例如单个反馈晶体管组成，其栅极连接到共源共栅电流源的共源共栅节点，而电压分压器电路可以包括两个电阻，其被布置为反馈晶体管的源极和相关联的功率fet的漏极之间的电压分压器。当电压分压器的分压器节点连接到共源共栅电流源的下级的栅极时，共源共栅保护电路可以在共源共栅节点与分压器节点之间建立反馈回路以保护共源共栅装置并且在电流限制运行期间增强其作为共源共栅电流源的运行。此布置的结果是节省了超高压掩模并且减少了制造成本。

图1是示出电力供应系统100的系统图，电力供应系统100包含功率fet控制器102以控制功率fet104来调节从高压功率路径pphv106到电压总线vbus108的功率的供应，或反之亦然(如双向箭头106、108所指示)，并且限制沿此类路径106、108的电流。具有电压总线108的功率路径106可以用于例如经由usb连接，例如根据usbpd协议将功率供应到外围装置或从外围装置供应功率。

功率fet控制器102包含根据电荷泵电压vcp112和偏置电流114起作用的电流源驱动电路110，以调节到功率fet104的栅极所附接的栅极节点116的电流。可以布置栅极箝位电路118以对功率fet104施加恒定的最大栅极到源极电压(vgs)。为了调节到栅极116的电流，电流源驱动110可以包含向栅级116提供上拉电流(ipu)的共源共栅电流源120。共源共栅电流源120例如可以是较大共源共栅电流镜布置的一部分。

为了保护共源共栅电流源120中的装置并且确保电流源驱动110在正常和电流限制运行模式期间的正常功能，共源共栅保护电路122可以包含源极跟随器124和反馈电压分压器126，其可以对共源共栅电流源120中的共源共栅节点处的电压进行采样并且自适应地改变共源共栅电流源120中的共源共栅的下级的栅极处的电压。

电流限制电路128可以将功率路径电流与阈值进行比较，以帮助限制通过功率fet104的电流，从而限制通过功率路径106、108的电流。电流限制电路128由此可以通过基于比较而下拉栅极116来响应过电流情况，例如通过创建与由共源共栅电流源120供应的上拉电流(ipu)相反的下拉电流。

共源共栅电流源120可以由例如晶体管装置组成，例如被布置在具有上级(其源极节点连接到电荷泵电压节点112)和下级(其源极节点连接到上级的漏极节点)的共源共栅配置中的低功率fet(即，小于5伏的栅极-源极电压(vgs)可靠性限制，小于30伏的漏极-源极电压(vds)可靠性限制的fet)。源极跟随器124可以由例如反馈晶体管组成，所述反馈晶体管的栅极布置在共源共栅电流源120的中间节点(即，连接共源共栅的上级的漏极和共源共栅的下级的源极的节点)。反馈电压分压器126可以由例如布置为具有上节点、分压节点和下节点的分压器的反馈电阻组成，其中电压分压器126的上节点连接到反馈晶体管的源节点，电压分压器126的分压节点连接到共源共栅中的晶体管中的一个的栅极节点，电压分压器126的下节点连接到功率fet104的漏极节点，例如连接到布置中的公共漏极节点，所述布置可以使功率fet104与第二功率fet(图1中未展示)漏极到漏极地放置。

图2是可以用于例如usbpd应用的功率路径电路电流源拓扑200的电路图。电容器元件cout表示由例如在节点vbus处连接到总线的外围装置所呈现的负载，其中所述总线可以是usb功率总线。如箭头202所指示，功率路径电路200可以以源极模式运行，即，提供从系统侧高压功率路径节点pphv到外围侧总线电压节点vbus的电流。背对背功率fetmnp0、mnp1提供端口隔离。功率fetmnp0、mnp1的漏极连接在公共漏极节点cmdrn，其电压是pphv和vbus的最大值(如208处所指示)。

功率fetmnp0、mnp1各自由来自电荷泵vcp的共源共栅电流源组成的高压栅极驱动电路驱动。在所示电路200中，晶体管mp2、mp3一起形成功率fetmnp0的栅极驱动电路，而晶体管mp4、mp5一起形成功率fetmnp1的栅极驱动电路。每个共源共栅电流源向其相应的功率fet提供上拉电流ipu。通过在相应的功率fetmnp0或mnp1的栅极被充电之后引入充电电流ipu，栅极到源极箝位电路204、206各自保持相应的功率fetmnp0、mnp1的恒定最大栅极-源极电势差vgs。因此，在功率fetmnp0的情况下，栅极-源极电势差vgs是节点gate_sensefet和pphv处的电势差，而在功率fetmnp1的情况下，栅极-源极电势差vgs是节点gate_passfet和vbus处的电势差。电荷泵电压节点vcp具有来源于公共漏极电压cmdrn的输入和输入供应(未展示)，例如3.3伏的输入供应vdd_3p3，如以下等式所展示：

vcp＝cmdrn(max(pphv，vbus))+n*3.3v

其中n是电荷泵中的级数。

电荷泵电压vcp必须通过供应足够的栅极-源极电势差vgs足以向所有(a)功率fet供电；(b)共源共栅电流源所需的漏极到源极电压；以及(c)功率路径中的所有其它高压电路，如以下等式所展示：

vcp＝cmdrn(max(pphv，vbus))+vgs(mnp0)+vds(mp2)+vds(mp3)+加载导致电荷泵脱落

或，类似地，

vcp＝cmdrn(max(pphv，vbus))+vgs(mnp1)+vds(mp4)+vds(mp5)+加载导致电荷泵脱落

在实例应用中，例如其中通过设计，由栅极箝位(例如206)执行的功率fet(例如mnp1)的目标vgs为10伏或更高，电荷泵电压vcp可以保持在高于公共漏极电压cmdrn(即，pphv或vbus中的较大者)至少约10.3伏的电势。在此实例中，电荷泵应为n＝4级，使得电荷泵电压始终高于cmdrn至少约10.3伏。如果vcp高于此值1伏或2伏，则也可以接受。

功率fetmnp0、mnp1可以是高压mosfet，例如nexfet，其是具有非常低的漏极-源极导通电阻rdson以减少功率损耗的低成本竖直功率fet。例如，nextfet可以具有额定为20伏的最大栅极到源极电压(vgs)。在一些实例中，多芯片模块(mcm)用于使用nexfet工艺制造的共同封装nexfet管芯和使用不同工艺，例如单片工艺制造的控制器管芯，而在其它实例中，单独的nexfet组件和控制器组件被单独组装而不封装在mcm中。对于usbpd应用，pphv或vbus上的最大电压为24伏。

当将功率fet栅极到源极电压vgs(即，由栅极箝位206实施的目标vgs)选择为10伏时，则最小电荷泵电压vcp需要大于34伏以允许用于驱动器电流源装置(例如mp2、mp3、mp4、mp5)的余量。在一些实例中，电荷泵电压vcp可以上升到干线电压，例如36伏或更高。因此，如布置在拓扑200中，驱动器电流源装置(例如mp2、mp3、mp4、mp5)需要被额定为40伏vds，以适应潜在的大目标vgs值(例如10到20伏)。当在任何此类装置的漏极和源极之间放置40伏或更大的电势差时，额定vds不为40伏的装置可能遭受损坏或性能降低。40伏的漏极扩展pmos(depmos)装置构成了被额定为40伏vds的装置的一个实例。然而，40伏depmos装置在制造中花费超高压(hv)掩模，例如双扩散阱(dwell)掩模或p-埋层(pbl)掩模。

因此，电流源拓扑如图2中所展示，当用于驱动具有10伏或更大的，例如nexfet的vgs的功率fetmnp0、mnp1时具有某些限制。作为实例，图2电流源拓扑需要额外的hv掩模(例如40伏pbl掩模)，并且驱动器电流源装置mp2、mp3、mp4、mp5需要额定为40伏vds。此外，当在电流限制运行期间功率fet栅极节点gate_passfet被拉低以限制通过功率fetmnp0、mnp1的电流时，共源共栅装置mp4看到|vgs|违反(例如大于5伏的绝对值栅极-源极电压)。当在反向电流保护期间将功率fet栅极节点gate_sensefet被拉低以感测在源极模式期间vbus是否大于pphv并且因此关断mnp0时，共源共栅装置mp2看到类似的|vgs|违反。

因此，当限于使用低压装置用于其共源共栅电流源时，图2中所展示的栅极驱动拓扑200仅适合于驱动具有不大于5伏的栅极-源极电压vgs的内部功率fet，并且当功率fet的栅极-源极电压vgs被预期为大于5伏或具有大于5伏的电势时，不能用于此应用。

图3展示了用于usbpd功率路径中的高压(hv)nexfet栅极驱动器电路的电流源拓扑300。拓扑300与图2中的拓扑200共享许多公共的特征，但是在其共源共栅栅极驱动器的设计上不同，共源共栅栅极驱动器由共源共栅晶体管mp4、mp5、反馈晶体管mnf以及在图顶部的分压电阻器r1、r2组成。为了清楚地示出，仅展示了gate_passfet(mnp1)的电流源驱动器，而省略了gate_sensefet的电流源驱动器。拓扑300中的相同的共源共栅栅极驱动器也可以驱动mnp0的栅极(未展示)。例如，mp4、mp5可以是额定30伏vdsdepmos装置，其最小漏极到源极击穿电压(bvdss)额定为35伏。这些额定值是用于制造fet装置的工艺的函数。所示的拓扑300避免了对40伏hv掩模的需要。

反馈晶体管mnf和由电阻r1和r2形成的电压分压器形成共源共栅保护电路，其可以对应于图1中的共源共栅保护电路122。如图3中所示，共源共栅保护电路对共源共栅节点vy处的电压进行采样，并且自适应地改变到共源共栅节点的下级，即，在分压器节点vbp2处的栅极的电压，使得共源共栅的下级装置mp4的栅极-源极电压总是被保护不受|vgs|违反。此外，当共源共栅的下级装置的漏极，即，标记为gate_passfet的节点被例如电流限制电路拉低时，如在需要限制去往/来自vbus的通过功率路径的电流的过电流情况期间可能发生，共源共栅保护电路自动地配置下级晶体管mp4为源极跟随器，使共源共栅下级晶体管mp4置于饱和状态。共源共栅保护电路关闭反馈回路，以确保共源共栅节点vy稳定到vbp2加上mp4的vgs的值。

如箭头302所指示，功率路径电流300可以在源极模式下运行，即，提供系统侧高压功率路径节点pphv(在图3中省略)到外围侧总线电压节点vbus的电流。通过在对功率fetmnp1的栅极充电之后引入充电电流ipu，栅极到源极箝位电路306为功率fetmnp1维持恒定的栅极-源极电势差vgs(即，目标vgs)。

如下，反馈晶体管mnf和分压电阻器r1、r2可以被设计成使得拓扑300将永远不会遭受拓扑200中固有的|vgs|违反问题。反馈晶体管mnf作为源极跟随器运行。反馈晶体管mnf和由反馈电阻器r1和r2组成的电压分压器基于功率fet栅极节点gate_passfet处的电压来设定节点vx处的电压并且因此设定节点vbp2处的电压，使得mp4和mp5始终在其栅极-源极电压vgs(例如小于5伏)和漏极-源极电压vds(例如小于30伏)的可靠性限制内运行。

电路300可以具有几种运行模式，其包含当在pphv-vbus功率路径上提供低于阈值电流的功率时的“正常运行”模式，以及当在功率路径上消耗超阈值电流时引起电流限制电路310(例如电流限制放大器)限制通过功率fetmnp1并且因此通过pphv-vbus功率路径的电流的“电流限制运行”模式。拓扑300的共源共栅栅极驱动器电路能够在模式之间转换时自动地保护装置mp4、mp5并且确保没有|vgs|违反。

在拓扑300的正常运行期间，即，在提供低于预定阈值电流的电流以使得不触发过电流情况的运行期间，电流源晶体管mp5在饱和状态下运行，而mp4在其线性区域运行，作为功率fet栅极节点gate_passfet处的电压处于或接近功率fetmnp1的全部指定的栅极-源极电压vgs(例如gate_passfet＝vbus+10伏)。这是因为，如下面的等式所示，(a)电荷泵电压vcp是满载的，并且其最小电压约为vbus+10.3伏，并且(b)gate_passfet＝vbus+10伏，没有为处于饱和状态的mp4留下余量。mp5的大小可以以具有更长的沟道长度，以用于更大的电流镜精度。例如，mp5的大小可以为具有最小沟道长度的至少五倍的沟道长度(即，lmp5>5*lmin)。在下面的等式中，阈值电压vthp是当在mosfet的漏极与源极之间施加电压时引起电流流动的最小栅极到源极电压，vsdmp4是晶体管mp4的源极-漏极电压，vgsmnf是晶体管mnf的栅极-源极电压，并且其它节点的电压如图3中所标记。

假设pphv＝24v，|vthp|≈1v，gatepassfet＝vbus+10v，

假设vsdmp4>0.5v为饱和状态，则vy＝vbus+10.5v

vx＝vy-vgsmnf≈vy-1v

vsdmp4>vy-vbp2-vthp

因此mp4在线性区域。

即使将饱和阈值取为0.3伏，也同样不能满足以上不等式，正如在以上分析中一样，因为0.3伏不大于2.375伏，就像0.5伏不大于2.375伏。

电荷泵电压vcp的任何增加都受到面积和工艺可靠性规范的限制，因为这将增加衬底的漏极/源极隔绝电压到大于35伏并且影响装置的可靠性。对于当最大总线电压vbus为24伏并且由栅极箝位306实施的目标功率fetvgs为10伏时的情况，则cmdrn为24伏，gate_passfet为34伏，vbp2为30.75伏，vx为33伏，共源共栅节点vy为34伏，mp5在其饱和区运行，而mp4在其线性区运行。

在电流限制运行期间，功率fet的栅极，即，图3中所示实例中的mnp1由电流限制电路310拉低(例如接近1伏，例如在0.5伏和1.5伏之间)以限制通过功率fetmnp1的电流。因此，下级装置mp4的漏极也将被拉低，因为此类漏极节点是与功率fet的栅极相同的节点，即，图3中所示实例中的gate_passfet。因此，在上级装置mp5的源极和下级装置mp4的漏极之间存在大的电压差，导致用于mp4的大的vds，使得mp4进入饱和状态成为可能。由于电路300的布置，当mp4的漏极-源极电压vds增加时，共源共栅保护电路自动将mp4和mp5偏置在饱和状态，在电流限制期间提供较高的电流精度，并且向功率fetmnp1的栅极和电流限制电路310提供较高的输出阻抗。mp4作为源极跟随器运行，并且将共源共栅节点vy处的电压限定为分压器节点vbp2上方的一个下级vgs。

电流限制电路310感测功率fetmnp1的漏极-源极电压vds，并且当通过功率fet的电流高于预定电流阈值iref时，节流阀gate_passfet以限制通过功率fetmnp1的电流。作为实例，电流限制电路310可以对通过pphv-vbus功率路径的电流进行采样，所述功率路径电流采样值在图3中被标注为ipower_samp，并且将此采样的功率路径电流值与阈值电流值iref进行比较，其精确值是可编程的或可选择的。当ipower_samp超过iref阈值时，电流限制电路310开始下拉gate_passfet上的电压。

在此电流限制运行期间，共源共栅栅极驱动器自动向功率fetmnp1和电流限制电路310的栅极呈现较高的阻抗，从而提高了电流限制电路310的小信号稳定性。对于当最大总线电压vbus为24伏的情况，则cmrdn为24伏，gate_passfet为1伏，共源共栅节点vy为27伏，vx为大约26伏，vcp为34.4伏，并且mp4和mp5均在饱和区中运行。在此类实例中，反馈晶体管mnf的vgs大约是1伏(即，vx将比共源共栅节点vy小大约1伏)。在电流限制运行期间mp4在饱和区中运行如下所示：

vgsmnf≈1v

vy≈|vgsmp4|+vbp2

vy≈4*(6+1.5-0.75)v

vy≈27v，因此mp4处于饱和状态。

反馈电阻器r1和r2，其可以是例如polyvsr电阻器，可以经选择以使得共源共栅装置mp4、mp5具有其在其可靠性限制(例如小于5伏)内的|vgs|。“polyvsr”电阻器是具有非常高的薄层电阻(vsr)的多晶硅电阻器。polyvsr是可以具有比其它类型的电阻器更高的温度变化的低面积电阻器。然而，因为在电路300中以一定比率使用电阻，作为温度函数的电阻的任何此类绝对变化对电路运行没有实质影响。可以选择r1和r2，使得即使当vbus为0伏时，反馈比r2/(r1+r2)也足够大，以避免mp4上|vgs|违反。例如，反馈比可以大于5/9，例如3/4。例如，r1可以选择为2.25兆欧，而r2可以选择为6.77兆欧。下面的分析演示了挑选足够大的反馈比，例如3/4的背后的逻辑。如从以下分析可见，挑选太小例如1/2的反馈比会导致mp4的|vgs|违反。

选择r1和r2使得|vgsmp4|<5v

情况1:如果

vgsmnf≈1v

情况2:如果

图3的电路300在当使用高功率fet制造工艺(例如nexfet工艺)在一个ic上制造功率fetmnp0、mnp1，并且使用较低功率制造工艺在单独的控制器ic上制造所展示的各种其它fet组件时可以使用。例如，图3的电路300提供可靠的栅极驱动电路以驱动具有较高的栅极-源极电压vgs(即，vgs≥10v)的nexfet，并且克服了图2的电路的可靠性限制，同时节省了超高压工艺掩模(例如dwell或pbl掩模)，从而降低了usbpdic的成本。反馈晶体管mnf以及电阻器r1和r2基于功率fet(gate_sensefet，gate_passfet)的栅极处的电压而自动设定vx，并且因此自动设定共源共栅偏置vbp2，使得mp2、mp3、mp4和mp5始终在vgs(例如小于5伏)和vds(例如小于30伏)的过程可靠性限制中运行。mp4的栅极-源极电压vgs在正常运行期间受到保护，并且在电流限制运行期间ipu表现为非常良好的电流源。图3的电路300使用额定30伏vdsmosfet实现40伏功率fet控制器ic设计，使其与使用40伏工艺制造相比，制造成本更低。

图4是示出在电力供应中供应(或调节)功率的实例方法400的流程图。在方法400中，电流可以被供应402到功率fet的栅极，以通过具有输出的功率路径来调节功率。此电流例如可以由共源共栅电流源供应。所述方法继续到检测404通过功率路径的电流超过预定电流限制阈值。基于检测404，功率fet的栅极可以例如通过被布置成对通过功率路径的电流进行取样并且将其与阈值进行比较的电流限制电路被下拉406。方法400继续以检测408功率fet的栅极已经被下拉，并且共源共栅电流源的下级被偏置410以在饱和状态下运行，从而增加412共源共栅电流源到功率fet的栅极的输出阻抗，并且增加了414共源共栅电流源的电流精度。

偏置可以例如通过共源共栅保护电路来完成，其可以包含例如反馈晶体管和连接到共源共栅电流源的反馈电压分压器。功率fet的栅极电压的降低406可以基于通过功率路径的电流的采样值超过阈值电流。

共源共栅电流源的上级和下级可以是具有额定35伏的最小bvdss的额定30伏vdsdepmos装置。在一些实例中，这些额定vds不为40伏或更高。功率fet的栅极的电压电势可以比功率路径的输出的电压电势高至少10伏。电荷泵可以向共源共栅电流源供应高于功率fet的漏极的电压电势的电压。电荷泵的最小输出可以比功率路径输出的电压电势多至少10.3伏。

在电流限制运行期间，功率fet的栅极的电压电势可以被下拉406到大约1伏，例如在0.5与1.5伏之间。检测408功率fet的栅极被下拉可以涉及通过反馈共源共栅电流源的下级的源极和栅极之间的信号来感测共源共栅电流源的下级的vds的增加。此类反馈信号可以通过反馈晶体管和反馈电压分压器的上电阻设定，所述反馈电压分压器可以具有连接到反馈晶体管的上电阻r1、连接到功率fet的漏极的下电阻r2，并且可以选择电阻使得r2/(r1+r2)的反馈比大于5/9，例如大约3/4。如参考电压分压器电阻所使用的，术语“下”是指拓扑位置，而不是相对于电阻值的指示。

图5是示出在电力供应中供应(或调节)功率的实例方法500的流程图。在方法500中，电流被供应502到功率fet的栅极，以通过具有输出的功率路径来调节功率。此电流例如可以由共源共栅电流源供应。在提供小于预定电流限制阈值的通过功率路径的电流的正常运行期间，共源共栅电流源的上级晶体管在饱和状态下运行504，共源共栅电流源的下级晶体管在其线性区运行504。

在将通过功率路径的电流限制到预定电流限制阈值的电流限制运行期间，功率fet的栅极可以例如通过被布置成对通过功率路径到阈值的电流进行采样和比较的电流限制电路被拉低506，并且上级和下级晶体管被偏置508以在饱和状态下运行，从而向功率fet的栅极和电流限制电路呈现510较高的输出阻抗，并且提高512电流限制电路的小信号稳定性。偏置可以例如通过共源共栅保护电路来完成，其可以包含例如反馈晶体管和连接到共源共栅电流源的反馈电压分压器。在电流限制运行期间功率fet的栅极的电压的降低506可以基于通过功率路径的电流的采样值超过阈值电流。

在方法500中，共源共栅电流源的上级和下级晶体管可以是具有额定35伏的最小bvdss的额定30伏vdsdepmos装置，但在一些实例中额定不为40伏vds或更大。功率fet的栅极的电压电势可以比功率路径的输出的电压电势高至少10伏。电荷泵可以向共源共栅电流源供应高于功率fet的漏极的电压电势的电压。电荷泵的最小输出可以比功率路径输出的电压电势多至少10.3伏。

在方法500中，在正常运行期间，功率fet的栅极的电压电势可以是34伏或更高。电荷泵的电压电势可以是34.3伏或更高。公共漏极的电压电势可以是大约24伏，并且连接到上级晶体管的漏极和下级晶体管的源极的共源共栅电流源的中间节点的电压电势可以是大约34伏。在电流限制运行期间，功率fet的栅极的电压电势可以是大约1伏，例如在0.5与1.5伏之间，电荷泵的电压电势可以是大约34.3伏，公共漏极的电压电势可以是大约24伏，连接到上级晶体管的漏极和下级晶体管的源极的共源共栅电流源的中间节点的电压电势可以是大约27伏。

在方法500中，共源共栅电流源的下级晶体管的vds可以在电流限制运行期间增加以偏置上级和下级晶体管以在饱和状态下运行。反馈电压分压器可以具有连接到反馈晶体管的上电阻r1、连接到功率fet的漏极的下电阻r2，并且可以选择电阻使得r2/(r1+r2)的反馈比大于5/9，例如大约3/4。如参考电压分压器电阻所使用的，术语“下”是指拓扑位置，而不是相对于电阻值的指示。

在此说明书中，术语“基于”是指至少部分地基于。

在包含所附权利要求的本申请的范围内，在所描述的实例实施例中的修改是可能的，并且其它实施例是可能的。