用于在单指令多线程计算系统中加载数据的方法和装置与流程

1.本公开的实施例一般地涉及电子领域，更具体而言涉及一种用于在单指令多线程计算系统中加载数据的方法和装置。


背景技术：

2.对于常规的单指令多线程计算系统，每个线程有自己的寄存器堆(即寄存器的阵列，也称为寄存器文件)，并且每个线程可以在其寄存器与存储器之间进行线程级的数据交换。
3.目前，通常采用典型的寄存器存取架构(load-store architecture)来在寄存器与存储器之间进行数据交换。例如，可以利用加载(load)指令来从存储器读取数据并将数据存储到寄存器中。然而，常规的加载指令缺少针对多个线程进行数据交换的优化。因此，需要一种用于在单指令多线程计算系统中针对多个线程高效地加载数据的方案。


技术实现要素：

4.本公开的实施方式提供了一种在单指令多线程计算系统中加载数据的技术方案。
5.在第一方面，提供了一种在单指令多线程计算系统中加载数据的方法。该方法包括：基于接收到的单个加载指令，确定所述多个线程的多个谓词，每个谓词指示相应线程中所指定的地址是否有效，所述地址用于访问存储器中的数据；基于所确定的所述多个谓词，确定所述多个线程中的至少一个执行线程；针对所述至少一个执行线程中的每个执行线程，确定目标数据；以及将针对所述至少一个执行线程中的每个执行线程的所述目标数据的集合写入到所述多个线程中的每个目标线程的寄存器堆中。
6.在第二方面，提供了一种用于在单指令多线程计算系统中加载数据的装置。该装置包括：谓词确定单元，被配置为：基于接收到的单个加载指令，确定所述多个线程的多个谓词，每个谓词指示相应线程中所指定的地址是否有效，所述地址用于访问存储器中的数据；以及执行线程确定单元，被配置为基于所确定的所述多个谓词，确定所述多个线程中的至少一个执行线程；目标数据确定单元，被配置为针对所述至少一个执行线程中的每个执行线程，确定目标数据；以及写入单元，被配置为将针对所述至少一个执行线程中的每个执行线程的所述目标数据的集合写入到所述多个线程中的每个目标线程的寄存器堆中。
7.在第三方面，提供了一种计算机可读存储介质。该介质存储多个程序，多个程序被配置为一个或多个处理引擎执行，多个程序包括用于执行本公开的第一方面的方法的指令。
8.在第四方面，提供了一种计算机程序产品。该计算机程序产品包括多个程序，多个程序被配置为一个或多个处理引擎执行，多个程序包括用于执行本公开的第一方面的方法的指令。
9.利用本公开的示例性实现方式，可以基于单个加载指令来针对每个执行线程确定对应的目标数据并且向每个目标线程写入目标数据的集合。这样，可以提高在寄存器与存
储器之间进行数据交换的效率。
附图说明
10.通过结合附图对本公开示例性实施方式进行更详细的描述，本公开的上述以及其他目的、特征和优势将变得更加明显，其中，在本公开示例性实施方式中，相同的参考标号通常代表相同部件。
11.图1示出了本公开的多个实施方式能够在其中实现的示例环境的示意图；
12.图2示出了根据本公开的一个实施方式的芯片示意图；
13.图3示出了利用常规的加载指令来进行寄存器与存储器之间的数据交换的示意图；
14.图4示出了根据本公开的一个实施方式的加载数据的方法的流程图；
15.图5示出了根据本公开的一个实施方式的加载数据的结果的示意图；
16.图6a和图6b示出了根据本公开的一个实施方式的转置存储的示意图；
17.图7示出了根据本公开的一个实施方式的加载数据的过程的示意图；以及
18.图8示出了根据本公开的一个实施方式的用于加载数据的装置的示意框图。
具体实施方式
19.下面将参照附图更详细地描述本公开的优选实施方式。虽然附图中示出了本公开的优选实施方式，然而应该理解，本公开可以以各种形式实现而不应被这里阐述的实施方式限制。相反，提供这些实施方式是为了使本公开更加透彻和完整，并且能够将本公开的范围完整地传达给本领域的技术人员。
20.在本文中使用的术语“包括”及其变形表示开放性包括，即“包括但不限于”。除非特别申明，术语“或”表示“和/或”。术语“基于”表示“至少部分地基于”。术语“一个示例实施方式”和“一个实施方式”表示“至少一个示例实施方式”。术语“另一实施方式”表示“至少一个另外的实施方式”。术语“第一”、“第二”等等可以指代不同的或相同的对象。下文还可能包括其他明确的和隐含的定义。
21.首先参见图1描述用于执行本公开的多个示例性实现方式的环境的概要。图1示出了本公开的多个实施方式能够在其中实现的示例环境100的示意图。示例环境100例如可以包括诸如计算机之类的具有计算能力的电子设备。在一个实施方式中，示例环境100例如包括中央处理器(cpu)120、系统存储器110、北桥/存储器桥130、加速器系统140、外部存储设备150和南桥/输入输出(io)桥160。系统存储器110例如可以包括诸如动态随机存取存储器(dram)之类的易失性存储器。北桥/存储器桥130例如集成了内存控制器、pcie控制器等，其负责cpu 120和高速接口之间的数据交换以及桥接cpu 120和南桥/io桥160。南桥/io桥160用于计算机的低速接口，例如串行高级技术接口(sata)控制器等。加速器系统140例如可以包括诸如图形处理器(gpu)和人工智能(ai)加速器等用于对图形、视频等数据进行加速处理的装置或芯片。外部存储设备150例如可以是诸如dram之类的位于加速器系统140外部的易失性存储器。
22.在本公开中，外部存储设备150也被称为片外存储器，即，位于加速器系统140的芯片外部的存储器。相对而言，加速器系统140的芯片内部也具有易失性存储器，例如一级
(l1)高速缓存(cache)以及可选的二级(l2)高速缓存。将在下文结合本公开的一些实施方式具体描述。虽然在图1中示出了本公开的多个实施方式能够在其中实现的一种示例环境100，但是本公开不限于此。本公开的一些实施方式也可以在诸如arm架构和risc-v架构之类的具有诸如gpu之类的加速器系统的其他应用环境中使用。
23.图2示出了根据本公开的一个实施方式的加速器系统200的示意框图。加速器系统200例如可以是图1中加速器系统140的芯片的一种具体实现方式。加速器系统200例如包括诸如gpu之类的加速器系统芯片。根据本公开的一个示例性实现方式，加速器系统200可以包括流处理器(sp)210、页表装置220、处理引擎(processing engine，pe)单元230、直接存储器访问(dma)控制器240、l1高速缓存260和l2高速缓存250。
24.加速器系统200可以由诸如cpu 120之类的主机设备控制，并且接收来自cpu 120的指令。sp 210对来自cpu 120的指令进行分析，并且将经分析的操作指派给pe单元230、页表装置220和dma控制器240进行处理。页表装置220用于管理加速器系统200可访问的虚拟存储。在本公开中，除了l1高速缓存260，虚拟存储例如可以包括l2高速缓存250和诸如图1中的外部存储设备150之类的片外存储器。页表装置220由sp 210、pe单元230和dma控制器240共同维护。
25.pe单元230可以包括多个处理引擎pe_1、pe_2
……
pe_n，其中n表示大于1的整数。pe单元230中的每个pe可以是单指令多线程装置。在pe中，每个线程可以具有自己的寄存器堆，并且每个pe的所有线程还共享统一寄存器堆(uniform register file)。多个pe可以并行地执行相同或不同的处理工作。例如，pe可以针对待处理的数据执行排序、卷积等处理。
26.用户(例如，程序员)可以编写应用程序来实现特定的目的。对于需要较大计算量的应用程序而言，可以将该应用程序划分为多个部分，并且分别在多个pe处并行地运行多个部分。
27.进一步，可以在每个pe处启动一个或多个线程。每个线程可以具有自己的寄存器堆和执行单元，并使用自己的存储地址。执行单元可以包括一个支持多种数据类型的浮点/定点单元以及一个算数逻辑单元，以用于执行算术和逻辑运算。算术运算例如浮点和定点数的加、减、乘、除。逻辑运算例如逻辑与、或、非等。
28.如上所述，可以采用典型的寄存器存取架构来针对每个线程进行与存储器之间的数据交换。图3示出了利用常规的加载指令来进行寄存器与存储器之间的数据交换的示意图。如图3所示，pe 300中的线程310-1至310-n(统称为多个线程310)可以与存储器320进行数据交换。每个线程具有各自的寄存器堆，例如线程310-1具有寄存器堆330-1，线程310-2具有寄存器堆330-2，等等。每个线程还具有各自的数据通路，例如数据通路340-1至340-n(统称为数据通路340)。存储器320可以包括芯片内部的存储器(例如一级高速缓存、二级高速缓存)，也可以包括芯片外部的存储器。
29.在一些场景中，pe 300中的多个线程310需要从存储器320中的相同地址读取数据并且将所读取的相同数据加载到每个线程各自的寄存器中(该操作简称为广播加载)。例如，在执行矩阵乘法时，需要将a矩阵的每一行与b矩阵的同一列相乘，这就需要将b矩阵的同一列广播到用于处理矩阵a的每一行的每个线程。
30.在这样的场景中，如果利用常规的加载指令，需要每个线程指定相同的地址。然后，针对每个线程，可以基于该地址从存储器320读取数据并且将所读取的数据写入到线程
的寄存器中。换言之，该数据将被读取n次，也即该数据在寄存器与存储器320之间的数据通路340中将被复制n次。对相同数据的多次读取和复制降低了寄存器与存储器320之间的数据交换的效率并且增加了数据交换的功耗。
31.为了至少部分地解决已有技术方案的上述以及其他缺陷，根据本公开的一个示例性实现方式，提供了一种在单指令多线程计算系统中高效地加载数据的技术方案。在该方案中，基于接收到的单个加载指令，确定针对多个线程的多个谓词，每个谓词指示相应线程中所指定的地址是否有效，地址用于访问存储器中的数据；基于所确定的多个谓词，确定多个线程中的至少一个执行线程；针对至少一个执行线程中的每个执行线程，确定目标数据；以及将针对至少一个执行线程中的每个执行线程的目标数据的集合写入到多个线程中的每个目标线程的寄存器堆中。
32.以此方式，可以基于单个加载指令来针对每个执行线程确定对应的目标数据并且向每个目标线程写入目标数据的集合，也即分别与多个执行线程对应的多个目标数据，而无需针对每个执行线程多次读取相同的目标数据。这样，寄存器与存储器之间的数据交换的效率可以得到提高。
33.下文将参考图4至图6来详细描述本方案的细节。
34.图4示出了根据本公开的一个实施方式的加载数据的方法400的流程图。方法400可以被实现在包括多个线程的simt计算系统处，例如图3所示的pe 300处。具体地，可以由pe 300中用于与存储器320进行数据交换的输入输出模块(图3中未示出)来实现。
35.在框410处，基于接收到的单个加载指令，确定针对多个线程的多个谓词，每个谓词指示相应线程中所指定的地址是否有效，地址用于访问存储器中的数据。多个线程可以是pe 300中的部分或全部线程。例如，多个线程可以是由pe 300启动的部分线程。多个线程中的每个线程可以指定相应的谓词。例如，可以在线程的谓词寄存器中指定谓词的值。
36.谓词可以指示线程中所指定的用于访问存储器中的数据的地址是否有效。换言之，谓词可以指示是否能够基于线程中指定的地址而从存储器320读取数据。例如，当谓词的值为真时，可以基于线程中指定的地址来从存储器320读取数据。相反，当谓词的值为假时，可以将线程中指定的地址视为无效，也即，不基于该地址来读取存储器320中的数据。
37.在框420处，基于所确定的多个谓词，确定多个线程中的至少一个执行线程。执行线程是指要针对其确定待写入数据的线程。待写入数据是指要被写入到线程中的数据，也称为目标数据。可以基于谓词和预定规则来确定多个线程中的执行线程。
38.在一些实施例中，可以仅将谓词指示地址有效的线程确定为执行线程。例如，可以将谓词的值为真的线程确定为执行线程，并且将谓词的值为假的线程排除在执行线程之外。
39.备选地，可以将多个线程按编号排序为序列并且确定该序列中的目标子序列，目标子序列中的所有线程可以被确定为执行线程。目标子序列起始于序列中的起始线程(例如，线程310-1)，并且结束于序列中最后一个其谓词的值为真的线程。也即，多个线程中在目标子序列之后的剩余线程的谓词的值均为假。在这种实施例中，可以将所有谓词的值为真的线程以及部分谓词的值为假的线程确定为执行线程。
40.附加地，还可以基于其他规则来确定目标子序列。例如，可以规定目标子序列中的线程的数目是n的整数倍，其中n是大于等于1的整数。这样，目标子序列可以结束于最后一
个其谓词的值为真的线程之后的第1、2
……
或第n-1个线程。
41.在框430处，针对至少一个执行线程中的每个执行线程，确定目标数据。如上所述，目标数据是指要写入到线程中的数据。针对不同的执行线程，可以采用不同方法来确定对应的目标数据。
42.在一些实施例中，响应于执行线程的谓词指示地址有效，可以基于该地址从存储器320提取针对该执行线程的目标数据。相反，响应于执行线程的谓词指示地址无效，可以基于预定值来确定目标数据。例如，可以将目标数据确定为零。
43.在一些实施例中，不同的执行线程中指定不同的地址。在这种情况下，基于单个加载指令，可以从存储器320读取来自不同地址的多个目标数据，并且每个目标数据仅被读取一次。这样，可以提高多个线程的寄存器与存储器320之间的数据交换的效率。
44.在一些实施例中，可以基于加载指令，确定执行线程的寄存器堆中用于存储地址的地址寄存器，并且从该地址寄存器读取地址。基于该地址，可以从存储器320提取针对执行线程的目标数据。加载指令中可以包括用于标识地址寄存器的参数。例如，参数可以是地址寄存器在寄存器堆中的编号。
45.在一些实施例中，取决于加载指令，可以基于4字节或16字节的数据宽度来从存储器320提取目标数据。
46.在框440处，将针对至少一个执行线程中的每个执行线程的目标数据的集合写入到多个线程中的每个目标线程的寄存器堆中。目标线程是指多个线程中将被写入目标数据的集合的线程。
47.目标线程可以是多个线程中的一个或多个线程。目标线程也可以是多个线程中的每个线程。在一些实施例中，可以基于单个加载指令来确定目标线程。例如，可以基于加载指令的修饰符确定目标线程的编号。
48.目标数据的集合包括针对所有执行线程的目标数据。这样，基于单个加载指令，可以向每个目标线程写入更多的相同数据，从而提高从存储器320加载数据的效率。
49.在一些实施例中，在目标数据的集合中，目标数据按照与执行线程相同的顺序被排序。例如，目标数据可以按照对应的执行线程的编号而被排序。这样，在并行地针对每个执行线程确定目标数据时，可以使得多个目标数据按照一定顺序被写入到目标线程的寄存器中。
50.在一些实施例中，在将目标数据的集合写入到每个目标线程中时，可以将目标数据的集合写入到指定的寄存器中。指定的寄存器可以是基于各种预定规则确定的至少一个寄存器。
51.指定的寄存器可以是至少一个连续的寄存器，也即，在寄存器堆中这些寄存器的地址是连续的。指定的寄存器可以起始于目标寄存器。
52.在一些实施例中，可以基于加载指令来确定寄存器堆中的目标寄存器。例如，加载指令中可以包括用于标识目标寄存器的参数。例如，参数可以是目标寄存器在寄存器堆中的编号。
53.基于目标数据的集合的大小和每个寄存器的大小，可以将目标数据的集合写入到寄存器堆中起始于目标寄存器的至少一个连续的寄存器。
54.例如，如果一个执行线程指定16字节的目标数据，则8个执行线程可以指定8
×
16
＝128字节的目标数据的集合。在寄存器的宽度为4字节的情况，每个目标数据需要写入4个寄存器。可以将目标数据的集合按顺序写入到寄存器堆中的128/4＝32个寄存器中。应理解，如果目标数据的集合的数据大小超过了寄存器堆的大小，则可以将多余的数据丢弃。
55.图5示出了根据本公开的一个实施方式的加载数据的结果的示意图。图5示出了线程310-1、线程310-2、线程310-3、线程310-4以及存储器320。应理解，线程310-1、线程310-2、线程310-3、线程310-4仅是目标线程的示例，目标线程可以包括1个、2个、3个、4个或更多线程。如图5所示，每个线程可以包括谓词寄存器、地址寄存器和用于存储数据的数据寄存器。
56.以线程310-1为例，线程310-1的寄存器堆中可以包括用于存储谓词的值的谓词寄存器501-1、用于存储存储器数据的地址的地址寄存器502-1、以及数据寄存器503-1。数据寄存器503-1中可以包括目标寄存器504-1，其作为存储目标数据的起始寄存器。线程310-2、线程310-3和线程310-4的细节不再赘述。
57.如图5所示，在数据存取宽度与寄存器的数据宽度一致(例如，4字节)时，一个目标数据可以写入一个寄存器，并且目标数据可以基于对应的执行线程的编号按顺序被写入到每个目标线程的寄存器堆中。
58.具体地，响应于线程310-1中的谓词的值为真(t)并且所指定的地址为a，存储器320中地址a处的数据a’(记为数据520-1)可以作为目标数据被写入到每个目标线程中的第一寄存器，也即目标寄存器中。
59.响应于线程310-2中的谓词的值为真(t)并且所指定的地址为b，存储器320中地址b处的数据b’(记为数据520-2)可以作为目标数据被写入到每个目标线程中的第二寄存器中。
60.响应于线程310-3中的谓词的值为假(f)并且所指定的地址为c，存储器320中地址c处的数据c’(记为数据520-3)可以不被写入到每个目标线程中，并且可以将为零的目标数据写入到每个目标线程中的第三寄存器中。
61.响应于线程310-4中的谓词的值为真(t)并且所指定的地址为d，存储器320中地址d处的数据d’(记为数据520-4)可以作为目标数据被写入到每个目标线程中的第四寄存器中。
62.以此方式，基于单个加载指令，通过指定地址寄存器和目标寄存器，可以将相同的目标数据的集合写入到每个目标线程中，从而实现数据的广播加载，以提高寄存器与存储器320数据交换的效率。
63.在一些实施例中，在将目标数据的集合写入到线程中之前，可以转置目标数据的集合，并且将经转置的目标数据的集合写入到每个目标线程中(该操作也称为转置存储)。
64.在一些实施例中，可以按照单字节或双字节来对数据进行转置。图6a和图6b示出了根据本公开的一个实施方式的转置存储的示意图。应理解，类似于图5，线程310-1、线程310-2、线程310-3、线程310-4仅是目标线程的示例，目标线程可以包括1个、2个、3个、4个或更多线程。此外，在图6a和6b中假设要读取的数据a’、b’、c’和d’的大小为4字节，并且寄存器的大小也为4字节。
65.为了方便描述，数据a’可以拆分为数据a1、a2、a3、a4，并且a1、a2、a3、a4的大小为单个字节。类似地，数据b’和d’的细节不再赘述。因此，图5中所示的第一寄存器中写入的数据是
a1、a2、a3、a4；第二寄存器中写入的数据是b1、b2、b3、b4；第三寄存器中写入的数据是0、0、0、0；第四寄存器中写入的数据是d1、d2、d3、d4。
66.图6a示出了按照单字节来进行转置存储的示意图。如图6a所示，经过转置之后，第一寄存器中写入的数据是a1、b1、0、d1；第二寄存器中写入的数据是a2、b2、0、d2；第三寄存器中写入的数据是a3、b3、0、d3；第四寄存器中写入的数据是a4、b4、0、d4。
67.图6b示出了按照双字节来进行转置存储的示意图。如图6b所示，经过转置之后，第一寄存器中写入的数据是a1、a2、b1、b2；第二寄存器中写入的数据是a3、a4、b3、b4；第三寄存器中写入的数据是0、0、d1、d2；第四寄存器中写入的数据是0、0、d3、d4。
68.下文将参考图7和图8描述本公开的实施例的硬件实现。图7示出了根据本公开的一个实施方式的加载数据的过程的示意图。图7示出了谓词检查模块710、排序输入模块720、排序输出模块730和转置模块740。图7还示出了与多个线程310分别对应的多个缓冲器750-1、750-2至750-n(统称为缓冲器750)以及片外存储器760。缓冲器750和片外存储器760可以是存储器320中的一部分。
69.应理解，图7仅示出了从存储器320加载数据的示例，并非示出了数据交换的所有细节。例如，尽管未示出，每个线程中指定的地址可以通过地址总线传输到存储器320。
70.在一些实施例中，谓词检查模块710基于接收到的单个加载指令，确定多个线程310的多个谓词，每个谓词指示相应线程中所指定的地址是否有效，地址用于访问存储器中的数据。
71.谓词检查模块710还基于所确定的多个谓词，确定多个线程310中的至少一个执行线程。例如，谓词检查模块710可以将其谓词的值为真的线程确定为执行线程。
72.在一些实施例中，谓词检查模块710可以记录在多个线程的序列中从哪个线程开始谓词都为假。例如，谓词检查模块710可以确定从编号为n的线程开始谓词都为假。
73.在一些实施例中，谓词检查模块710可以基于谓词来确定是否从片外存储器760读取执行线程中指定的地址处的数据。例如，当执行线程的谓词的值为真时，谓词检查模块710可以指示从片外存储器760读取对应的数据，并将数据缓存在与执行线程对应的缓冲器750中。
74.排序输入模块720被配置为针对至少一个执行线程中的每个执行线程，确定目标数据。如上所述，可以基于谓词来确定目标数据。在一些实施例中，排序输入模块720将当前处理的线程编号传递给谓词检查模块710。谓词检查模块710根据线程编号和谓词真假决定如何处理，例如是否从片外存储器760读取数据并写入缓存器750中。
75.假如从线程n开始谓词都为假，则可分为三种情况：(1)当前处理的线程编号小于n且其谓词的值为真，则可以从与此线程对应的缓存器750中读取目标数据；(2)当前处理的线程编号小于n，且谓词的值为假，则可以使用全0的数据作为目标数据；(3)当前处理的线程编号大于等于n，则停止处理。
76.在一些实施例中，排序输入模块720可以将目标数据基于对应的执行线程的编号进行排序，以允许并行地读取和确定各个目标数据。
77.排序输出模块730被配置为将针对至少一个执行线程中的每个执行线程的目标数据的集合写入到多个线程中的每个目标线程的寄存器堆中。排序输出模块730可以通过广播总线将目标数据的集合写入到每个目标线程中。广播总线的宽度可以与寄存器堆的端口
和多个线程的数目相匹配。
78.在一些实施例中，在排序输入模块720与排序输出模块730之间可以设置转置模块740。转置模块740可以被配置为转置目标数据的集合来更新目标数据的所述集合。这样，经转置的目标数据的集合可以被写入每个目标线程中。
79.图8示出了根据本公开的一个实施方式的用于加载数据的装置800的示意框图。装置800可以被实现为或者被包括在图2的加速器系统200中。装置800可以包括多个单元，以用于执行如图4中所讨论的方法400中的对应步骤。每个单元可以实现谓词检查模块710、排序输入模块720、排序输出模块730和转置模块740中至少一个模块的部分或所有功能。
80.如图8所示，装置800包括：谓词确定单元810，被配置为基于接收到的单个加载指令，确定多个线程的多个谓词，每个谓词指示相应线程中所指定的地址是否有效，地址用于访问存储器中的数据；执行线程确定单元820，被配置为基于所确定的多个谓词，确定多个线程中的至少一个执行线程；目标数据确定单元830，被配置为针对至少一个执行线程中的每个执行线程，确定目标数据；以及写入单元840，被配置为将针对至少一个执行线程中的每个执行线程的目标数据的集合写入到多个线程中的每个目标线程的寄存器堆中。
81.根据本公开的一个示例性实现方式，目标数据确定单元830被配置为执行以下之一：响应于执行线程的谓词指示地址有效，基于地址从存储器提取针对执行线程的目标数据；或者响应于执行线程的谓词指示地址无效，基于预定值确定目标数据。
82.根据本公开的一个示例性实现方式，目标数据确定单元830被配置为：基于加载指令，确定执行线程的寄存器堆中用于存储地址的地址寄存器；从地址寄存器读取地址；以及基于地址从存储器提取针对执行线程的目标数据。
83.根据本公开的一个示例性实现方式，目标数据确定单元830还被配置为：基于4字节或16字节的数据宽度来提取目标数据。
84.根据本公开的一个示例性实现方式，写入单元840被配置为：基于加载指令，确定多个线程中的目标线程；基于加载指令，确定寄存器堆中的目标寄存器；以及基于目标数据的集合的大小，将目标数据的集合写入到寄存器堆中的至少一个连续的寄存器，至少一个连续的寄存器起始于目标寄存器。
85.根据本公开的一个示例性实现方式，装置800还包括：转置单元850，被配置为通过转置目标数据的集合来更新目标数据的集合。
86.根据本公开的一个示例性实现方式，转置单元850还被配置为：每字节或每双字节转置目标数据的集合。
87.根据本公开的一个示例性实现方式，其中多个线程按编号被排序为序列，并且执行线程确定单元820被配置为：确定序列中的目标子序列，目标子序列起始于序列中的起始线程，并且结束于序列中最后一个其谓词的值为真的线程；以及将目标子序列中的所有线程确定为至少一个执行线程。
88.根据本公开的一个示例性实现方式，提供了一种用于广播加载数据的加载指令，也称为广播读指令。广播读指令被执行时使得处理引擎执行以下操作：确定多个线程的多个谓词，每个谓词指示相应线程中所指定的地址是否有效，地址用于访问存储器中的数据；基于所确定的多个谓词，确定多个线程中的至少一个执行线程；针对至少一个执行线程中的每个执行线程，确定目标数据；以及将针对至少一个执行线程中的每个执行线程的目标
数据的集合写入到多个线程中的每个目标线程的寄存器堆中。
89.根据本公开的一个示例性实现方式，广播读指令可以包括用于指定地址寄存器的第一参数和用于指定目标寄存器的第二参数。基于该广播读指令，目标数据的集合可以被写入每个目标线程的寄存器堆中的至少一个连续的寄存器。
90.根据本公开的一个示例性实现方式，提供了一种计算机可读存储介质。该介质存储多个程序，多个程序被配置为一个或多个处理引擎执行，多个程序包括用于执行上文描述的方法的指令。
91.根据本公开的一个示例性实现方式，提供了一种计算机程序产品。该计算机程序产品包括多个程序，多个程序被配置为一个或多个处理引擎执行，多个程序包括用于执行上文描述的方法的指令。
92.根据本公开的一个示例性实现方式，提供了加速器系统。该加速器系统包括：处理器；以及与所述处理器耦合的存储器，所述存储器具有存储于其中的指令，所述指令在被所述处理器执行时使得所述设备执行上文描述的方法。
93.本公开可以是方法、设备、系统和/或计算机程序产品。计算机程序产品可以包括计算机可读存储介质，其上载有用于执行本公开的各个方面的计算机可读程序指令。
94.此外，虽然采用特定次序描绘了各操作，但是这应当理解为要求这样操作以所示出的特定次序或以顺序次序执行，或者要求所有图示的操作应被执行以取得期望的结果。在一定环境下，多任务和并行处理可能是有利的。同样地，虽然在上面论述中包含了若干具体实现细节，但是这些不应当被解释为对本公开的范围的限制。在单独的实施方式的上下文中描述的某些特征还可以组合地实现在单个实现中。相反地，在单个实现的上下文中描述的各种特征也可以单独地或以任何合适的子组合的方式实现在多个实现中。
95.尽管已经采用特定于结构特征和/或方法逻辑动作的语言描述了本主题，但是应当理解所附权利要求书中所限定的主题未必局限于上面描述的特定特征或动作。相反，上面所描述的特定特征和动作仅仅是实现权利要求书的示例形式。