电平转换电路的制作方法

1.本发明涉及半导体集成电路设计领域，特别是指一种电平转换电路。


背景技术：

2.在设计电路时，很多情况下会出现电平不匹配的情况，最常用的方式就是增加电平转换芯片。
3.作为应用广泛的一种电路，传统电平转换电路在转换电平过程中有较高延迟-能量的综合开销，如图1所示。基于此提出一款具有低综合开销的高性能电平转换电路。


技术实现要素：

4.本发明所要解决的技术问题在于提供一种电平转换电路，具有低综合开销。
5.为解决上述问题，本发明所述的一种电平转换电路，由nmos管及pmos管及一个反相器所组成，包含一个输入端及两个差分输出端；
6.所述的nmos管包含nm0～nm5共6个nmos，所述的pmos管包含pm0～pm7共8个pmos；
7.所述输入端为整个电平转换电路的输入接口，输入端与nm4的栅极及反相器的输入端相连，所述输入端还与pm2的栅极相连；所述反相器的输出端与nm5的栅极以及pm3的栅极相连，反相器对所述输入端输入的信号反向后进入下一级电路，最后形成差分输出端中的第二输出端；
8.pmos管中pm2、pm4、pm6管源漏依次串联，pm6的漏极与nm2的漏极相连，nm2的源极再与nm4的漏极相连，nm4的源极接地；
9.pm0、pm1、pm2、pm3的源极接电源vddh，pm0的栅极与nm2的栅极连接并与pm6的串联节点相连；所述pm0的漏极与nm0的漏接连接，所述nm0的源极接地；
10.所述pm0余nm0串接的节点为所述电平转换电路的第一输出端；
11.pm3与pm5、pm7、nm3、nm5依次串联，所述nm5的源极接地；
12.所述pm6与nm2的连接节点同时连接到pm5的栅极，所述pm7与nm3的连接节点同时连接到pm4的栅极；所述nm2与nm4的连接节点同时连接到nm0以及pm6的栅极，所述nm3与nm5的连接节点同时连接到pm7以及nm1的栅极；
13.所述pm5与pm7的连接节点同时连接到pm1以及nm3的栅极，所述pm1与nm1的漏源串接，其串接节点形成所述电平转换电路的第二输出端；所述nm1的源极接地。
14.进一步地，所述的反相器还接有电源vdd，所述vdd的电压低于vddh。
15.进一步地，所述的mos管nm0～nm5以及pm0～pm7均为高压mos管。
16.进一步地，当输入端信号为低电平时，电平转换电路的第一输出端输出高电平。
17.进一步地，当输入端信号从低变到高电平时，电平转换电路的第一输出端输出高电平。
18.一种终端，包括所述的电平转换电路。
19.本发明所述的电平转换电路，通过高压nmos和pmos形成新的电路，在各种工作状
态下均具有更低的功耗。
附图说明
20.图1是现有的一种电平转换电路的结构原理图。
21.图2是本发明电平转换电路的结构原理图。
具体实施方式
22.以下结合附图给出本发明的具体实施方式，对本发明中的技术方案进行清楚、完整的描述，但本发明不限于以下的实施方式。显然，所描述的实施例是本发明的一部分实施例，而不是全部的实施例。根据下面说明和权利要求书，本发明的优点和特征将更清楚。需说明的是，附图均采用非常简化的形式且均使用非精准的比率，仅用于方便、明晰地辅助说明本发明实施例的目的。本领域普通技术人员在不做出创造性劳动的前提下所获得的所有其它实施例，都属于本发明保护的范围。
23.应当理解，本发明能够以不同形式实施，而不应当解释为局限于这里提出的实施例。相反地，提供这些实施例将使公开彻底和完全，并且将本发明的范围完全地传递给本领域技术人员。在附图中，为了清楚，层和区的尺寸以及相对尺寸可能被夸大，自始至终相同附图标记表示相同的元件。应当明白，当元件或层被称为“在
…
上”、“与
…
相邻”、“连接到”或“耦合到”其它元件或层时，其可以直接地在其它元件或层上、与之相邻、连接或耦合到其它元件或层，或者可以存在居间的元件或层。相反，当元件被称为“直接在
…
上”、“与
…
直接相邻”、“直接连接到”或“直接耦合到”其它元件或层时，则不存在居间的元件或层。应当明白，尽管可使用术语第一、第二、第三等描述各种元件、部件、区、层和/或部分，这些元件、部件、区、层和/或部分不应当被这些术语限制。这些术语仅仅用来区分一个元件、部件、区、层或部分与另一个元件、部件、区、层或部分。因此，在不脱离本发明教导之下，下面讨论的第一元件、部件、区、层或部分可表示为第二元件、部件、区、层或部分。
24.为了使本发明实现的技术手段、创作特征、达成目的与功效易于明白了解，下面结合具体图示，进一步阐述本发明。
25.本发明所述的电平转换电路，如图2所示，包含nm0～nm5共6个nmos管，pm0～pm7共8个pmos管。所述的nmos管和pmos管全部为高压mos管。
26.电源端包含有两路电源，vddh和vdd，其中vddh电压高于vdd。所述电平转换电路包含第一输出端vout和第二输出端voutn。第二输出端voutn和第一输出端vout输出相反的信号。
27.输入端in，所述输入端in为整个电平转换电路的输入接口，输入端in与nm4的栅极及反相器的输入端相连，所述输入端还与pm2的栅极相连；所述反相器的输出端与nm5的栅极以及pm3的栅极相连，反相器对所述输入端输入的信号反向后进入下一级电路，最后形成差分输出端中的第二输出端。输入端信号一路直接传输到nm4和pm2的栅极，另一路同时经反相器后再传输到nm5和pm3的栅极。
28.pmos管中pm2、pm4、pm6管源漏依次串联，pm6的漏极与nm2的漏极相连，nm2的源极再与nm4的漏极相连，nm4的源极接地。
29.pm0、pm1、pm2、pm3的源极接电源vddh，pm0的栅极与nm2的栅极连接并与pm6的串联
节点相连；所述pm0的漏极与nm0的漏接连接，所述nm0的源极接地。
30.所述pm0余nm0串接的节点为所述电平转换电路的第一输出端vout。
31.pm3与pm5、pm7、nm3、nm5依次串联，所述nm5的源极接地。
32.所述pm6与nm2的连接节点同时连接到pm5的栅极，所述pm7与nm3的连接节点同时连接到pm4的栅极；所述nm2与nm4的连接节点同时连接到nm0以及pm6的栅极，所述nm3与nm5的连接节点同时连接到pm7以及nm1的栅极。
33.所述pm5与pm7的连接节点同时连接到pm1以及nm3的栅极，所述pm1与nm1的漏源串接，其串接节点形成所述电平转换电路的第二输出端；所述nm1的源极接地。
34.继续参考图2，上述电平转换电路包含几个连接节点：a、b、c
……
f，其节点电压在工作时情况如下：
35.当输入信号in为低电平时，nm4截止而nm5导通，pm2和pm3均导通而pm3因存在阈值电压损失，所以a点和b点的电压分别被快速地上拉至vddh和vddh-vdd。h点被下拉到零电平，d和h点隔着二极管连接的nmos管和pmos管，此时相比于b点是vddh的情况，pm5由于b点存在电压损失，所以其电流在e点电压被上拉至vddh的过程中进一步减小，使得d点电压更快被下拉至mos管阈值电压vthp(pmos管的阈值电压)，但下拉速度仍然比h点更慢。由于此时pm7有明显的衬底偏置效应，而nm3几乎无衬偏效应，所以pm7的阈值电压更高，pm7截止而nm3弱导通，f点电压降至零电位。同理，可以推出g点电位被上拉为vddh-vthn(nmos管的阈值电压)，c点和e点电位都被上拉至为vddh。所以pm0导通，nm0截止，电平转换电路输出out端为高电平。
36.当输入信号in从低变到高电平时，nm4导通，nm5截止。pm2和pm3均导通而pm2存在阈值电压损失，所以a点和b点电压分别被快速地上拉至vddh-vdd和vddh。g点从vddh-vthn开始下拉，由于nm2和pm6的阻隔作用(pm6弱导通，nm2弱截止)c点电压下降的时间落后于g点。所以对于pm0和nm0支路，nm0能快速截止，而pm0后打开，该支路的短路电流非常小。同样，由于nm2和pm6存在，相当于在nm4和pm2之间插入大电阻，使得这一路的短路电流也非常小。当e点下拉后，pm5导通，d点先拉高，然后f点和h点拉高。同理对于pm1和nm1支路，也是pm1先截止，然后nm1后打开，流过该支路的短路电流同样很小。注意，在f点电压抬升的过程中，pm4导通电流相比与a点电压为vddh的时候要小很多，所以c点能够更快的被下拉，但下拉速度远小于g点。输入in变高后，输出端vout也随后变为高电平。相比于现有的设计，本发明的电平转换电路的电流非常小，这能进一步降低功耗。
37.当输入端in信号从高到低电平变化时，和上述过程类似，电平转换电路的输出变为低电平，该过程的短路电流同样很小。
38.因此，在各种工作状态下，本发明提供的上述电平转换电路在工作时都具有更小的电流，
39.以上仅为本发明的优选实施例，并不用于限定本发明。对于本领域的技术人员来说，本发明可以有各种更改和变化。凡在本发明的精神和原则之内，所作的任何修改、等同替换、改进等，均应包含在本发明的保护范围之内。