基于频谱平衡方法的自适应均衡电路与流程

本发明涉及基于频谱平衡方法的自适应均衡电路，属于自适应均衡电路技术领域。

背景技术：

数据传输过程中会受到衰减，需要均衡器对信号进行均衡，而不同的信道衰减是不同的，因此自适应均衡电路在数据通讯等领域中得到了广泛的应用。

接收端的自适应均衡电路主要分为连续时间线性均衡电路(ctle)和判决反馈均衡电路(dfe)。自适应均衡电路有多种均衡方法，其中基于频谱平衡的均衡方法是一种较为容易实现的方法。现有基于频谱平衡方法的电路如图8所示，由连续时间线性均衡电路和增益控制环路组成，其中转折频率fc与输入数据的速度有关。图8中由于fc固定，因此无法适应不同速度的数据。改进的电路如图9所示，由ctle、限制器电路(slicer)、增益控制环路以及fc控制环路组成，通过所述fc控制环路可以调整转折频率，以适应输入数据的不同速度，但是slicer会限制整体电路的速度。

因此，针对以上不足，需要提供一种新的自适应均衡电路，使转折频率fc可以自适应调整从而匹配不同速度的输入数据，并使整体电路保持较高的运行速度。

技术实现要素：

针对现有基于频谱平衡方法的均衡电路为实现对转折频率的自适应调整而采用的slicer会限制整体电路速度的问题，本发明提供一种基于频谱平衡方法的自适应均衡电路。

本发明的一种基于频谱平衡方法的自适应均衡电路，包括ctle、时钟数据恢复电路、增益控制环路和fc控制环路，

所述ctle根据增益控制信号调整增益，用于对原始输入信号进行均衡获得均衡后的数据信号；

所述时钟数据恢复电路用于由所述均衡后的数据信号恢复获得原始输入信号的恢复时钟和恢复数据；

所述增益控制环路用于检测所述均衡后的数据信号的高频功率和低频功率，并根据所述均衡后的数据信号的高频功率和低频功率以及转折频率控制信号调整增益控制信号，实现自适应增益控制；

所述fc控制环路用于检测所述恢复数据的高频功率和低频功率，并根据所述恢复数据的高频功率和低频功率调整转折频率控制信号，实现自适应转折频率控制，进而与原始输入信号的输入速率相适应。

根据本发明的基于频谱平衡方法的自适应均衡电路，所述时钟数据恢复电路包括边缘采样器、数据采样器及cdr逻辑，

所述ctle输出的均衡后的数据信号作为边缘采样器的一路输入和数据采样器的一路输入，边缘采样器的输出作为cdr逻辑的一路输入，数据采样器的输出作为cdr逻辑的二路输入，cdr逻辑输出的一路恢复时钟作为数据采样器的二路输入，cdr逻辑输出的二路恢复时钟作为边缘采样器的二路输入；所述数据采样器输出所述恢复数据。

根据本发明的基于频谱平衡方法的自适应均衡电路，所述增益控制环路包括一号低通滤波器、一号高通滤波器、一号整流器、一号v/i转换电路和电容cp1，

所述ctle输出的均衡后的数据信号作为一号低通滤波器的一路输入和一号高通滤波器的一路输入，fc控制环路输出的转折频率控制信号作为一号低通滤波器的二路输入和一号高通滤波器的二路输入，一号低通滤波器的输出作为一号整流器的一路输入，一号高通滤波器的输出作为一号整流器的二路输入，一号整流器的输出作为一号v/i转换电路的输入，一号v/i转换电路输出的信号作为增益控制环路输出的增益控制信号；

电容cp1连接在电源地和一号v/i转换电路的输出端之间。

根据本发明的基于频谱平衡方法的自适应均衡电路，所述fc控制环路包括二号低通滤波器、二号高通滤波器、二号整流器、二号v/i转换电路和电容cp2，

所述数据采样器的输出作为二号低通滤波器的一路输入和二号高通滤波器的一路输入，二号低通滤波器的输出作为二号整流器的一路输入，二号高通滤波器的输出作为二号整流器的二路输入，二号整流器的输出作为二号v/i转换电路的输入，二号v/i转换电路输出的信号作为fc控制环路输出的转折频率控制信号；

所述二号v/i转换电路的输出作为二号低通滤波器的二路输入和二号高通滤波器的二路输入；

电容cp2连接在电源地和二号v/i转换电路的输出端之间。

根据本发明的基于频谱平衡方法的自适应均衡电路，所述时钟数据恢复电路包括全速率、半速率或1/4速率。

本发明的有益效果：本发明可用于微电子芯片设计中，例如用于serdes系统中的自适应均衡电路。本发明中不采用slicer，而是采用时钟数据恢复电路代替slicer输出恢复数据，使数据在采样阶段可以达到较高的速度而不需要较高的增益；在保持阶段可以保持较大的增益，而不需要较快的速度，因此使本发明的整体电路在能够调整ctle增益为合适值的同时，可以达到较高的速度。另外时钟数据恢复电路可以减小输入信号的噪声和抖动，提高精度。本发明电路能自适应的调整ctle的增益，并且能适应原始输入信号的不同输入速度，具有速度快、精度高等优点。

附图说明

图1是本发明所述基于频谱平衡方法的自适应均衡电路的电路原理示意图；

图2是时钟数据恢复电路为1/4速率时自适应均衡电路的电路原理示意图；图中lpf表示低通滤波器，hpf表示高通滤波器；

图3是增益控制环路频谱平衡过程的示意图；式中s(db)表示分贝，f表示频率，pl表示低频功率，ph表示高频功率；

图4是输入信号的速度适中时的fc示意图；

图5是输入信号的速度较高时的fc示意图；

图6是输入信号的速度较低时的fc示意图；

图7是时钟数据恢复电路、增益控制环路和fc控制环路的锁定状态曲线图；图中vctrl表示cdr逻辑中vco的控制电压，可用来表示cdr逻辑的稳定性；v(v)表示电压；

图8是现有基于频谱平衡方法的电路图；

图9是对图8进行改进后的基于频谱平衡方法的电路图。

具体实施方式

下面将结合本发明实施例中的附图，对本发明实施例中的技术方案进行清楚、完整地描述，显然，所描述的实施例仅仅是本发明一部分实施例，而不是全部的实施例。基于本发明中的实施例，本领域普通技术人员在没有作出创造性劳动的前提下所获得的所有其他实施例，都属于本发明保护的范围。

需要说明的是，在不冲突的情况下，本发明中的实施例及实施例中的特征可以相互组合。

下面结合附图和具体实施例对本发明作进一步说明，但不作为本发明的限定。

具体实施方式一、结合图1和图2所示，本发明提供了一种基于频谱平衡方法的自适应均衡电路，包括ctle1、时钟数据恢复电路2、增益控制环路3和fc控制环路4，

所述ctle1根据增益控制信号调整增益，用于对原始输入信号进行均衡获得均衡后的数据信号；

所述时钟数据恢复电路2用于由所述均衡后的数据信号恢复获得原始输入信号的恢复时钟和恢复数据；

所述增益控制环路3用于检测所述均衡后的数据信号的高频功率和低频功率，并根据所述均衡后的数据信号的高频功率和低频功率以及转折频率控制信号调整增益控制信号，实现自适应增益控制；

所述fc控制环路4用于检测所述恢复数据的高频功率和低频功率，并根据所述恢复数据的高频功率和低频功率调整转折频率控制信号，实现自适应转折频率控制，进而与原始输入信号的输入速率相适应。

本实施方式中，由ctle1输出的数据经由时钟数据恢复电路2进行恢复后再输出，获得恢复数据dout；为与原始输入信号din的速率进行匹配，通过增益控制环路3调整增益控制信号vc，而增益控制信号vc的结果又与fc控制环路4输出的转折频率控制信号vf相关，转折频率控制信号vf又基于时钟数据恢复电路2输出的恢复数据获得，因此，本发明通过有效的环路设计，实现了对原始输入信号的自适应均衡。

所述时钟数据恢复电路2可以恢复数据并生成理想的波形。fc控制环路4可调整增益控制环路3和fc控制环路4的转折频率，实现对数据速率的自适应调整。

所述增益控制环路3使用频谱平衡方法，比较ctle的输出信号的高频功率和低频功率，并调整增益控制信号vc进而调整ctle的增益使ctle输出信号的高频功率和低频功率相等，此时ctle的增益为合适的值。

fc控制环路4使用频谱平衡方法，比较时钟数据恢复电路2输出恢复数据的高频功率和低频功率，调整转折频率控制信号vf进而调整增益控制环路3和fc控制环路4中滤波器的转折频率，使时钟数据恢复电路2输出信号的高频功率和低频功率相等。因为时钟数据恢复电路2输出数据的波形接近理想波形，所以此时的fc为准确的，并且fc可以随着输入数据的速度的变化而变化。

进一步，结合图1和图2所示，所述时钟数据恢复电路2包括边缘采样器21、数据采样器22及cdr逻辑23，

所述ctle1输出的均衡后的数据信号作为边缘采样器21的一路输入和数据采样器22的一路输入，边缘采样器21的输出作为cdr逻辑23的一路输入，数据采样器22的输出作为cdr逻辑23的二路输入，cdr逻辑23输出的一路恢复时钟作为数据采样器22的二路输入，cdr逻辑23输出的二路恢复时钟作为边缘采样器21的二路输入；所述数据采样器22输出所述恢复数据。

本实施方式中，原始输入信号din首先输入至ctle1，数据采样器22结合cdr逻辑23输出的时钟信号，对ctle1输出的均衡后的数据信号进行采样处理，进一步获得恢复数据dout；边缘采样器21对输入的均衡后的数据信号进行采样处理，获得边缘信息信号，与恢复数据dout同时输入至cdr逻辑23，cdr逻辑23获得两相相位不同的时钟，分别输出给边缘采样器21和数据采样器22。

所述数据采样器22在数据采样阶段可以达到较高的速度，此时不需要较高的增益；在保持阶段具有较大的增益，此时不需要较快的速度。

时钟数据恢复电路2对均衡后的数据信号进行恢复，输出数据的波形可接近理想波形，将其作为标准调整转折频率fc。时钟数据恢复电路2可以减小输入噪声和抖动的影响，能使fc控制环路4得到更准确的结果。

再进一步，结合图1和图2所示，所述增益控制环路3包括一号低通滤波器31、一号高通滤波器32、一号整流器33、一号v/i转换电路34和电容cp1，

所述ctle1输出的均衡后的数据信号作为一号低通滤波器31的一路输入和一号高通滤波器32的一路输入，fc控制环路4输出的转折频率控制信号作为一号低通滤波器31的二路输入和一号高通滤波器32的二路输入，一号低通滤波器31的输出作为一号整流器33的一路输入，一号高通滤波器32的输出作为一号整流器33的二路输入，一号整流器33的输出作为一号v/i转换电路34的输入，一号v/i转换电路34输出的信号作为增益控制环路3输出的增益控制信号；

电容cp1连接在电源地和一号v/i转换电路34的输出端之间。

所述一号低通滤波器31和一号高通滤波器32将输入的信号分为高频成分和低频成分两路输出，再通过一号整流器33比较高频功率和低频功率，一号v/i转换电路34根据一号整流器33的比较结果对电容cp1进行充放电，进而调整ctle1的增益。

再进一步，所述fc控制环路4包括二号低通滤波器41、二号高通滤波器42、二号整流器43、二号v/i转换电路44和电容cp2，

所述数据采样器22的输出作为二号低通滤波器41的一路输入和二号高通滤波器42的一路输入，二号低通滤波器41的输出作为二号整流器43的一路输入，二号高通滤波器42的输出作为二号整流器43的二路输入，二号整流器43的输出作为二号v/i转换电路44的输入，二号v/i转换电路44输出的信号作为fc控制环路4输出的转折频率控制信号；

所述二号v/i转换电路44的输出作为二号低通滤波器41的二路输入和二号高通滤波器42的二路输入；

电容cp2连接在电源地和二号v/i转换电路44的输出端之间。

所述二号低通滤波器41和二号高通滤波器42将输入的信号分为高频成分和低频成分两路输出，再通过二号整流器43比较高频功率和低频功率，二号v/i转换电路44根据二号整流器43的比较结果对电容cp2进行充放电，进而调整转折频率控制信号vf。

所述二号低通滤波器(lpf)41和二号高通滤波器(hpf)42的转折频率fc可以调整，并且转折频率由两个环路的fc控制输入端的信号进行调整。

作为示例，所述时钟数据恢复电路2包括全速率、半速率或1/4速率。钟数据恢复电路2还可以根据需要采用其它不同的速率。

对应于cdr逻辑23采用不同的速率，fc控制环路4的转折频率也要做相应的调整，以1/4速率为例，fc控制环路的转折频率应为1/4fc。

本发明中共包括三个环路，分别为时钟数据恢复电路2、增益控制环路3和fc控制环路4，其中时钟数据恢复电路2需最先完成锁定，在其完成锁定前，增益控制环路3和fc控制环路4无法得到准确的结果；在其完成锁定后，增益控制环路3不会影响fc控制环路4，只会单方面的受到fc控制环路4的影响。

具体实施例：结合图2所示，原始输入信号din频率为28ghz，时钟数据恢复电路2采用1/4速率的cdr，电源电压为1.2v，工作过程如下：

其整体电路的工作过程为：原始输入信号din通过ctle1，ctle1通过增益控制信号vc调整其增益。ctle1的输出同时作为时钟数据恢复电路2和增益控制环路3的输入。增益控制环路3检测ctle1输出信号的功率，根据检测结果调整ctle1的增益。时钟数据恢复电路2从输入的信号中恢复出时钟和数据，其中数据作为恢复数据输出；因为时钟数据恢复电路2采用1/4速率，共恢复出4位数据，可分别输入到不同的fc控制环路4中，时钟数据恢复电路2恢复出的数据接近理想的波形。fc控制环路4检测时钟数据恢复电路2恢复的数据的功率，并根据检测结果调整vf，进而调整各个滤波器的转折频率。

所述ctle1：将输入信号的高频成分进行放大，其增益(高频增益减低频增益)由增益控制信号vc进行控制，增益最大处的频率约为14ghz。

所述时钟数据恢复电路2：cdr逻辑根据输入数据调整生成时钟的相位，并使时钟相位对齐数据的中心，通过数据采样器22在时钟到来时对原始输入信号进行采样，得到正确数据，最终使数据接近理想的波形。对于1/4速率的cdr，可得到4位1/4速率的数据，8位1/4速率的时钟，其中4位时钟作为数据采样器22的输入用于对齐数据中心，另外4位时钟作为边缘采样器21的输入用于对齐数据边缘。在cdr锁定之前，因为时钟尚未对齐数据中心，此时采样得到的数据不准确。

所述增益控制环路3：使用频谱平衡方法，如图3所示，通过将均衡后的信号用hpf和lpf分成高频成分和低频成分，并用整流器比较高频功率和低频功率，v/i转换电路根据比较结果对电容进行充放电，调整ctle的增益。

如果均衡后的信号为理想的伪随机二进制码，则功率谱sx(f)为：

式中f为频率，tb为一比特数据的周期；

将公式(2)用fc分成高频成分和低频成分，并使两者相等：

即当fc＝0.28/tb时，理想信号的高低频功率相等。增益控制环路调整ctle的增益，直到ctle输出的高低频功率相等，此时ctle的输出接近理想信号，完成了补偿。fc＝0.28/tb仅在信号为伪随机二进制码时成立。

fc控制环路4：当输入信号的速度发生变化时，fc也会发生变化，所以要想实现对数据速率自适应需要调整fc，如图4至图6所示。fc控制环路同样使用频谱平衡的方法，通过输入接近理想的信号，并调整fc控制环路的转折频率fc2直到理想信号的高低频功率相等，此时的fc2即为合适的值。fc控制环路同时还控制增益控制环路的fc，因为本实例的cdr是1/4速率的，fc控制环路的输入数据的频率也是1/4的，fc2＝1/4fc。只有当cdr完成锁定后，fc控制环路才能得到正确的输入数据，此时输出的vf才是准确的。由图4至图6可知，输入信号的速率越高，转折频率越大，输入信号的速率越低，转折频率越小。

三个环路的锁定状态：锁定状态如图7所示。初始时，时钟数据恢复电路、增益控制环路以及fc控制环路尚未稳定，此时cdr恢复的数据不是准确的数据，fc控制环路无法得到准确的fc。经过一段时间后，cdr完成锁定，输出正确的数据，此时增益控制环路以及fc控制环路尚未稳定，fc控制环路调整fc，增益控制环路随着fc的变化调整ctle的增益。最终，增益控制环路和fc控制环路同时完成锁定，此时ctle的增益以及fc为合适的值。图7中三条曲线对应三个环路的锁定状态，状态稳定时即为锁定。

综上所述，本发明在适应不同数据速度的同时，具有速度快、精度高的优点。

虽然在本文中参照了特定的实施方式来描述本发明，但是应该理解的是，这些实施例仅仅是本发明的原理和应用的示例。因此应该理解的是，可以对示例性的实施例进行许多修改，并且可以设计出其他的布置，只要不偏离所附权利要求所限定的本发明的精神和范围。应该理解的是，可以通过不同于原始权利要求所描述的方式来结合不同的从属权利要求和本文中所述的特征。还可以理解的是，结合单独实施例所描述的特征可以使用在其他所述实施例中。