一种电力系统二次设备网络对时系统及方法
【技术领域】
[0001]本发明涉及一种电力系统二次设备网络对时系统及方法，属于电力自动化技术领域。
【背景技术】
[0002]在智能变电站中，二次设备同步对时应用开始由脉冲逻辑对时向数字化网络对时过渡，这是智能变电站全数字化的必然需求。由于智能变电站内合并单元、PMU(相量测量单元)等二次设备对于对时精度及稳定性的要求很高，其余二次设备为了提高采样精度和方便事故分析，对对时精度要求也会越来越高。因此高精度网络对时成为了电力系统二次设备的一个基本功能。
[0003]目前在电力系统二次设备中实现网络对时主要是借助国外现成的芯片技术，如DP83640 ;该类芯片是物理层芯片，能够达到基本的网络对时精度，但是芯片易受温度、电磁环境、网络等外部因素干扰且使用该类芯片需重新制板，成本太高，扩展性能差，独立端口少，破环原有稳定的硬件环境。
[0004]智能变电站二次设备中的时钟设备作为网络对时的发起端，其余二次设备作为网络对时的接收端，有着不同的应用需求。绝大多数二次设备需要接入两个相互独立的网络，来接收两路网络对时信号，那么二次设备必须正确隔离及处理这两路对时信号。而时钟设备则需要向大量独立网络发送对时信号，那么时钟装置可以输出的独立端口数量必须大大增加。
[0005]在IEEE1588规范中明确了最佳主时钟算法，该算法可以从接收来的多路IEEE1588报文中选择其中一路，并将该路的发起源作为主时钟源。IEEE1588报文中存在通知报文，通知报文内部有精度字段、时间源字段、优先级字段以及端口信息字段。最佳主时钟算法会先判断各路报文的精度字段，精度字段表示报文发起源本身的授时精度，算法优先选择精度最高的发起源；若精度一样，再比较时间源字段，在我国，北斗源优先于GPS源；若时间源一样，则比较优先级字段，它指代发起源在整个系统的优先级，算法选择优先级高的发起源；若以上都一样，会根据端口信息做比较，由于端口信息每个发起源均不同，算法会根据端口数字大小顺序选择发起源。
【发明内容】
[0006]为解决现有技术中的不足，本发明提供一种电力系统二次设备网络对时系统及其对时方法，解决了对时芯片成本高、二次设备输入及输出的独立端口数量受限的问题。
[0007]为了实现上述目标，本发明采用如下技术方案:一种电力系统二次设备网络对时系统，包括CPU，FPGA,物理层网卡芯片PHY，恒温晶振OCXO ;所述CPU与FPGA通过PCIE总线连接；所述FPGA包括通过FPGA实现的以太网媒体访问控制器MAC和硬件时间戳探测及生成模块和锁相回路PLL ;所述PHY与MAC通过媒体独立接口 MII连接；所述OCXO与PLL连接，为FPGA提供时钟信号；所述锁相回路PLL用于消除OCXO输出时钟波形的扭曲和延迟；所述硬件时间戳探测及生成模块用于捕获IEEE1588报文进入MAC层和PHY层之间的MII层的时刻。
[0008]前述的一种电力系统二次设备网络对时系统，其特征是:所述MAC包括8个发送MAC和2个接收MAC ；
[0009]前述的一种电力系统二次设备网络对时系统，其特征是:所述OCXO频率为20MHz，所述FPGA将OCXO频率倍频至100MHz，使得硬件时间戳最小分辨率由50ns提高至10ns。
[0010]前述的一种电力系统二次设备网络对时系统，其特征是:所述CPU采用不低于266MHz主频的POWERPC架构或者ARM架构的CPU。
[0011]前述的一种电力系统二次设备网络对时系统，其特征是:所述FPGA逻辑单元数量不少于24000个。
[0012]基于上述任——种电力系统二次设备网络对时系统的对时方法，其特征在于:包括步骤:
[0013]I)网络对时输入:外部两个独立网络通道内的IEEE1588报文依次通过PHY层和MII层进入FPGA的两个接收MAC，判断这两路报文是否通过CPU的最佳主时钟算法，若否，则FPGA通过接收MAC将IEEE1588报文的特征信息传送给CPU，CPU通过最佳主时钟算法选择使用其中一个通道内报文的发起源作为主时钟，并告知FPGA只接收这一通道内的IEEE1588 报文；
[0014]2)过滤报文并提高报文对时同步精度:若IEEE1588报文已经经过最佳主时钟算法的计算，则FPGA判断所选通道内的报文为IEEE1588报文还是为二次设备需要接收的相关报文；如果是相关报文，则选择接收，否则丢弃该报文；同时，当OCXO输出波形的出现扭曲或者产生延迟时，FPGA利用内部锁相回路PLL自身输出时钟信号作为输入时钟信号以保持整个时钟信号稳定，直至OCXO输出信号恢复稳定；PLL电源电路采用专用隔离电源电路，使PLL的电源与总线电源分开；
[0015]3)采用FPGA给报文添加硬件时间戳:FPGA通过硬件时间戳探测及生成模块捕获IEEE1588报文进入MAC层和PHY层之间的MII层的时刻，将此时刻的时间戳记录下来；FPGA将得到的硬件时间戳添加到IEEE1588报文后面，并将报文通过PCIE总线传输给CPU ；
[0016]4)网络对时同步:CPU对步骤3)传输的IEEE1588报文利用IEEE1588标准技术进行延迟偏移计算和时钟频率修正，使得整个二次设备的内部时钟频率与IEEE1588发起源的时钟频率同步；当二次设备同步后，CPU再以自身时钟频率为基准构建新的IEEE1588报文发送给FPGA ；
[0017]5)网络对时输出:FPGA同时向八个发送MAC输出上述步骤得到的对时同步报文，这些报文再依次通过MII层和PHY层进入独立的网络通道。
[0018]前述的一种电力系统二次设备网络对时方法，其特征是:步骤I)中所述报文特征信息指IEEE1588报文内的精度字段、时间源字段、优先级字段以及端口信息字段。
[0019]前述的一种电力系统二次设备网络对时方法，其特征是:步骤I)中所述最佳主时钟算法为CPU获取两路IEEE1588报文的特征信息，并按照优先级顺序逐个比较特征信息，直至选中其中一路报文，并将这路报文的发起源作为主时钟。
[0020]前述的一种电力系统二次设备网络对时方法，其特征是:所述相关报文为二次设备正常运行需要的报文，包括GOOSE报文、SV报文。
[0021]本发明所达到的有益效果:本发明以FPGA为核心，可以在不变更硬件结构的条件下，使用较低的成本实现多通道的高精度网络对时；同时通过PLL锁相回路以及加盖在MII层的硬件时间戳技术，还可以大大提高网络对时精度；本发明输入独立端口数能达2个，输出独立端口数能达8个，成本低、扩展性能强，可广泛应用于变电站综合自动化系统的二次设备。
【附图说明】
[0022]图1是电力系统二次设备网络对时系统结构图；
[0023]图2是电力系统二次设备网络对时方法流程图。
【具体实施方式】
[0024]下面结合附图对本发明作进一步描述。以下实施例仅用于更加清楚地说明本发明的技术方案，而不能以此来限制本发明的保护范围。
[0025]如图1所示，一种电力系统二次设备网络对时系统，包括CPU，FPGA，物理层网卡芯片PHY，恒温晶振OCXO ;所述CPU与FPGA通过PCIE总线连接；所述FPGA包括通过FPGA实现的以太网媒体访问控制器MAC和硬件时间戳探测及生成模块和锁相回路PLL ;所述MAC包括8个发送MAC和2个接收MAC ;所述PHY与MAC通过媒体独立接口 MII连接；所述OCXO与PLL连接，为FPGA提供时钟信号；所述锁相回路PLL用于消除OCXO输出时钟波形的扭曲和延迟；所述硬件时间戳探测及生成模块用于捕获IEEE1588报文进入MAC层和PHY层之间的MII层的时刻，将此时刻的时间戳记录下来。
[0026]外部恒温晶振OCXO频率为20MHz，FPGA将OCXO频率倍频至10MHz，使得硬件时间戳最小分辨率由50ns提高至10ns，进而提高整个系统的同步精度。
[0027]CPU采用不低于266MHz主频的POWERPC架构或者ARM架构的CPU。
[0028]FPGA逻辑单元数量不少于24000个，以确保FPGA内部十个MAC的构建。
[0029]如图2所示，基于上述一种电力系统二次设备网络对时系统的对时方法，步骤包括:
[0030]I)网络对时输入:外部两个独立网络通道内的IEEE1588报文依次通过PHY层