用于直接存取混合测试的设备和方法与流程

用于直接存取混合测试的设备和方法
1.相关申请案的交叉引用
2.本技术案主张2019年10月2日申请的第16/590,694号美国专利申请案的权益。前述申请案出于任何目的以引用的方式整体并入本文中。


背景技术：

3.本公开大体上涉及半导体装置，且更确切地说，涉及半导体存储器装置。一些存储器装置可作为系统级封装(sip)安装于第二装置(例如，图形卡、母板、计算系统等)上。sip可包含主机装置(例如，处理器)并且在正常操作模式中，可通过主机装置执行对存储器的电路的存取。存储器装置还可包含直接存取端子，其为允许信号直接耦合到存储器装置且信号无需通过存储器装置和主机装置之间的接口的端子。
4.可能需要在存储器装置封装到sip装置上之后测试所述存储器装置。举例来说，测试可涉及将数据样式写入到一或多个存储器单元，并且接着读回写入的数据。可能需要绕过sip装置的其它组件以便通过直接存取端子执行测试，然而，可能难以通过直接存取端子提供长数据样式。


技术实现要素：

5.在至少一个方面中，本公开涉及一种设备，其包括：直接存取(da)端子；存储器阵列；查找表，其存储多个测试样式；直接存取混合(da混合)电路和错误捕捉存储器(ecm)电路。所述da混合电路从所述直接存取端子接收测试指令，并且基于所述测试指令提供来自所述查找表的所述多个测试样式中的一个所选测试样式。所述ecm电路基于所述测试指令存储结果信息。
6.所述设备还可包含高带宽存储器(hbm)装置。所述hbm装置可包含：接口裸片，其可包含所述直接存取端子、所述查找表、所述da混合电路和所述ecm电路；和核心裸片，其可包含所述存储器阵列。
7.所述测试指令可包含与所述存储器阵列的所选存储器单元相关联的地址和与所述查找表中的所述多个测试样式中的所述所选测试样式相关联的指针值。响应于所述测试指令，可将所述所选测试样式存储于所述所选存储器单元中。所述da混合电路可存储所述测试指令并且当从与所述测试指令相关联的所述所选存储器单元读取数据时，将所述指针值提供给所述查找表。
8.所述ecm电路可接收来自所述存储器阵列的存储器单元的读取数据和来自所述查找表的所述所选测试样式，并且基于所述读取数据与所述所选测试样式的比较，产生所述结果信息。
9.所述设备还可包含测试接口电路，其接收来自所述da端子的所述多个测试样式并将其存储于所述查找表中，并且将来自所述ecm电路的所述结果信息提供给所述da端子。所述测试接口电路可为ieee 1500接口电路。
10.在至少一个方面中，本公开可涉及一种设备，其包括：直接存取(da)端子；至少一
个核心裸片，其包含多个存储器单元；和接口裸片，其存储多个测试样式。所述接口裸片通过所述da端子接收与所述多个存储器单元中的至少一个相关联的地址以及与所述多个测试样式中的一个所选测试样式相关联的索引指针，并且将所述多个测试样式中的所述所选测试样式存储到与所述地址相关联的所述存储器单元。
11.所述接口裸片也可从所述存储器单元读取所述多个测试样式中的所述所选测试样式，将所述读取测试样式与所述多个测试样式中的所述所选测试样式进行比较，并且基于所述比较产生结果信息。所述接口裸片可将所述结果信息提供给所述da端子。
12.所述接口裸片可包含可存储所述多个测试样式的查找表。可在所述设备的第一操作模式中通过所述da端子将所述多个测试样式加载到所述查找表中。作为所述设备的第二操作模式的部分，可将所述地址和所述索引指针提供给所述da端子。所述设备还可包含测试接口电路，所述测试接口电路可在所述设备处于所述第一操作模式中时接收所述多个测试样式。所述da端子可包含探测垫。
13.在至少一个方面中，本公开可涉及一种方法。所述方法包含在存储器的直接存取端子处接收测试指令；基于所述接收到的测试指令，从存储于所述存储器的查找表中的多个测试样式选择测试样式；将所述测试样式写入到所述存储器的存储器单元；从所述存储器单元读取数据；和将所述测试样式与所述读取数据进行比较并且基于所述比较产生结果信息。
14.所述方法还可包含将所述存储器置于直接存取ieee 1500操作模式中并且在所述ieee 1500操作模式中通过所述直接存取端子读取所述结果信息。所述方法还可包含将所述存储器置于直接存取ieee 1500操作模式中并且将所述多个测试样式存储于所述查找表中。
15.所述方法还可包含存储所述接收到的测试指令。将所述测试样式与所述读取数据进行比较可包含基于所述所存储的测试指令检索所述测试样式。所述测试指令可包含与所述所选测试样式相关联的数据指针和与所述存储器单元相关联的地址。所述方法还可包含在时钟信号的上升边沿接收第一地址并且在所述时钟信号的下降边沿接收第二地址。
16.在至少一个方面中，本公开可涉及一种设备，其包含具有直接存取端子的存储器装置和测试器。所述测试器将所述存储器装置置于第一操作模式中并且将多个测试样式提供给所述直接存取端子。所述测试器将所述存储器装置置于第二操作模式中并且将至少一个测试指令提供给所述直接存取端子。所述测试器将所述存储器装置置于所述第一操作模式中并且接收与所述至少一个测试指令相关联的结果信息。
17.所述第一操作模式可为直接存取ieee 1500模式。所述至少一个测试指令可包含地址和与所述多个测试样式中的一个相关联的数据指针。所述数据指针可包含第一数目的位且所述多个测试样式中的每一个可包含大于所述第一数目的位的第二数目的位。
附图说明
18.图1是根据本公开的实施例的系统级封装(sip)装置的横截面。
19.图2是根据本公开的实施例的存储器装置的框图。
20.图3是根据本公开的实施例的存储器装置的操作模式的状态图。
21.图4是根据本公开的实施例的执行测试操作的方法的流程图。
22.图5是根据本公开的实施例的直接存取转换器电路。
23.图6是根据本公开的实施例的直接存取混合模式测试操作中的信号的定时图。
24.图7是根据本公开的实施例的存储器装置的框图。
25.图8是根据本公开的实施例的存储器装置的框图。
具体实施方式
26.以下对某些实施例的描述在本质上仅是示范性的，且决不意图限制本公开的范围或其应用或用途。在对本发明的系统和方法的实施例的以下详细描述中，参考形成本文的一部分的附图，以及借助于说明示出的其中可实践所描述的系统和方法的特定实施例。足够详细地描述这些实施例，以使所属领域的技术人员能够实践当前公开的系统和方法，且应理解，可利用其它实施例，且在不脱离本公开的精神和范围的情况下可进行结构和逻辑改变。此外，为清晰起见，某些特征的详细描述在其对于所属领域的技术人员来说将显而易见时将不予以论述，以免使本公开的实施例的描述混淆不清。因此，以下详细描述不应在限制性意义上理解，且本公开的范围仅由所附权利要求书限定。
27.存储器装置可包含可用于存储信息的数个存储器单元。举例来说，每一存储器单元可存储单一信息位。一些存储器装置可与一或多个其它装置一起封装于系统级封装(sip)装置中。举例来说，sip装置可包含封装于包含可充当sip的主机装置的一或多个处理器(例如，gpu、cpu等)的计算装置上的存储器装置。在正常操作模式中，可沿着主机装置和存储器装置之间的通道发送和接收信息(例如，数据、指令、时钟信号和/或其它信号)。sip装置还可包含直接存取端子，其允许在无需通过主机装置的情况下传送信息进出存储器装置。
28.可能需要在存储器装置已封装到sip装置中之后对所述存储器装置执行一或多个测试。一般来说，测试可涉及作为写入操作的部分，将数据样式加载到存储器装置的一或多个存储器单元中；作为读取操作的部分，从存储器单元检索所存储的信息；和将写入的数据与读取数据进行比较。可使用存储器的内置式自测试(bist)电路执行测试，所述bist电路可加载有数据测试样式以及用于执行测试的指令。然而，在许多情况下，使用具有随机特性的极长测试样式执行测试可为有用的，这需要比bist电路中的实际存储空间更多的存储空间。也可通过直接存取端子直接发送测试样式和指令来执行测试。然而，可存在相对少的数目的可用直接存取端子(例如，与主机和存储器装置之间的连接数目相比)，且在每个测试操作期间通过直接存取端子提供长测试样式可为效率低下的。
29.本公开是针对用于直接存取混合测试的设备、系统和方法。数个测试样式可预装载到存储器装置中并且存储于存储器的查找表中。作为直接存取(da)混合模式中的测试操作的部分，可通过直接存取端子提供测试指令。测试指令可包含一或多个存储器单元的地址信息，以及从查找表检索一或多个测试样式的指针信息(例如，查找表的索引)。由指针信息指示的测试样式接着可写入到由地址信息指示的存储器单元。存储器装置还可包含错误捕捉存储器(ecm)电路。ecm电路可将从存储器单元读取的信息与查找表中的写入到那些存储器单元的测试样式进行比较并且可基于所述比较产生结果信息。可通过直接存取端子从存储器读出所述结果信息。
30.图1是根据本公开的实施例的系统级封装(sip)装置的横截面。sip装置100包含存
储器装置102和处理器110，所述存储器装置102和处理器110与插入件112一起封装于封装衬底114上。
31.如图1的实例中所示，存储器装置102可为高带宽存储器(hbm)装置，其包含接口裸片(或逻辑裸片)104和堆叠于接口裸片104上的一或多个存储器核心裸片106。存储器装置102包含用以耦合接口裸片104和核心裸片106的一或多个穿硅通孔(tsv)108。处理器110可充当sip 100的主机装置。
32.处理器110和存储器装置102两者通过数个微凸块111耦合到插入件112。穿过插入件112的通道105可将与处理器110耦合的微凸块111中的一些耦合到与存储器装置102耦合的微凸块111中的相应微凸块以形成存储器装置102和处理器110之间的接口。虽然在图1中仅示出三个通道105，但可使用更多或更少数目的通道105。插入件112可由一或多个凸块(例如c4凸块113)耦合到封装衬底。封装衬底114包含凸块115，所述凸块115中的一些耦合到处理器110且所述凸块115中的一些耦合到存储器装置102。直接存取(da)凸块116通过封装衬底114和插入件112耦合到接口裸片104。
33.直接存取凸块116(例如，凸块115的耦合到接口裸片104的部分)可组织成探测垫。例如测试器的外部装置可耦合到探测垫上以便发送和接收来自存储器装置102的信号，且无需那些信号传送到处理器110。特定来说，测试器可用于将一或多个测试样式预加载到接口裸片104的查找表中。测试器接着可沿着直接存取端子116提供一或多个测试指令。接口裸片104可基于测试指令和预加载的测试样式对核心裸片106执行一或多个测试并且可产生结果信息。在执行测试之后，测试器可通过da端子116读出结果信息。
34.图2是根据本公开的实施例的存储器装置的框图。图3是根据本公开的实施例的存储器装置的操作模式的状态图。在一些实施例中，存储器装置200可包含在图1的存储器装置102中。状态图300表示实例存储器装置(例如存储器装置200)的操作。应理解，存储器装置200可具有比图3中示出的操作模式更多或更少的操作模式，且可在其它实施例中使用状态之间的不同路径(例如，在一些实施例中，信号可使存储器装置200从hbm待机模式312转变到p1500待机模式332)。
35.类似于图1中示出的存储器装置，存储器装置200可为hbm装置，具有接口裸片204和一或多个核心裸片206。为了清楚起见，在图2中仅示出单一核心裸片206，然而，应理解，多个核心裸片206可耦合到接口裸片204(例如，可存在3或7个核心裸片206)。
36.为了突出显示测试程序的操作，仅示出了接口裸片204的在测试过程中涉及的某些组件。应理解，可在各种操作中涉及接口裸片204的未示出的其它组件。举例来说，各种组件示出为经由多路复用器被耦合以表示可沿着不同信令路径路由信号。出于清楚起见，未示出控制这些多路复用器的信号以及控制这类路由的逻辑电路。
37.存储器装置200包含用于存取核心裸片206和/或存储器的一或多个电路的三个不同接口端子，即固有微凸块(ubump)205、直接存取(da)ubump 216和测试接口ubump 220。测试接口ubump 220可为特定接口协议(例如ieee 1500接口(还被称作p1500接口))的部分。一般来说，测试接口ubump 220可被称为p1500 ubump 220(以及相关p1500操作模式、p1500电路等)，然而，应理解，可在其它实例实施例中使用其它测试接口协议。
38.图3的状态图300示出固有模式310、da模式320和p1500模式330。这些模式中的每一个可含有一或多个操作模式，所述操作模式中的每一个主要使用指定接口端子传送信息
进出存储器装置200。举例来说，固有模式310包含hbm待机模式312和固有模式314，其中的每一个主要使用固有ubump 205与存储器通信。da模式320包含da 1500模式322、da直接模式324和da混合模式326，其中的每一个主要使用da ubump 216与存储器装置200通信。p1500模式330包含p1500待机模式332和内置式自测试(bist)模式334，其中的每一个主要使用p1500 ubump 220。
39.在接收到重置信号之后，存储器装置200可进入hbm待机模式312。在处于hbm待机模式312中时，存储器装置200可进行检查以确定存储器装置200是否应转变到da1500模式322。在处于hbm待机模式312中时，存储器装置200可接收将存储器装置200置于固有操作模式314中的命令(例如，沿着固有ubump 205)。固有操作模式314可表示存储器装置200的正常操作模式，其中根据从主机装置(例如，图1的处理器110)发送和接收的信号来执行存储器操作。
40.在固有操作模式314中，逻辑裸片可通过固有ubump 205发送和接收信息。在一些实施例中，这些固有ubump 205可包含在图1的ubump 111中。固有ubump 205可经由一个或多个通道(例如，图1的105)耦合到处理器(例如，图1的处理器110)。处理器可通过固有ubump 205发送和接收信息以存取核心裸片206中的信息(例如，执行读取或写入操作)。处理器也可使用固有ubump 205执行存储器装置200的一或多个其它操作，例如起始存储器装置200的刷新模式。
41.在作为固有模式314的部分的实例存取操作中，可在固有ubump 205处接收到请求核心裸片206中的一或多个的存储器单元上的存取操作(例如读取操作)的信号。可在固有ubump 205处接收到与指定将读取的存储器单元的地址一起指示读取操作的命令指令以作为被称为
‘
aword’的数据包的部分。aword可含有地址信息，所述地址信息可指示将读取哪些存储器单元。举例来说，核心裸片206中的每一个可包含存储器阵列，所述存储器阵列可包含布置于行(字线)和列(位线)的相交点处的存储器单元。aword可含有地址信息，例如指定一或多个行和列的相交点处的存储器单元的行地址和列地址。aword也可含有额外地址信息，例如组地址、特定核心裸片206的地址等。aword还可包含命令信息，例如用于操作和命令定时以指示正在执行的是读取操作还是写入操作的时钟信号。响应于在读取命令期间的地址信息，核心裸片206可通过从地址信息指定的存储器单元读取数据并且接着提供所述数据作为dword的部分来做出响应，所述dword可提供给固有ubump 205。
42.在固有模式314的另一实例操作中，可在固有ubump 205处接收到请求核心裸片206中的一或多个的某些存储器单元上的存取操作(例如写入操作)的信息。可在固有ubump 205处接收到aword以及含有将写入的数据的dword，所述aword指定写入操作并且包含将被写入的存储器单元的地址信息。aword和dword可提供给核心裸片206，所述核心裸片206可将含于dword中的信息写入到aword中的地址信息指定的存储器单元。
43.在一些实施例中，接口裸片204可包含沿着将出自核心裸片206中的一个的dword耦合到固有ubump 205的路径的串行器电路233。在这类实施例中，与存在的固有ubump 205相比，在接口裸片204和核心裸片206之间可存在数目大得多的连接。串行器电路233可沿着第一数目的数据线(例如，从核心206)并行接收信息，并且接着沿着小于第一数目的第二数目的数据线(例如，通到固有ubump 205)以串联方式提供所述信息。
44.在一些情况下，可能需要将存储器装置200置于测试模式中以便确定存储器装置
200的一或多个特性。存储器装置200可包含一或多个测试模式，其中的一些可利用通过p1500 ubump 220的测试接口且其中的一些可利用da ubump 216。p1500 ubump 220可用于使用用于发送和接收信号的特定测试接口发送或接收通过主机装置的信号。存储器装置200可接收将其置于p1500待机模式332中的测试模式重置信号。类似于hbm待机模式312，在p1500待机模式332中，存储器装置200可等待沿着p1500 ubump 220接收一或多个命令。当沿着p1500 ubump 220接收到命令时，存储器装置200可从p1500待机模式332转变到bist模式334。
45.在bist模式334期间，存储器装置200可使用p1500 ubump 220发送和接收信号以操作bist定序器228。p1500 ubump 220耦合到测试接口电路(例如，p1500电路)224，所述测试接口电路224可解译使用p1500信号协议发送和接收的信号。举例来说，p1500电路224可将在p1500 ubump处接收到的信号转译成可供存储器装置200的其它电路使用的信号且反之亦然。在p1500操作模式330中，存储器装置200可接收通过p1500 ubump 220的信号并且将那些信号提供给p1500电路224。类似地，来自存储器装置200的信号可提供给p1500电路224，所述p1500电路224接着可经由p1500 ubump 220将那些信号发送出存储器装置。
46.在bist操作模式334期间，可接收到操作bist定序器228以对存储器执行测试的指令。bist定序器228可产生将写入到核心裸片206的存储器单元的测试序列(例如，逻辑位串)。bist定序器228可包含可用于存储将测试的存储器单元的地址以及测试序列的数个寄存器。由于bist定序器228中的空间可为有限的，因此测试序列和/或地址可基于指令在bist定序器228内产生。举例来说，bist定序器228可对特定地址值执行测试，使所述地址值递增一，并且接着再次执行测试。在一些实施例中，为节约bist定序器228中的空间，bist定序器228可将测试序列加载到查找表中，所述查找表例如数据拓朴(dtopo)电路230。dtopo电路230中的每一条目可与指针值(例如，索引值)相关联，并且bist定序器228可以类似于地址的方式产生指针值序列。
47.在bist模式334中的测试的写入部分期间，bist定序器228可将地址信息(例如，一或多个行地址和列地址)和测试序列(例如，将写入到地址信息指定的存储器单元的数据)提供给输入缓冲器234。在一些实施例中，bist定序器228可将地址信息提供给输入缓冲器234，并且可将索引信息提供给dtopo电路230，所述dtopo电路230可将测试序列提供给输入缓冲器234。
48.输入缓冲电路234可为寄存器，所述寄存器可存储值并且接着将所述值写入到核心裸片206。输入缓冲电路234可操作为先进先出(fifo)电路，并且可被称为写入fifo(wfifo)电路234。基于从wfifo 234提供的地址信息，测试序列可写入到地址信息指定的存储器单元。
49.在bist模式334中的测试的读取部分期间，bist定序器228可提供地址信息以检索先前存储于核心裸片206中的测试序列。信息可从地址信息指定的存储器单元读出到输出缓冲电路235。输出缓冲电路235可大体类似于输入缓冲器234，不同之处在于输出缓冲器235接收来自核心裸片206的信息并且接着将所述信息提供到接口裸片204的其它电路上。输出缓冲器235可为读取fifo(rfifo)电路235。
50.错误捕捉存储器(ecm)电路232可用于基于读取测试序列产生结果信息。ecm电路232可耦合到提供给输入缓冲器234的地址信息和测试序列，并且还包含用以存储写入的测
试序列以及关于测试序列写入到哪些存储器单元的地址信息的一或多个寄存器。当执行读取操作时，ecm电路232可将来自输出缓冲器235的读取测试序列与作为较早写入操作的部分写入到那些存储器单元的测试序列进行比较，并且可基于所述比较产生结果信息。ecm电路232接着可将结果信息(例如，哪些存储器单元未通过、作为什么测试的部分等)提供给p1500电路224，所述p1500电路224接着可在p1500 ubump上提供出自存储器的结果信息。
51.除固有模式310和p1500模式330以外，存储器装置200也可进入da模式320。在一些情境中，可能需要绕过sip封装的其它组件(例如，图1的处理器110)以直接发送和接收来自存储器装置200的信号。在装置处于da模式320中的一个中时，可沿着da ubump 216发送和接收信号，可绕过sip的其它组件并且允许外部装置(例如，测试器电路、探测器)直接发送和接收来自存储器装置200的信号。
52.在处于hbm待机模式312中时，存储器装置200可转变到直接存取模式320中的一个，例如da1500模式322。这可涉及激活da启用信号。举例来说，da ubump 216中的一个可用作da启用引脚，并且当在da启用引脚处接收到da启用信号(例如逻辑高)时，存储器可转变到da1500模式322。如果未接收到da启用信号(例如，da启用引脚处于低逻辑电平)，那么存储器装置可保持于hbm待机模式312中。存储器装置200也可从bist模式334转变到da1500模式322。这可涉及da启用信号/引脚，且/或可涉及经由p1500接口发送的信号。
53.接口裸片204包含绕过sip的其它组件以允许进出存储器装置的直接耦合的数个直接存取(da)ubump 216(例如，图1的da凸块116)。在一些实施例中，这些da ubump 216可组织成探测垫，其中外部装置(例如，探测器、测试器)可耦合到da ubump 216以便存取接口裸片204(并且通过接口裸片204存取核心裸片206)。
54.在da1500模式322中，da ubump 216可用于使用p1500接口协议发送和接收信号。这些信号可遵守p1500 ubump 220的接口标准，不同之处在于通过da ubump 216而非p1500 ubump 220发送和接收信号。如本文中更详细描述，da1500模式322可用于加载出于测试电路(例如dtopo电路230和/或ecm电路232)的信息。这类信息可在da ubump 216和p1500电路224之间传送并且接着传达进出其它电路，如先前关于bist模式334所描述。
55.举例来说，在存储器处于da1500模式322中时，测试序列可通过da ubump 216加载到dtopo电路230中。每个测试序列可表示可(串行或并行地)提供给核心裸片的逻辑位串。测试序列可具有匹配一或多个dword中的数据量的位数。在实例操作中，当加载dtopo电路时，存储器200可置于da1500模式322中，且测试器可将位串提供给da ubump 216，所述da ubump 216可路由到p1500电路224。p1500电路接着又可将位串提供给dtopo电路230，在所述dtopo电路230中可存储位。
56.可将存储器装置200从da1500模式322放置到其它da模式320中。举例来说，存储器装置200可置于da直接模式324中。在da直接模式324中，存储器装置200可以类似于固有模式314的方式操作，不同之处在于沿着da ubump 216而非固有ubump 205提供信息。
57.举例来说，在da直接模式324中，da ubump 216可以类似于固有模式314的方式接收(和/或提供)aword和dword。在一些实施例中，与存在的固有ubump 205相比，可存在较少da ubump 216。为了模仿沿着固有ubump 205的信号的操作，可使用并行器电路222。并行器电路222可从da ubump 216接收aword和dword并且接着将接收到的串行数据拆分成数个并行通道。在一些实施例中，并行器电路222可将aword和dword拆分成数个并行通道以模仿固
ubump 216加载的数据样式中的一个不同数据样式。在一些实施例中，每个数据条目可包含数个字节的数据。在一些实施例中，每一条目还可包含与那些字节相关联的错误校正信息(例如，错误校正码)。也可基于数据提供给核心裸片206的方式结构化数据条目。举例来说，如果核心裸片206能够在给定时钟循环中(例如，基于核心裸片206的数据端子数目)接受并行接收到的数个数据位，那么每个数据条目可包含将并行提供给每个数据端子的数个位。在一些实施例中，每一条目可包含将在第一时间间隔期间在数据端子处提供的第一位集、将在第二时钟间隔期间提供的第二位集等。表1示出可作为dtopo电路230的条目中的一个加载的位序列的实例。表1的实例示出存储于dtopo条目中的特定位排序，然而，应理解，可在其它实例实施例中使用其它位排序。
66.表1.实例测试样式/dtopo条目
[0067][0068][0069]
不同的字节示出为一起分组在寄存器群组a-p中。每个寄存器群组可表示dtopo电路的给定条目中的位的一部分。举例来说，如果每个寄存器群组存储数据字节，那么每个寄存器群组可存储8位的信息。在一些实施例中，每个寄存器群组可存储更多位以便容纳与数据相关联的额外信息，例如错误校正信息。表1的实例dtopo条目包含在四个不同单位间隔中的每一个处提供的四个字节(例如，四个
‘
突发’，每突发四个字节)。单位间隔可表示用以控制存储器中的定时的时钟波形(或其部分)。举例来说，ui可表示半时钟周期(例如，上升边沿或下降边沿)。换句话说，当从dtopo电路230调用时，每个数据条目可用于在第一单位间隔期间提供四个字节的第一集，随后在第二单位间隔期间提供四个字节的第二集，在第三单位间隔期间提供四个字节的第三集，并且在第四单位间隔期间提供四个字节的第四集。举例来说，在第一单位间隔期间，可一起提供来自寄存器群组a、e、i和m的字节。随后，在第二单位间隔期间，可提供来自寄存器群组b、f、j和n的字节等等。
[0070]
在一些实施例中，存储器装置200中可存在多个dtopo电路230。举例来说，存储器
的每一通道且可沿着那些通道提供给存储器的每个dword都可存在dtopo电路230。所述dtopo电路230可用以将类似于在固有操作模式314中接收到的dword流的数据流提供到核心。举例来说，如果存在8个通道，所述8个通道中的每一个可携载4个dword，那么可存在总计32个不同的dtopo电路230，所述32个不同的dtopo电路230中的每一个可包含多个条目(例如，32个dtopo中每dotop 8个条目，总共128个条目)。
[0071]
框414后面通常可为框422，其描述进入da混合模式。当处于da混合模式326中时，可在da ubump 216接收信息并将所述信息提供给da转换器电路226。举例来说，在da混合模式326中接收到的信息可包含测试指令，例如地址信息，以及可用于选择先前存储于dtopo电路230中的的数据样式的一或多个数据指针。da转换器电路226可路由信息以使得对核心裸片206执行测试程序。
[0072]
框422后面通常可为框424，其描述对存储器执行测试。如先前论述，通常可通过将测试数据写入到核心裸片206的存储器单元，读取存储于那些存储器单元中的数据并且将写入的测试数据与读取的测试数据进行比较以确定是否存在任何差异，以此执行所述测试。
[0073]
在框424期间，可通过da ubump 216提供测试指令以对核心裸片206执行一或多个写入操作。在实例写入操作中，da转换器电路226可接收包含地址信息和数据指针的测试指令。地址信息可拆分并且可作为aword提供给输入缓冲器234。数据指针可提供给dtopo电路230，所述dtopo电路230将存储于与数据指针的值相关联的条目中的数据样式作为dword提供给输入缓冲器234。因此，从dtopo电路230检索的数据样式可写入到地址信息指定的存储器单元。以此方式，可在da ubump 216上提供测试指令，无需在da ubump 216处还提供测试数据样式，原因是测试数据样式预加载于dtopo电路230中。在表2中提供测试指令的实例。
[0074]
表2.实例测试指令
[0075][0076]
表2的第一列描述接收到给定信号的引脚。每个引脚可为da ubump 216中的一个个别da ubump 216。可在各种实施例中使用不同引脚指派，因此在表2的实例中，已通过使用字母表示与给定信号相关联的引脚群组来抽象化引脚指派。例如m、n、
ⅰ
、j、k、p、x、q、r和y等字母各自用以表示整数数目。举例来说，da[m+8:m]表示从引脚编号m到引脚编号8+m的引
脚。在不同实施例中，给定字母的准确值可改变。
[0077]
在表2表示的实施例中，可存在60个不同的da ubump 216，然而，在一些实施例中，那60个da ubump 216中的一些可预留并且在da混合模式326中不可用。举例来说，在一些实施例中，38个da ubump 216在da混合模式326中可用。在一些实施例中，da转换器226可基于多少个da ubump 216可用而在不同模式之间转变。举例来说，可存在38个da模式(例如，其中60个da ubump 216中仅38个da ubump 216可用)和60个da模式。表2的实例可表示38个da模式。可在其它实施例中使用引脚到不同功能的不同指配。
[0078]
在表2的实例中，预留一个引脚以用作da启用信号da en。此da启用信号da en可用于指示存储器是否应从固有模式310或p1500模式330转变到da模式320。如表2的实例中所示，此引脚可为引脚编号28，然而，在其它实施例中，可使用不同引脚用于da启用信号。九个引脚用于列地址c[0]到c[8]，而七个引脚用于行地址r[0]到r[6]。两个引脚可分别用于时钟信号ck_t和ck_c，而另一引脚用于时钟启用信号cke。列地址c和行地址r以及时钟信号可提供给输入缓冲器234。
[0079]
测试指令还可包含数据指针信息位(例如，dptr)。在实例实施例中，由于每个dtopo包含八个条目，因此指针信息的长度可为三个位。可在其它实施例中使用数据指针的其它数目的位。还包含数据反转位(例如，dinv)。当数据反转位处于作用中(例如，处于高逻辑电平)时，可发指令给dtopo电路230以反转所提供的测试样式的所述的逻辑电平。以此方式，可用测试样式的数目可加倍而无需dtopo电路230中有更多条目。还提供数据掩蔽位(例如，dm)，可用于掩蔽数据总线中的一个的输出。数据掩蔽位可用作比较操作的部分。
[0080]
da转换器电路226可存储对什么信息写入到哪些存储器单元的记录。举例来说，da转换器电路226可包含可存储行和列地址信息(c和r)以及数据指针信息(dptr)并且在一些实施例中，还存储反转位dinv和掩蔽位dm的查找表。此所存储的信息可当读取命令发到相同存储器单元(例如，基于地址信息)时被检索并且用以提供原始测试样式以与读取的测试样式进行比较。
[0081]
当从存储器单元读取测试数据时，也可提供行和列地址信息。当读取命令与行地址和列地址一起提供给da转换器电路226时，da转换器电路可从查找表检索数据信息。此数据信息可提供给dtopo电路230，所述dtopo电路230继而可将与所述数据信息相关联的测试样式提供给ecm电路232。此测试样式可为作为较早写入操作的部分写入到与地址信息相关联的存储器单元的测试样式。同时，读取命令和地址信息可提供给核心裸片206，可将来自与所述地址信息相关联的存储器单元的读取测试数据提供给ecm电路232。ecm电路232可将来自dtopo 230的测试数据与读取测试样式进行比较并且可基于所述比较产生结果信息。ecm电路232可存储数个这类结果信息片段直到随后从ecm电路232检索这类结果信息片段为止。
[0082]
框424后面通常可为框432，其描述将存储器装置200置于da1500模式中。存储器装置200可从da混合模式326转变到da1500模式322。
[0083]
框432后面通常可为框434，其描述读取ecm结果。如先前论述，ecm电路232可用于存储结果信息的多个条目，其中每一条目表示写入的测试样式和读取的测试样式之间的比较的概述。表3表示可从ecm电路232读出的条目的实例。
[0084]
表3.ecm电路的实例条目
[0085]
位描述寄存器群组xsid寄存器群组w组寄存器群组v行地址寄存器群组u列地址寄存器群组t数据inv寄存器群组sdtopo指针寄存器群组r字节/dq/ui失败信息寄存器群组q失败旗标
[0086]
类似于表1，第一列识别存储于ecm电路232的条目中的位串的一或多个位。在一些实例实施例中，每个条目可比每个dtopo条目长(例如，更多位)。第二列识别与第一列中识别的位相关联的含义是什么，且第三列提供额外注释。
[0087]
ecm电路232的条目可包含失败信息。举例来说，寄存器群组q一失败旗标，其可用于指示进行测试的过程是否成功执行。如果失败旗标处于低电平，那么这可指示测试以某一方式失败，且条目中的数据的剩余部分无效。ecm电路232的条目可包含关于测试的存储器单元和对其执行的测试的信息。举例来说，寄存器群组u、v和w包含地址信息，例如组信息、行地址信息和列地址信息。寄存器群组x可包含系统识别(sid)信息。ecm电路232的条目可包含关于使用的测试样式的信息。举例来说，寄存器群组s和t包含指针信息(例如，dptr的值)和数据反转信息(例如，dinv)。
[0088]
ecm电路232的条目还可包含表示测试结果的数个
‘
失效’位。每一位可存在作为测试样式的部分写入(且因此还作为读取测试样式的部分读取)的失效位。每个失效位可表示将写入的测试样式的位与读取的测试样式的对应位进行比较的结果。在一些实施例中，失效位可为逻辑操作(例如写入的测试位和对应的读取的测试位之间的xor)的结果。因此，如果写入的测试位和读取的测试位匹配，那么失效位可处于逻辑低，且如果所述位不匹配，那么失效位可处于高逻辑电平。可在其它实例实施例中使用将写入的测试位与读取的测试位进行比较的其它方法。
[0089]
表3的实施例可包含使用表1中描述的测试样式执行的测试的结果信息。因此，可存在四个集，每个集四个字节，其中四个字节的集在单位间隔期间一起写入。相应地，寄存器群组r包含四个不同单位间隔中的每一个内四个字节中的每一个的失效信息(例如，总共16个字节的失效信息)。在一些实施例中，寄存器群组r还可包含错误校正信息。
[0090]
类似于可为多个dtopo电路230，还可存在多个ecm电路232。举例来说，存储器的每一通道并且沿着那个通道的每个数据字都可存在单独的ecm电路232。举例来说，如果存在八个通道和每通道四个数据字，那么可存在总共32个ecm电路232。每个ecm电路232还可包含各自与写入的数据字值的测试数据与读取的数据字值的测试数据的比较相关联的多个条目(例如，类似于表3中示出的实例条目)。在一些实施例中，与每个dtopo 230相比，每个ecm 232可具有不同数目的条目。在一些实施例中，每个ecm 232可与每个dtopo 230具有相同数目的条目。
[0091]
在一些实施例中，可执行方法400以使得在从ecm电路232读出那些测试的结果之前将所有所要测试样式写入到存储器以及从存储器读取所有所要测试样式(例如，作为步
骤424的部分)。在一些实施例中，执行测试通常可比读取所述测试的结果更快速。举例来说，沿着da ubump 216提供的用以执行测试的数据(例如，表2的实例的的28个位)比提供的用以检索所述测试的结果的数据(例如，表3的实例的184个位)少。因此，为了有效地利用时间，可快速执行数个测试，并且接着可读出结果。在一些实施例中，可基于ecm电路232的总条目数目来运行数个测试。举例来说，在框424中描述的步骤期间，可执行数个测试直到跨ecm电路232的总条目数已满。方法400接着可继续进行到框434，其中通过读出那些条目清空ecm电路232。在一些实施例中，如果期望与ecm电路232具有用以存储测试结果的空间相比执行更多的测试，那么在执行框434的步骤之后，方法可返回到框422的步骤，且测试可重复。
[0092]
图5是根据本公开的实施例的直接存取转换器电路。在一些实施例中，da转换器电路500可包含在图2的da转换器电路226中。当存储器装置处于da混合模式(例如，图4的422)中时，da转换器电路500可从da ubump(例如，图2的216)接收信号。da转换器电路可接收包含作为aword的命令和地址信息的信息和包含作为dword的数据信息的信息。因为在当接收到将测试样式写入到一些指定存储器单元的命令时与当从那些存储器单元读回数据时之间可存在延迟，所以da转换器电路500可存储对什么测试数据写入到哪些存储器单元的记录，使得可执行稍后的比较。
[0093]
da转换器电路500包含从da ubump(例如，图2的216)接收经由并行器电路(例如，图2的222)提供的aword和dword的解码器电路540。解码器电路540可用于解译aword和dword中的信息。举例来说，aword可接收来自各个da ubump的输入，并且可基于其da ubump用以传送哪些信息片段的映射(例如，基于表2的引脚映射)将信息分组在一起。经解码信息可提供给编码器电路544，所述编码器电路544可将经解码信息组织成一型式以使得可以存储器的核心裸片(例如，图2的核心裸片206)辨识的格式提供信息。举例来说，编码器电路544可将从解码器电路540接收的信息编码为命令流总线信息。
[0094]
da转换器电路500还包含查找表542，其可用于存储解码器电路540提供的(全部或一部分)信息。举例来说，查找表542可存储解码器电路提供的地址信息(例如，行地址、列地址和组地址信息)以及关于测试样式的信息(例如，数据指针、数据掩蔽和数据反转位)。在一些实施例中，一或多个地址信息片段可用作查找表342的索引信息。举例来说，在一些实施例中，组信息可用于为查找表342加索引。在一个实例实施例中，在查找表342中可存在针对组地址的每一值的一个条目。因此，如果存在32个组，那么在查找表342中可存在32个条目。
[0095]
当正在执行测试操作时(例如，在图4的步骤424期间)，可将测试样式写入到存储器单元并且接着从那些存储器单元读取所述测试样式，且可将写入的测试数据与读取的测试数据进行比较。然而，对某一存储器单元集(例如，对给定行地址/列地址/组地址)的写入操作未必紧跟着来自那个存储器单元集的读取命令。换句话说，在将测试样式写入到第一存储器单元集之后，可在从第一存储器单元集读出测试样式之前，将数据写入到一或多个其它存储器单元集或从一或多个其它存储器单元集读取数据。当发出读取命令时，查找表542可基于地址信息提供关于哪个测试样式先前写入到那些存储器单元的信息。举例来说，查找表可将数据指针、数据掩蔽和数据反转信息通过编码器电路544提供给dtopo电路。dtopo电路继而可将测试样式提供给ecm电路以用于比较。
[0096]
图6是根据本公开的实施例的直接存取混合模式测试操作中的信号的定时图。定时图600表示在使用da混合模式测试操作(例如，图4的框424)期间提供给da ubump(例如，图2的216)的各个信号的操作。
[0097]
第一信号线表示da启用信号，所述da启用信号可在整个da混合模式操作中处于作用中。下一信号集表示命令和地址信号，例如aword。第一信号是用于确定存储器装置是否正在接收时钟信号的时钟启用信号cke。下两个信号ck_t和ck_c是时钟信号。aword的剩余两个信号是行地址和列地址。行地址可为七位信号，且列地址可为九位信号。下两个信号线表示可包含在数据信息(例如dword)中的信号。特定来说，示出了数据指针信号dptr和数据反转信号dinv。定时图600的最后信号线表示用以将接地电压(例如，vss)发射到存储器装置的预留信号线。
[0098]
特定来说，定时图600中示出的实施例可为其中上升时钟边沿和下降时钟边沿两者均用以对正在沿着da ubump提供给存储器装置的信息计时的实施例。在实例中，时钟信号具有频率1.6ghz，随后可以3.2gbps的速率(例如，是时钟信号的频率的两倍)发射行地址和列地址信息。应注意，dword信号仍可计时到时钟信号的上升边沿或下降边沿并且因此可具有1.6gbps的数据速率。因此，由于行地址和列地址信息可以两倍快的速度提供给存储器，因此可需要比表2的实例中使用的引脚指派更多的引脚指派。除了表2的引脚指派之外，表4还示出可供图6的实例实施例使用的实例引脚指派集。
[0099]
表4.实例下降边沿地址引脚指派
[0100][0101]
表4的实例示出16个额外引脚(7个用于行地址且9个用于列地址)可如何用于提供可在时钟信号的下降边沿读取的行地址和列地址。表4的引脚指派可与先前在表2的实例中描述的引脚指派一起用于在时钟信号的上升边沿提供行地址和列地址并且在时钟信号的下降边沿提供行地址和列地址。两个不同的地址集可共享数据信息(例如，数据指针dptr、数据反转dinv和数据掩蔽dm)。
[0102]
图7是根据本公开的实施例的存储器装置的框图。存储器装置700可大体类似于图2的存储器装置200，并且出于简洁起见，先前关于图2描述的特征和组件将不再进行描述。
[0103]
存储器装置700表示其中存储器装置700的da直接模式已经移除，且通过da ubump 716的仅有存取模式是da混合模式或da 1500模式的实施例。因此，允许刚好来自并行器722之后的信息直接发到核心裸片706的信号线已经移除。替代地，从并行器722提供的信息提供给da转换器电路726。
[0104]
图8是根据本公开的实施例的存储器装置的框图。存储器装置800可大体类似于图2的存储器装置200，并且出于简洁起见，先前关于图2描述的特征和组件将不再进行描述。
[0105]
存储器装置800表示不具有bist电路(例如，已经省略bist定序器228)的实施例。因此，存储器装置800可能不具有bist模式，并且可从p1500模式直接转变到da1500模式。
[0106]
当然，应了解，本文中所描述的实例、实施例或过程中的任一个可与一或多个其它实例、实施例和/或过程组合或分离和/或在根据本发明系统、装置和方法的单独装置或装
置部分当中执行。
[0107]
最后，上文的论述仅旨在说明本发明系统，且不应解释为将所附权利要求书限于任何特定实施例或实施例群组。因此，虽然已参考示范性实施例详细地描述了本发明系统，但还应了解，在不脱离如在所附权利要求书中所阐述的本发明系统的更广和既定精神和范围的情况下，所属领域的技术人员可设计众多修改和替代实施例。因此，说明书和附图应以说明性方式看待，且并不旨在限制所附权利要求书的范围。